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  • Tarjeta Entrenadora para FPGA Basada en Hardware Abierto. Transparencias

    Încărcat de

    Juan Gonzalez Gomez
    178 vizualizări12 pagini
    TRANSPARENCIAS. Presentación de la placa JPS, una tarjeta entrenadora para FPGAs de Xilinx, diseñada con una licencia abierta que ermite a cualquiera disponer de los esquemas y planos relativos al PCB, modificarlos y/o distribuirlos, así como fabricar la placa. La tarjeta permite realizar diseños autónomos sobre algunos modelos de FPGAs Spartan y XC4000. Éstos se pueden cargar desde una EEPROM serie incluida en la placa, o trabajar en modo entrenador, cargando los diseños desde el PC.

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    Tarjeta entrenadora para FPGA basada en Hardware abierto. Transparencias

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    Tarjeta entrenadora para FPGA,

    basada en Hardware abierto

    Juan González, Pablo Haya,


    Sergio López-Buedo, Eduardo Boemo

    Escuela Politécnica Superior


    Universidad Autónoma de Madrid
    Introducción

     Lenguajes HDL
     Los diseños son ficheros de texto (“Código fuente”)
     Proceso de diseño hardware, parecido al del software
     Compartir Hardware (¿GPL?)
     Hardware Libre

     Plataforma libre para probar los diseños:

    Tarjeta JPS
    Introducción:
    FPGAs

     Compuestas por bloques iguales configurables (CLBs)


     RAM y biestables
     Implementación de circuitos digitales
     Diseños a medida
     Prototipado rápido
     Solución hardware más rápida que usando microcontrolador

    CLB CLB CLB

    CLB CLB CLB


    La tarjeta JPS (I)

     Tarjeta entrenadora para FPGA


     Propósito general
     Uso principal en microrrobótica
     FPGAs soportadas:
    CLBs
    XC4003E 100
    XC4005E 196
    XC4010E 400
    XCS05 100
    XCS10 196
    La tarjeta JPS (II):
    Características

    ● FPGA
    ● 6 Puertos Expansión

    ● 8 bits, VCC, GND


    ● Oscilador

    ● Alimentación 5v

    ● Led y pulsador de pruebas

    ● Led y pulsador prog.

    ● Switches entrada

    ● Conexión PC/ext

    ● Memoria EEPROM serie

    ● Programación in circuit de

    la memoria EEPROM
    Modos de funcionamiento

     Modo autónomo
     No conexión al PC
     FPGA se carga desde la EEPROM
     Ejemplo aplicación: Microrrobots
     Modo entrenador
     Carga desde un PC
     Carga desde un sistema microcontrolador

    PC

    Micro
    Hardware abierto

     Software libre:
     Se puede utilizar para cualquier propósito
     Estudiar su código fuente y adaptarlo a tus necesidades
     Redistribuir copias libremente
     Redistribuir las modificaciones
     Ej. licencia GPL
     Hardware abierto/libre
     Diseños descritos mediante HDL: Igual que software libre (GPL?)
     Tarjeta JPS: esquema, PCB y ficheros fabricación (GERBER)
    Campos de aplicación

     Docencia
     Electrónica digital, lenguajes HDL
     Ciclo de diseño completo (diseño, simulación, síntesis y prueba)
     Modificable por profesores/alumnos
     EJ. Laboratorio Estructura y Diseño de Circuitos Digitales (UAM)
     Microcontroladores
     Desarrollo periféricos: controladores, coprocesadores, etc..
     Sistemas hardware reconfigurables
     Microrrobótica
     Diseño específico de CPUs para robótica
     Controladores para periféricos: PWM, ultrasonidos...
    Robot de docencia

     CPU: Panda-bear  Síntesis en FPGA XCS10


     16 bits  147 CLBs (75%)
     RISC  Frecuencia: 12MHZ
     8 instrucciones  Tarjeta JPS
     Laboratorio de Arquitectura e  Tarjeta GP_IFAZ
    Ingeniería de Computadores
    Ventajas e inconvenientes

    VENTAJAS INCONVENIENTES

     Hardware a la medida  Mayor precio


     Acortamiento ciclo diseño Entornos de desarrollo
    propietarios, con licencias altas
     Flexibilidad
     Pasar algoritmos a hardware
    Plataforma para diseños
    hardware libres
    Conclusiones

     Placa pequeña, sencilla y libre


     Orientada a la docencia y microrrobótica
     Laboratorio de Estructura y Diseño de Circuitos Digitales
     Laboratorio de Arquitectura e ingeniería de Computadores
    Construido el robot de docencia que usa una CPU diseñada en
    VHDL y sintetizada en la placa JPS
    FIN

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