DEPARTAMENTO DE TECNOLOGA ELECTRNICA

FUNDAMENTOS DE ELECTRNICA

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Escuela Politcnica Superior

Grado en Ingeniera
ASIGNATURA: Fundamentos de Electrnica

CURSO: 2012/2013

DEPARTAMENTO: Tecnologa Electrnica

Grupo: 2.9

Fecha: 22/05/2013

Tutorial PSPICE

Calificacin

Nombre alumno: Francisco Jos Ramrez Garca

Nombre alumno: Carlos Lara Cuevas

OBTENCIN DE LAS ECUACIONES DEL CIRCUITO:

1. Utilizar los conocimientos adquiridos en la parte terica de la asignatura para
calcular los valores de SUMA y ACARREO a partir slo de puertas NAND.
R1

SUMA
ACARREO

/(/(/A*B)/(A*/B))
/(/(A*B))

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RESPUESTAS DE LAS PRCTICAS DE ELECTRNICA DIGITAL

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DISEO DEL CIRCUITO:
2. Dibujar el esquema del sumador de un bit implementado (usa slo puertas
NAND). Hay que incluir en el esquema todos los componentes y marcadores utilizados
en el esquema de PSPICE.
R2

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REPRESENTACIN DE RESULTADOS:
3. Dibujar la grfica obtenida en el MicroSim Probe al simular el circuito sumador
de un bit diseado. Slo es necesario pintar los valores de las seales de entrada (A y B)
y de las seales de salida (SUMA y ACARREO).
R3

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Escuela Politcnica Superior
Grado en Ingeniera
ASIGNATURA: Fundamentos de Electrnica

CURSO: 2012/2013

DEPARTAMENTO: Tecnologa Electrnica

Grupo:2.9

Prctica n 2

Fecha:03/06/2013

Calificacin

Nombre alumno: Francisco Jos Ramrez Garca

Nombre alumno: Carlos Lara Cuevas
R1

A1
0
0
0
0
0
0
0
0
1
1
1
1
1
1
1
1
R2

ENTRADA
BINARIO
A0
B1
B0
0
0
0
0
0
1
0
1
0
0
1
1
1
0
0
1
0
1
1
1
0
1
1
1
0
0
0
0
0
1
0
1
0
0
1
1
1
0
0
1
0
1
1
1
0
1
1
1

Tabla de Karnaugh para S1 (minitrminos):

A1 A0
00
01
11
10
R3

SALIDA
DECIMAL DECIMAL
BINARIO
A+B
COUT S1
S0
0+0
0
0
0
0
0+1
1
0
0
1
0+2
2
0
1
0
0+3
3
0
1
1
1+0
1
0
0
1
1+1
2
0
1
0
1+2
3
0
1
1
1+3
4
1
0
0
2+0
2
0
1
0
2+1
3
0
1
1
2+2
4
1
0
0
2+3
5
1
0
1
3+0
3
0
1
1
3+1
4
1
0
0
3+2
5
1
0
1
3+3
6
1
1
0

00
0
0
1
1

01
0
1
0
1

B1 B0
11
1
0
1
0

10
1
1
0
0

Ecuacin simplificada para S1 (suma de productos):

S1 = /A1 /A0 B1 + /A1 B1 /B0 + A1 A0 B1 B0 + /A1 A0 /B1 B0 + A1 /B1 /B0 + A1 /A0 /B1

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R4

Tabla de Karnaugh para S0 (minitrminos):

A1 A0
00
01
11
10
R5

00
0
1
1
0

01
1
0
0
1

B1 B0
11
1
0
0
1

10
0
1
1
0

Ecuacin simplificada para S0 (suma de productos):

S0 = A0 /B0 + /A0 B0

R6

Conversin de S1 (suma de productos) a NAND:

S1 = /( / (/A1/A0B1) / (/A1B1/B0) / (A1A0B1B0) / (/A1A0/B1B0) / (A1/B1/B0) / (A1/A0/B1) )

R7

Conversin de S0 (suma de productos) a NAND:

S0 = / ( / (A0/B0) / (/A0B0) )

R8

Esquemtico de la suma de productos mediante AND y OR.

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R9

Esquemtico de la suma de productos mediante NAND

R10

Resultado de la simulacin (representar aqu un vez, pero simular y comprobar los 2

esquemticos).

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CURSO: _____/______

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Grupo: 2.9

Fecha:13/06/2013

Prctica n3

Calificacin

Nombre alumno: Francisco Jos Ramrez Garca

Nombre alumno: Carlos Lara Cuevas

R1

Tabla de Karnaugh para BCD0 (maxitrminos):

IN3 IN2
IN1 IN0

00

01

11

10

00

01

11

10

Ecuacin simplificada para BCD0 (producto de sumas):

R2
BCD0 = IN0

R3

Tabla de Karnaugh para BCD1 (maxitrminos):

IN3 IN2
IN1 IN0

00

01

11

10

00

01

11

10

Ecuacin simplificada para BCD1 (producto de sumas):

R4
BCD1 = ( IN1 + IN3 ) ( IN2 + /IN3 ) ( /IN1 + /IN3 )

R5

Tabla de Karnaugh para BCD2 (maxitrminos):

IN3 IN2
IN1 IN0

00

01

11

10

00

01

11

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10

Ecuacin simplificada para BCD2 (producto de sumas):

R6
BCD2 = IN2 ( IN1 + /IN3 )

R7

Tabla de Karnaugh para BCD3 (maxitrminos):

IN3 IN2
IN1 IN0

00

01

11

10

00

01

11

10

Ecuacin simplificada para BCD3 (producto de sumas):

R8
BCD3 = ( IN1 + IN3 ) ( IN1 + /IN2 ) ( /IN1 )

R9

Tabla de Karnaugh para BCD4 (maxitrminos):

IN3 IN2
IN1 IN0

00

01

11

10

00

01

11

10

Ecuacin simplificada para BCD4 (producto de sumas):

R10
BCD4 = ( IN3 ) ( IN1 + IN2 )

Conversin de BCD1 (producto de sumas) a NOR:

R12
BCD1 = /( /(IN1+IN3)+ /(IN2+/IN3) + /( /IN1 + /IN3 ) )

Conversin de BCD2 (producto de sumas) a NOR:

R13

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BCD2 = /( /( IN2 ) + /( IN1 + /IN3) )

Conversin de BCD3 (producto de sumas) a NOR:

R14
BCD3 = /( /( IN1 + IN3 ) + /( IN1 + /IN2) + /( /IN1) )

Conversin de BCD4 (producto de sumas) a NOR:

R15
BCD4 = /( /( IN3 ) + /( IN1 + IN2) )

Justificacin del circuito escogido para implementar la primera etapa:

R16
HEMOS ELEGIDO EL CIRCUITO FORMADO POR PUERTAS NOR CON EL OBJETIVO DE
LLEVAR A CABO LA PRCTICA MONTANDO LA PLACA, SOLO TENGAMOS QUE USAR
UN TIPO DE PUERTA LGICA Y POR TANTO BUSCANDO LA SIMPLICIDAD DE DICHA
PLACA.

R17

Esquemtico de BCDO, BCD1, BCD2, BCD3 Y BCD4:

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10