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Si un tage logique est construit laide de portes logiques (cest--dire si la sortie dune porte logique attaque lune des entres de la porte logique suivante) alors le temps de passage de ltage est au moins gal la somme des temps de passage des portes logiques qui le composent : dans ce cas, les temps de passage sajoutent. Il en rsulte quun changement des donnes en entre dun montage, non seulement mettra un certain temps se rpercuter en sortie, mais pourra en plus provoquer des changements dtat (impulsions) non souhaits la sortie. De telles impulsions parasites sont appeles hasards logiques. (a) Mise en vidence dun hasard logique. i. Exprimer la valeur de la sortie S du circuit ci-dessous en fonction de son entre E .
S1 E S2 S
ii. Complter le chronogramme suivant de ce circuit (on considre que toutes les portes logiques mises en jeu ont un mme temps de passage t ).
1 Entre E 0 Sortie S1 Sortie S2 1 0 1 0
1 Sortie S 0 t
(b) Exemples de mise prot des hasards logiques : dtecteur de transitions. i. Exprimer la valeur de la sortie S du circuit ci-dessous en fonction de son entre E .
S E 0 S1
ii. Complter le chronogramme suivant de ce circuit (on considre que toutes les portes logiques mises en jeu ont un mme temps de passage t ).
1 Entre E 0 Sortie S1 1 0
1 Sortie S 0 t
iii. Raliser un dtecteur de transitions pour lequel la dure des impulsions en S est de 3t . (c) Raliser un dtecteur de front montant, cest--dire un dtecteur de transitions qui ne rpond que lorsque le signal dentre passe dun niveau bas un niveau haut. (d) Raliser un dtecteur de front descendant, cest--dire un dtecteur de transitions qui ne rpond que lorsque le signal dentre passe dun niveau haut un niveau bas.