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Registros y Contadores
Contenidos
1. Registros
Registros con entrada serie y salida serie y paralelo
Registros con entrada paralelo y salida serie y paralelo
Registro universal de desplazamiento
2. Contadores
Contadores sncronos
Luis Entrena, Celia Lpez, Mario Garca, Enrique San Milln. Universidad Carlos III de Madrid, 2008
Registro
Circuito digital con dos funciones bsicas: almacenamiento de datos y
movimiento de datos (Floyd)
Es una coleccin de dos o ms biestables tipo-D con una entrada comn. Se
utiliza para almacenar una serie de bits relacionados, como un byte (8 bits) de
datos.
Dato(n)
Q(n)
Enable
Clear
Registro
Reloj
Reset
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Registro (1 bit)
Dato
Esquema
Enable
Clear
Reloj
Reset
Luis Entrena, Celia Lpez, Mario Garca, Enrique San Milln. Universidad Carlos III de Madrid, 2008
Registro (4 bits)
Entrada paralelo/salida paralelo
Esquema
Enable
Clear
Dato(1)
Dato(2)
Dato(3)
Dato(0)
Q(3)
Registro
1 bit
Registro
1 bit
Registro
1 bit
Registro
1 bit
Reset
Q(2)
Reloj
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Q(1)
Q(0)
5
Registro de desplazamiento
Es un registro que almacena y desplaza la informacin
Bit 0
Bit 1
Bit 2
Bit 3
Registra datos en los flancos activos del Reloj. Desplaza los bits..
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Registro de desplazamiento
Entrada y salida SERIE
Entrada
Bit 0
Bit 1
Bit 2
Bit 3
Salida
SISO
Registro de desplazamiento
Entrada SERIE, salida PARALELO
Entrada
Bit 0
S(0)
Bit 1
S(1)
Bit 2
Bit 3
S(2)
S(3)
SIPO
Registro de desplazamiento
Entrada PARALELO, salida SERIE
D(0)
Bit 0
D(1)
Bit 1
D(3)
D(2)
Bit 2
Bit 3
Salida
PISO
Registro de desplazamiento
Entrada serie/ salida paralelo-serie
Esquema
Enable
Clear
Dato
Q(3)
Registro
1 bit
Registro
1 bit
Registro
1 bit
Registro
1 bit
Reset
Q(2)
Reloj
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Q(1)
Q(0)
10
Registro de desplazamiento
Entrada serie-paralelo / salida paralelo-serie
Esquema
Dato(1)
Dato(2)
Dato(3)
S/P
Dato(0)
S_In
S_Out
Enable
Clear
Registro
1 bit
Registro
1 bit
Registro
1 bit
Registro
1 bit
Q(3)
Reset
Reloj
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Q(2)
Q(1)
Q(0)
11
Registro de desplazamiento
Dato(1)
Dato(2)
Dato(3)
Esquema
SISO
S/P
Dato(0)
S_Out
S_In
Enable
Clear
Registro
1 bit
Registro
1 bit
Registro
1 bit
Registro
1 bit
Q(3)
Reset
Q(2)
Reloj
Luis Entrena, Celia Lpez, Mario Garca, Enrique San Milln. Universidad Carlos III de Madrid, 2008
Q(1)
Q(0)
12
Registro de desplazamiento
Dato(1)
Dato(2)
Esquema
Dato(3)
PIPO
S/P
Dato(0)
S_Out
S_In
Enable
Clear
Registro
1 bit
Registro
1 bit
Registro
1 bit
Registro
1 bit
Q(3)
Reset
Q(2)
Reloj
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Q(1)
Q(0)
13
CSDI
CSDD
D(n)
Modo (2)
Q(n)
Registro
Universal
de
desplazamiento
Dato Salida.
N bits salida Paralelo
Bit 0 salida Serie
Reloj
Reset
Registro de desplazamiento con entrada serie y paralelo. Los datos se
pueden desplazar a izquierda o a derecha.
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14
Dato(0)
Esquema
Modo
CSDI
CSDD
11
10
01
00
11
10
01
00
Registro
0
Registro
1
Reset
Reloj
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Q(1)
Q(0)
15
Dato(0)
Esquema
Modo
CSDI
CSDD
11
10
01
00
11
10
01
00
Registro
0
Registro
1
Reset
Reloj
Luis Entrena, Celia Lpez, Mario Garca, Enrique San Milln. Universidad Carlos III de Madrid, 2008
Q(1)
Q(0)
16
Dato(0)
Esquema
Modo
CSDI
CSDD
11
10
01
00
11
10
01
00
Registro
0
Registro
1
Reset
Reloj
Luis Entrena, Celia Lpez, Mario Garca, Enrique San Milln. Universidad Carlos III de Madrid, 2008
Q(1)
Q(0)
17
Dato(0)
Esquema
Modo
CSDI
CSDD
11
10
01
00
11
10
01
00
Registro
0
Registro
1
Reset
Reloj
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Q(1)
Q(0)
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Contadores sncronos
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19
Contadores sncronos
Contador bsico
Enable
Q(n)
Contador
Fin
Reloj
Reset
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20
Contadores sncronos
Cronograma de funcionamiento
Reset
Clk
Enable
Q
Fin
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21
Contadores sncronos
Cronograma de funcionamiento
Reset
Clk
Enable
Q
Fin
Inicializacin Asncrona
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22
Contadores sncronos
Cronograma de funcionamiento
Reset
Clk
Enable
Q
Fin
Parada de cuenta
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23
Contadores sncronos
Cronograma de funcionamiento
Reset
Clk
Enable
Q
Fin
Fin de cuenta
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24
Luis Entrena, Celia Lpez, Mario Garca, Enrique San Milln. Universidad Carlos III de Madrid, 2008
25
Contador
en binario natural
de 0 a 7
1. Entradas y Salidas
Moore
Enable
Q(3)
Contador
Fin
Reloj
Reset
Entrada__Salidas
Ena__Q-F
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26
5
4
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27
0
1
Entrada__Salidas
Ena__Q-F
7
6
5
4
Luis Entrena, Celia Lpez, Mario Garca, Enrique San Milln. Universidad Carlos III de Madrid, 2008
28
Ena__Q-F
1
0
1
2
5
0
1
4
0
3
1
1
0
Luis Entrena, Celia Lpez, Mario Garca, Enrique San Milln. Universidad Carlos III de Madrid, 2008
29
0
1
Moore
000_0
Ena__Q-F
Salidas
111_1
110_0
001_0
5
0
010_0
101_0
4
1
100_0
011_0
Luis Entrena, Celia Lpez, Mario Garca, Enrique San Milln. Universidad Carlos III de Madrid, 2008
30
7 estados 3 biestables
Estado__Codificacin
0
1
2
3
4
5
6
7
000
001
010
011
100
101
110
111
Luis Entrena, Celia Lpez, Mario Garca, Enrique San Milln. Universidad Carlos III de Madrid, 2008
31
Entrada +Estado
Entradas T
Salidas
Q2
Q1
Q0
Q2
Q1
Q0
T2
T1
T0
Q2
Q1
Q0
Fin
0
32
Entrada +Estado
Entradas T
Salidas
Q2
Q1
Q0
Q2
Q1
Q0
T2
T1
T0
Q2
Q1
Q0
Fin
1
33
T2
Q1Q0
00
00
T1
01
11
10
01
11
10
EnQ2
Q1Q0
00
01
11
10
00
01
11
10
EnQ2
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34
T0
Q1Q0
00
00
Fin
01
11
10
01
11
10
EnQ2
Q1Q0
00
01
11
10
00
01
11
10
EnQ2
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35
T0 = Enable
T1 = Q0Enable
T2 = Q1Q0Enable
Fin = Q2Q1Q0Enable
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36
5. Esquemtico
Enable
Fin
T0 Q0
T1 Q1
T2 Q2
Q(0)
Q(1)
Reloj
Reset
Q(2)
37
Contadores sncronos
Contador Ascendente/Descendente
Q(n)
Enable
UpDown
Contador
Fin
Reloj
Reset
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38
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39
Cuenta Descendente
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40
Cuenta Ascendente
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41
Contadores sncronos
Contador con Precarga /Clear sncrono
Clear
Q(n)
Enable
Load
Dato(n)
Contador
Fin
Reloj
Reset
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42
Contadores sncronos
Cronograma de funcionamiento
Reset
Clk
Clear
Enable
Load
Dato
0
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43
Contadores sncronos
Inicializacin Asncrona
Reset
Clk
Clear
Enable
Load
Dato
0
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44
Contadores sncronos
Habilitacin de cuenta
Reset
Clk
Clear
Enable
Load
Dato
0
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45
Contadores sncronos
Precarga de valor de cuenta
Reset
Clk
Clear
Enable
Load
Dato
0
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46
Contadores sncronos
Inicializacin Sncrona
Reset
Clk
Clear
Enable
Load
Dato
0
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47
Ejercicio
Clear
Q(n)
Enable
Contador
Fin
Reloj
Reset
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48
01
1X
00
Clear-Ena__Q-Fin
01
6
01
Ejercicio
X0
11
1X
1X
00
1
1X
1X
01
1X
00
01
00
3
00
01
01
00
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49
Ejercicio
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50
Contador Johnson
Contador en anillo
Bit 0
Bit 1
Bit 2
Bit 0
Bit 1
Bit 2
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51
Ciclo
Q0
D1
Q2 Q1 Q0
Clk
Clk
1
2
0
0
0
1
1
1
3
4
1
1
1
1
1
0
5
6
1
0
0
0
0
0
Q1
Q2
Q1
D2
Clk
Q2
Reloj
Clk
Q0
2n patrones
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52
D0
Q2 Q1 Q0
Q0
Clk
Clk
Reloj
1
2
0
1
1
0
0
0
Reset
3
4
0
0
0
1
1
0
5
6
1
0
0
0
0
1
D1
Q1
D2
Q2
Clk
Clk
Q0
Q1
Q2
n patrones
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