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Practica No. 14
No. de Boleta:
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Practica No. 14
Communication Interfece).
OBJETIVOS:
a) Manejo del software de programacin CodeWarrior, en su versin 6.1,
PC.
c) Configuracin de los registros del SCI en el microcontrolador HC08 y
HC51JM.
d) Manejo de la herramienta de desarrollo DEMOJM, en la configuracin de
La condicin de Start toma un tiempo de bit y es validada cuando la seal en el canal pasa de
1 a 0, esta condicin abre la comunicacin.
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Practica No. 14
Cuando el formato es RZ (Return to Zero), un 1 lgico permanece medio tiempo en nivel alto
y luego cae (ver Figura 14.3). En promedio, esta tcnica consumira la mitad de la energa
para enviar informacin de un sistema a otro y viceversa.
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Practica No. 14
o
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Practica No. 14
La Figura 14.5. ilustra el diagrama en bloques del transmisor del mdulo SCI, en donde el
circuito (A) configura el buffer de transmisn, el cual recibe el dato a transmitir desde el bus
de datos interno.
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Practica No. 14
El circuito (B) corresponde al shift register que controla el formato de la trama SCI y su salida hacia
el pin de transmisin, en donde el primer bit del dato en salir es el LSb. El circuito ( C) conforma el
control de realimentacin (LOOP) del dato hacia el shift register del receptor, con el fin de hacer
comprobaciones del mdulo SCI en una comunicacin. A esta propiedad se le conoce tambin con
el nombre de eco local y consiste en la realimentacin de todo lo que se transmite hacia el propio
mdulo. La funcin OREX del circuito (D), permite que los bits de salida del transmisor se
complementen en su lgica. Esta opcin es interesante desde el punto de vista de confundir a
sistemas espas, que se conecten en paralelo al canal. El circuito generador de paridad (E),
permite introducir el bit de paridad a la trama del shift register y seleccionar el tipo de la misma. El
usuario puede optar por omitir la paridad y optar por transmitir 9 bits de dato. El circuito (F)
corresponde al controlador de los eventos de la transmisin, como envo de caracteres especiales
(break), controlar la direccin del pin de transmisin, monitoreo de cundo una transmisin ha
finalizado, entre otros. Finalmente, el circuito (G) controla los eventos de interrupcin del
transmisor.
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Practica No. 14
La Figura 14.6. ilustra el diagrama en bloques del receptor del mdulo SCI, en donde el circuito
(A) configura el buffer de recepcin, el cual almacena el dato recibido para ser llevado al bus de
datos interno.
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Practica No. 14
El circuito (B) corresponde al shift register que controla el formato de la trama SCI y su entrada
desde el pin de recepcin en donde el primer bit del dato en llegar es el LSb. El circuito (C)
conforma el control de realimentacin (LOOP) del dato que viene del shift register del transmisor
local. La funcin OREX del circuito (D), permite que los bits de entrada recuperen la polaridad
pactada con el transmisor. El circuito chequeador de paridad (E), permite comprobar la paridad
pactada en la comunicacin. El circuito (F) controla los eventos de interrupcin del receptor, tanto
por eventos de error como los propios de la recepcin. El circuito (G) corresponde con la lgica de
despertar (Wakeup). Finalmente el circuito de reloj (H), extrae el reloj del receptor dividiendo por 16
el reloj utilizado para el anlisis de los bits.
Envo de caracteres de pausa (break): Esta funcin permite hacer pausas para
comunicaciones con receptores de ratas de baudios lentas. Un caracter de pausa est
formado de slo 0s, incluyendo el bit de start y el bit de stop.
Es importante tener en cuenta que si se est conectado a otro dispositivo microcontrolador de
la familia Freescale se va a generar un error de trama, debido a la ausencia del bit de stop.
La tabla 14.1 ilustra sobre el tamao de un carcter break dependiendo de los bits de
configuracin SCIxC1[M] y SCIxS2[BRK13].
Tabla 14.1. Tamao de los caracteres break.
Mecansmo de despertar al receptor (Wakeup): Esta funcin permite que el receptor ignore
mensajes que no son propios y de esta manera evitar desgaste innecesario de tiempo y
energa.
En un sistema SCI elaborado como una red, todos los receptores evalan el primer carcter
de cada mensaje y tan pronto como ellos determinan que el mensaje no es propio, escriben
un 1 en el bit SCIxC2[RWU]. Este bit en 1 hace que las banderas de estado asociadas al
receptor sean inhibidas de ser puestas a 1, con esto se evita que el software asociado al
receptor dedique tiempo innecesario en la atencin a mensaje que no son para este.
Cuando un mensaje termina o comienza uno nuevo, los receptores automticamente ponen
en 0 el bit SCIxC2[RWU], con el fin de hacer un despertar (Wakeup) y analizar el primer
carcter del nuevo mensaje. Existen dos maneras de generar un evento de wakeup a un
receptor, a saber:
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Practica No. 14
~ Despertar por lnea desocupada (Idle Line Wakeup): Se establece con el bit
SCIxC1[WAKE] en 0 y en este modo el bit SCIxC2[RWU] es aclarado automticamente
al detectarse un carcter IDLE (slo 1s , incluyendo el bit de start y stop).
Cuando el bit SCIxC2[RWU] es 1 y el bit SCIxS2[RWUID] es cero, la condicin de lnea
desocupada que despierta la receptor no pondr a 1 la bandera SCIxS 1 [IDLE] del
receptor. El receptor despierta y espera el primer caracter del siguiente mensaje el cual
pone a 1 la bandera SCIxS1[RDRF], que genera un evento de interrupcin, si est
habilitada. Lo anterior se hace sin importar el estado del bit SCIxC2[RWU].
El bit de seleccin de tipo de lnea desocupada SCIxC1 [ILT] (Idle Line Type) elige entre
iniciar el contador de bits en modo vago (Idle Line). Cuando ILT = 0, se espera a que
haya pasado el bit de start y/o cualquiera otro bit en 1 al final del caracter recibido.
Cuando IL = 1, el contador de bits en modo vago no cuenta hasta tanto no haya pasado
el tiempo del bit de stop, esto hace que la deteccin de la lnea en modo vago no sea
afectada por el dato en el ltimo carcter del mensaje previo.
~ Despertar por marca de direccin (Address Mark Wakeup): Se establece con el bit
SCIxC1[WAKE] en 1 y en este modo el bit SCIxC2[RWU] es aclarado automticamente
al detectarse un 1 en el MSb del caracter recibido.
El 1 detectado en el MSb del caracter recibido aclara el bit SCIxC2[RWU] y pone a 1 la
bandera SCIxS1[RDRF], antes de que el bit de stop sea recibido. Para este caso el
caracter con el MSb en 1 es recibido, incluso si el receptor permaneci dormido durante
la mayor parte del tiempo del caracter recibido.
Registros asociados al mdulo SCI
o
~ LBKDIE: Bit para habilitar que se genere un evento de interrupcin debido a la recepcin de un
carcter de pausa (break) .
0: No habilita interrupcin por evento de pausa
1: Habilita interrupcin por evento de pausa
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~ RXEDGIE: Bit para habilitar que se genere un evento de interrupcin debido a un flanco
presente en el pin de recepcin .
0: No habilita interrupcin por flanco en pin de Rx 1: Habilita
interrupcin por flanco en pin de Rx
~ SBR(12:0): Bits para la programacin del divisor de la rata de baudios. Cuando el valor de
estos bits es cero, el genrador de la rata de baudios se detiene con el fin de ahorrar energa.
La ecuacin para el clculo de la rata de baudios es:
Rata de Baudios = Reloj del BUS / (16 x SBR)
Por ejemplo, si se necesita una rata de baudios de 9600 y se est trabajando con un reloj de
BUS interno de 8MHZ, el SBR ser de:
SBR = 8MHz / (16 x 9600Hz)
SBR = 52.08
El valor anterior se puede aproximar a 52, sin ningn deterioro del sincronismo de la
comunicacin. La Figura 14.8 ilustra la direccin de los registros de rata de baudios
asociados a los mdulos SCIx.
o Registro de control 1 del SCI (SCIxC1) La Figura 14.9 detalla el registro de configuracin 1
del SCI.
- LOOPS: Bit para seleccionar entre operacin normal y modo de realimentacin (LOOP).
Cuando este bit vale 1, la salida del transmisor es conectada internamente a la
entrada del receptor.
0: Operacin normal del SCI. Los pines RxD y TxD son usados de manera
independiente
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1: Habilita modo LOOP o conexin por un nico alambre (Single Wire Mode). El pin
RxD se desconecta del SCI
- SCISWAI: Bit para detener el SCI en modo WAIT.
0: El SCI contina trabajando estando la mquina en modo WAIT, de tal forma que un
evento de interrupcin al interior del SCI podra despertar la mquina.
1: El mdulo SCI est congelado en modo WAIT.
- RSRC: La operacin con este bit tiene sentido si el bit LOOP est en 1. En modo
LOOP el transmisor est conectado internamente al bloque de entrada del receptor,
entonces el bit RSRC decide cuando sta unin se conecta al pin de salida (TxD) del
SCI.
0: Modo normal de LOOP, la entrada RxD est desconectada del sistema y la salida
del transmisor es conectada internamente a la entrada del bloque receptor.
1: Pone el SCI en modo de un nico alambre (Single Wire Mode), entonces el pin de
TxD es conectado a la salida del transmisor y a la entrada del receptor, internamente.
- M: Bit para seleccionar dato de 8 o 9 bits.
0: Modo estndar: 1 bit de start + 8 bits de dato + 1 bit de stop.
1: Modo a 9 bits: 1 bit de start + 8 bits de dato + bit 9 + 1 bit de stop.
- WAKE: Bit para seleccionar el mtodo de despertar (Wakeup) del SCI.
0: Modo de despertar por Idle Line.
1: Modo de desperatar por Address Mark.
~ ILT: Bit para seleccionar el tipo de lnea en modo IDLE. Cuando este bit es puesto a
1, se asegura de que el bit de stop y el MSb del dato no cuenten dentro de los 10 (u
11) bits necesarios como nivel IDLE para la lgica de deteccin de dicho modo.
0: El contador de bits, del caracter para la condicin de IDLE, comienza despus del
bit de start.
1: El contador de bits, del caracter para la condicin de IDLE, comienza despus del
bit de stop.
~ PE: Bit para habilitar la generacin y el chequeo de paridad en la trama de
comunicacin.
0: No se trabaja con paridad.
1: Habilita el trabajo con paridad.
- PT: Bit para seleccionar el tipo de paridad a generarse o a chequear.
0: Paridad par (Even).
1: Paridad impar (Odd).
o
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por
transmisin,
TCIE: Bit para habilitar un posible evento de interrupcin por transmisin, para cuando el
ltimo bit ha salido del shift register.
o 0: Inhibe interrupcin por evento de TC = 1.
o 1: Habilita interrupcin por evento de TC = 1.
RIE: Bit para habilitar un posible evento de interrupcin por recepcin.
o 0: Inhibe interrupcin por evento de RDRF = 1.
o 1: Habilita interrupcin por evento de RDRF = 1.
ILIE: Bit para habilitar un posible evento de interrupcin por lnea en modo IDLE.
o 0: Inhibe interrupcin por evento de lnea en estado de IDLE.
o 1: Habilita interrupcin por evento de lnea en estado de IDLE.
TE: Bit para habilitar la operacin del transmisor.
o 0: Inhibe la operacin del transmisor.
o 1: Habilita la operacin del transmisor.
RE: Bit para habilitar la operacin del receptor.
o 0: Inhibe la operacin del receptor.
o 1: Habilita la operacin del receptor.
RWU: Bit para colocar el receptor del SCI en modo de stanby (atento), esperando a que
se de un evento de hardware o se presente un modo de despertar (Wakeup) sea por idle
line (WAKE = 0) o por address mark (WAKE = 1).
o 0: SCI en operacin normal.
o 1: SCI en modo de standby, esperando un estado de WAKE.
o
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SBK: Bit para permitir enviar un caracter break. Un caracter break consiste en el
apilamiento de 0s en toda la trama de comunicacin. La condicin no desaparece hasta
tanto no se haga SBK = 0.
o 0: SCI en operacin normal.
o 1: SCI enviando caracteres break.
Registro de estado 1 del SCI (SCIxS1) La Figura 14.11 detalla el registro de estado 1 del
SCI.
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Practica No. 14
TDRE: Bandera que indica cuando un dato del buffer de transmisin ha pasado al shift
register. Este evento indica que se puede depositar otro dato en el buffer de transmisin.
Para borrar la bandera TDRE es necesario leer el registro SCIxS 1 y luego escribir un
nuevo dato en el registro de datos del SCI (SCIxD).
o 0: El buffer de transmisin est lleno.
o 1: El buffer de transmisin est vaco.
TC: Bandera que indica cuando el ltimo bit de una trama ha salido por el shift register. Este
evento indica que se puede depositar otro dato en el buffer de transmisin. Para borrar la
bandera TC es necesario leer el registro SCIxS1 y luego ejecutar una de las siguientes
acciones:
Escribir un nuevo dato en el registro de datos del SCI (SCIxD)
Escribir un prembulo pasando el bit TE de 1 a 0.
Enviar un caracter de break escribiendo un 1 en el bit SBK.
o 0: Transmisor enviando un dato.
o
RDRF: Bandera que indica cuando el buffer de recepcin est lleno. El evento indica cuando
un dato recibido en el shift register ha pasado al registro de datos de SCI (SCIxD). Para
aclarar el estado del bit RDRF es necesario leer el registro SCIxS 1 y luego leer el registro de
datos SCIxD.
o 0: El registro de datos del SCI est vaco.
o 1: El registro de datos del SCI est lleno.
~ IDLE: Bandera se pone a 1 cuando el receptor ha recibido un caracter de slo 1s. Para
aclarar la bandera de IDLE es necesario leer el registro SCIxS 1 y luego leer el registro de
datos SCIxD.
o 0: No se ha detectado un caracter IDLE.
o 1: Se ha detectado un caracter IDLE.
OR: Bandera de sobrecarrera del receptor (Receiver Overrun). Esta bandera indica cuando
se va a escribir un nuevo dato entrante sobre el registro de datos de SCI (SCIxD) y an no
se ha ledo el dato anterior, en cuyo caso el dato nuevo se pierde. Para aclarar el bit OR es
necesario leer el regictro SCIxS 1 y luego leer el registro de datos SCIxD.
o 0: No se ha detectado una sobrecarrera en el receptor.
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Practica No. 14
NF: Todo bit de start es muestreado siete veces y tres muestras para los dems bits. Si
alguna de esas muestras es errnea, la bandera NF se pone a 1 al igual que el bit RDRF.
Para aclarar el bit NF es necesario leer el regictro SCIxS 1 y luego leer el registro de datos
SCIxD.
o 0: No se ha detectado ruido en el canal.
o 1: Se ha detectado ruido en le canal.
FE: Bandera para deteccin de error en una trama (aunque no es la nica condicin para
descartar una trama corrupta). Una trama se invalida cuando se detecta un 0 en el
tiempo del bit de stop. Para aclarar el bit FE es necesario leer el regictro SCIxS 1 y luego
leer el registro de datos SCIxD.
o 0: No se ha detectado una trama errnea.
o 1: Se ha detectado una trama errnea.
PF: Bandera que indica cuando el bit de paridad no coincide con el valor de la paridad
pactada. Para aclarar el bit PF es necesario leer el regictro SCIxS 1 y luego leer el
registro de datos SCIxD.
o 0: No se ha detectado paridad invlida.
o 1: Se ha detectado paridad invlida.
o Registro de estado 2 del SCI (SCIxS2) La Figura 14.12 detalla el registro de estado 2 del
SCI.
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Practica No. 14
- RXUID: Bit para indicar la deteccin de un estado de despertar por modo vago (Idle
Wakeup). Indica cuando un caracter IDLE ha puesto la bandera IDLE en 1.
o 0: Durante el estado de atento del receptor (RWU = 1), el bit IDLE no ha sido puesto
a 1 en la deteccin de un caracter IDLE.
o 1: Durante el estado de atento del receptor (RWU = 1), el bit IDLE ha sido puesto a
1 en la deteccin de un caracter IDLE.
BRK13: Bit para seleccionar la longitud de un caracter de break.
o 0: El caracter de break ser de 10 bits (11 si M =1).
o 1: El caracter de break ser de 13 bits (14 si M =1).
LBKDE: Bit para habilitar un caracter break en la lnea. Mientras este bit sea 1, el
sistema previene que el bit FE (Famming Error) y RDRF sean puestos a 1.
o 0: Un caracter de break de 10 bits es detectado (11 si M =1).
o 1: Un caracter de break de 13 bits es detectado (14 si M =1).
RAF: Bandera para indicar que el receptor a detectado un bit de start vlido y es borrada
automticamente cuando el receptor detecta la lnea en modo IDLE. Esta bandera puede
ser usada para chequear cuando un caracter est comenzando ha ser recibido, antes de
que la CPU entre en un estado de STOP.
o 0: El receptor en modo IDLE est esperando un bit de start.
o 1: El receptor del SCI est activo y el pin RxD no est en IDLE.
Registro de control 3 del SCI (SCIxC3) La Figura 14.13 detalla el registro de control 3 del
SCI.
R8: Noveno bit del receptor, para M = 1 y conforma el MSb del dato recibido. Cuando se
est trabajando en modo de 9 bits, se recomienda leer R8 antes de leer el SCIxD.
T8: Noveno bit a transmitir, para M = 1 y conforma el MSb del dato a transmitir. Cuando
se est trabajando en modo de 9 bits, escribir primero el dato a transmitir en el registro
SCIxD y luego definir el bit T8.
TXDIR: Bit para definir la direccin del pin de TxD, en modo de un slo hilo (Simple Wire)
half duplex (LOOPS = RSRC = 1).
0: El pin TxD es una entrada en el modo de un solo hilo.
1: El pin TxD es una salida en el modo de un solo hilo.
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Practica No. 14
TXINV: Bit para invertir el estado elctrico de los bits en el pin TxD.
0: Los bits transmitidos no son invertidos.
1: Los bits transmitidos son invertidos.
ORIE: Bit para habilitar un evento de interrupcin por Receiver Overrun.
0: Inhibe interrupcin por Receiver Overrun.
1: Habilita interrupcin por Receiver Overrun.
NEIE: Bit para habilitar un evento de interrupcin por Noise Error.
0: Inhibe interrupcin por Noise Error.
1: Habilita interrupcin por Noise Error.
FEIE: Bit para habilitar un evento de interrupcin por Framming Error.
0: Inhibe interrupcin por Framming Error.
1: Habilita interrupcin por Framming Error.
PEIE: Bit para habilitar un evento de interrupcin por Parity Error.
0: Inhibe interrupcin por Parity Error.
1: Habilita interrupcin por Parity Error.
o
Registro de datos del SCI (SCIxD) La Figura 14.14 detalla el registro de datos del SCI.
Cuando este registro se lee, retorna el valor del dato que lleg por recepcin. Lo que se
escriba en este registro ser transmitido. Ambas operaciones son independientes, es decir la
una no afecta la otra.
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Practica No. 14
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Practica No. 14
NOTA: Se recomienda al usuario revisar cuidadosamente el estado de los puentes del DEMOJM,
con el objetivo de hacer compatible el ejercicio actual y de esta manera liberar los pines
comprometidos en el circuito. En particular, en este ejercicio es necesario retirar los puentes en J4.
fuente,
utilizando
el
microcontrolador
/****************************************************************************************/
/* SCI_PC: Ejemplo sobre la utilizacin del modulo SCI.
*/
/* main.c
*/
/*
*/
/* Fecha: Noviembre 11, 2010
*/
/*
*/
/*V1.0, Rev 0 por Jose Luis DM
*/
/*
*/
/* Asunto: Implementar un codigo en C que comunique un PC, va Hyperterminal, con un MCF51JM
/*
128 v SCI1.Los caracteres que provienen desde el Hyperterminal deberan ser presen
*/
/*
tados en un LCD y los caracteres que enva el MCU deberan aparecer en la pantalla
/*
del Hyperterminal.
*/
/*
*/
/* Nota: Las tildes en los comentarios son omitidas para efectos de compatibilidad con otros
/* editores.
*/
/******************************************************************************************/
/******************************************************************************************/
/*
DISTRIBUCION DE LOS PINES DE PUERTOS
*/
/******************************************************************************************/
/******************************************************************************************/
/* PUERTO
* PIN * I/O * TIPO * INICIA *
COMENTARIO
*/
/******************************************************************************************/
/*PTA *
*
*
*
*LCD
*/
/*
*PTA0 *
O
*
D
*
1
*D4 del LCD
*/
/*
*PTA1 *
O
*
D
*
1
*D5 del LCD
*/
/*
*PTA2 *
O
*
D
*
1
*D6 del LCD
*/
/*
*PTA3 *
O
*
D
*
1
*D7 del LCD
*/
/*
*PTA4 *
O
*
D
*
1
*Seal ENABLE del LCD*/
/*
*PTA5 *
O
*
D
*
1
*Seal RS del LCD
*/
/******************************************************************************************/
/******************************************************************************************/
/*PTB * - * - * - * *No usado
*/
/******************************************************************************************/
/*PTC * - * - * - * - *No usado
*/
/******************************************************************************************/
/*PTD * - * - * - * - *No usado
*/
/******************************************************************************************/
/*PTE * - * - * - * - *Puerto SCI
*/
/*
*PTE0 * O
*D
*1
*TxD
*/
/*
*PTE1 * O
*D
*1
*RxD
*/
/******************************************************************************************/
/*PTF *
*
*
*
-*No usado
*/
/*
*PTF0 *
O
*
D
*
1
*Columna 1 teclado
*/
/*
*PTF1 *
O
*
D
*
1
*Columna 2 teclado
*/
/*
*PTF2 *
O
*
D
*
1
*Columna 3 teclado
*/
/******************************************************************************************/
/*PTG *
*
*
*
*Teclado
*/
/*
*PTG0 *
I
*
D
*
1
*Fila 1 del teclado
*/
/*
*PTG1 *
I
*
D
*
1
*Fila 2 del teclado
*/
/*
*PTG2 *
I
*
D
*
1
*Fila 3 del teclado
*/
/*
*PTG3 *
I
*
D
*
1
*Fila 4 del teclado
*/
/******************************************************************************************/
/*PTH * - * - * - * - *No usado
*/
/******************************************************************************************/
/******************************************************************************************/
/*PTJ * - * - * - * - *No usado
*/
JLDM
*/
*/
*/
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Practica No. 14
/******************************************************************************************/
/* Archivos de cabecera */
#include <hidef.h>
#include "derivative.h"
//deshabilita el COP
/* Declaracion de funciones */
void KBI_Init(char KBI1SC_Config,char KBI1PE_Config,char KBI1ES_Config);
//declare funcion que inicializa KBI1
void
PTA_Init(char
PTAD_Config,char
PTADD_Config,char
PTAPE_Config,char
PTASE_Config,char
PTADS_Config,char PTAIFE_Config);
//declare funcion que inicializa PTA
void
PTF_Init(char
PTFD_Config,char
PTFDD_Config,char
PTFPE_Config,char
PTFSE_Config,char
PTFDS_Config,char PTFIFE_Config);
//declare funcion que inicializa PTF
void SCI1_Init(char SCI1C1_Config,char SCI1C2_Config,char SCI1BD_Config);
//declare funcion que inicializa SCI1
void Delay(unsigned long retardo);
//funcion para hacer retardos varios
void LCD_Init(void);
//funcion para inicilaizar LCD
void Lcd_4bit_Wr(char dato4,char rs);
//funcion para escribir dato al LCD
void Comando_8bit(char comando8);
//funcion para inicio del LCD a 8 bits
void Rote_Col (void);
//funcion para rotar un cero por columnas teclado
void Analisis_Tecla(void);
//funcion para analisis de tecla presionada
/* main(): Funcion principal */
void main(void) {
MCGTRM = NVMCGTRM + 52;
MCGC1 = 0x04;
MCGC2 = 0x00;
MCGC4 = 0x22;
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Practica No. 14
PTASE_Config,char
PTFSE_Config,char
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Practica No. 14
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Practica No. 14
//llego a cero?
//no --> decrementa
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Practica No. 14
Compilacin y Depuracin
Estudiar el cdigo, Verificar con el
comunicaciones que se pueden obtener.
------------------------------------------------------------------------------
JLDM
equipo
de
FIN
cmputo
DE
LA
las
PRCTICA
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