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- OBJETIVOS
1. Comprobar el funcionamiento de los flip flops en Mquinas de estados
Finitos.
2. Comprobar el funcionamiento de los flip flops en registros y
contadores.
3. Comprobar el funcionamiento de memorias tipo 2716 y/o 2732, as
como la 6116 (RAM ESTTICA)
II.- MATERIALES
1. Fuente regulada de +5 VDC
2. Circuitos Integrados: Utilizados en las experiencias anteriores,
asimismo escoger entre los siguientes:
7476, 74190, 74193, 2716, 2732, 6116, 4116, 2114
3. Resistencias de 330, w.
4. Diodos LED.
5. Display de 7 segmentos.
6. Protoboard.
7. Cable telefnico para conexiones.
8. Alicate de punta.
Laboratorio de Digitales I
EE635M
-1-
Laboratorio de Digitales I
EE635M
-2-
Latch RS
Tabla de Verdad
Laboratorio de Digitales I
EE635M
-3-
Laboratorio de Digitales I
EE635M
-4-
t+1:
VCC
J1
S
Key = A
VCC
J1
S
Key = A
t+2:
VCC
J1
S
Key = A
Laboratorio de Digitales I
EE635M
-5-
LATCH RESET:
t:
t+1:
VCC
J1
R
Key = A
VCC
J1
Key = A
t+2:
VCC
J1
R
Key = A
VCC
J1
nQ
Key = A
J2
Key = A
R
Q
ESTADO
ACTUAL
Q
0
0
0
0
1
1
1
1
Laboratorio de Digitales I
ENTRADAS DE
EXCITACIN
S
R
0
0
0
1
1
0
1
1
0
0
0
1
1
0
1
1
EE635M
ESTADO
SIGUIENTE
Q*
0
0
1
X (X=0)
1
0
1
X (X=0)
-6-
MEMORIA
RESET
SET
NO PERMITIDO
MEMORIA
RESET
SET
NO PERMITIDO
VCC
J1
nS
Key = A
J2
Key = A
nR
nQ
ESTADO
ACTUAL
ENTRADAS DE
EXCITACIN
0
0
0
0
1
1
1
1
0
0
1
1
0
0
1
1
0
1
0
1
0
1
0
1
ESTADO
SIGUIENTE
Q*
X (X=1)
1
0
0
X (X=1)
1
0
1
NO PERMITIDO
SET
RESET
MEMORIA
NO PERMITIDO
SET
RESET
MEMORIA
S
nQ
Key = A
J2
Q
Key = A
R
Laboratorio de Digitales I
EE635M
-7-
ENTRADA
ACTIVACI
ON
ENTRADAS DE
EXCITACIN
ESTADO
ACTUAL
0
0
1
1
1
1
1
1
1
1
X
X
0
0
0
0
1
1
1
1
X
X
0
0
1
1
0
0
1
1
0
1
0
1
0
1
0
1
0
1
RESET
(compuertas
LATCH SETcompuertas):
ESTADO
SIGUIENTE
Q*
0
1
0
1
0
0
1
1
X (X=0)
X (X=0)
NANDs
RETENCIN
MEMORIA
RESET
SET
NO
PERMITIDO
controlada
por
VCC
J1
S
Q
Key = A
J2
Key = A
nQ
R
C
ENTRADA
ACTIVACI
ON
ENTRADAS DE
EXCITACIN
ESTADO
ACTUAL
0
0
1
1
1
1
1
1
1
X
X
0
0
0
0
1
1
1
X
X
0
0
1
1
0
0
1
0
1
0
1
0
1
0
1
0
EE635M
-8-
Laboratorio de Digitales I
ESTADO
SIGUIENTE
Q*
0
1
0
1
0
0
1
1
X (X=1)
RETENCIN
MEMORIA
RESET
SET
NO
X (X=1)
PERMITIDO
U1A
~1PR
1J
1Q
15
4
1
1CLK
16
1K
U1B
~1PR
~1Q
14
16
~1CLR
3
1Q
15
~1Q
14
1J
1CLK
1K
~1CLR
7476N
7476N
CK
INICIO
SIMULACION:
t+
t+
VCC
5V
t+
U1A
VCC
16
5V
1Q
15
~1Q
14
1J
1CLK
1K
16
1Q
15
~1Q
14
1J
1K
VCC
INICIO
VCC
16
5V
15
~1Q
14
QB
~1PR
4
16
1Q
15
~1Q
14
1J
1CLK
1K
~1Q
14
16
1J
1Q
15
1CLK
1K
~1CLR
~1Q
14
~1CLR
7476N
U1B
QA
1Q
1J
4
1
1K
QB
~1PR
15
7476N
CK
U1A
2
~1PR
4
1Q
1CLK
7476N
5V
CK
16
5V
~1CLR
7476N
VCC
1J
U1B
QA
~1PR
4
1CLK
~1CLR
U1A
QB
~1PR
4
5V
U1B
QA
~1PR
4
VCC
1CLK
1K
~1CLR
INICIO
t+
~1CLR
7476N
7476N
CK
VCC
5V
INICIO
VCC
VCC
U1A
4
1
VCC
16
5V
1Q
15
~1Q
14
1J
4
1
1CLK
1K
~1CLR
3
U1B
2
~1PR
QA
16
16
5V
1Q
15
~1Q
14
~1CLR
7476N
7476N
INICIO
CK
INICIO
t+
Laboratorio de Digitales I
EE635M
-9-
15
1K
~1Q
14
QB
~1PR
4
1
1CLK
CK
1CLK
1K
1Q
~1CLR
QB
1J
1J
U1B
QA
~1PR
4
~1PR
U1A
5V
16
1Q
15
~1Q
14
1J
1CLK
1K
~1CLR
7476N
7476N
VCC
t+
VCC
t+
5V
U1A
VCC
16
5V
1J
1Q
4
1
~1Q
14
16
1J
1Q
1K
~1Q
VCC
14
7476N
16
5V
~1CLR
1J
1Q
14
16
CK
INICIO
INICIO
U1A
VCC
16
5V
4
1
~1Q
14
16
~1CLR
3
1J
1Q
~1Q
VCC
14
16
5V
~1CLR
7476N
1J
1Q
4
1
1K
~1Q
14
16
~1CLR
3
CK
CK
INICIO
INICIO
QB
~1PR
15
1CLK
7476N
U1B
QA
~1PR
15
1CLK
1K
U1A
QB
~1PR
15
1CLK
1K
7476N
5V
U1B
QA
1Q
14
t+
t+
~1PR
~1Q
VCC
5V
1J
1K
7476N
VCC
15
1CLK
~1CLR
CK
1Q
1J
~1CLR
7476N
4
1
~1Q
QB
~1PR
15
1CLK
1K
U1B
QA
~1PR
15
1CLK
~1CLR
U1A
QB
~1PR
15
1CLK
1K
U1B
QA
~1PR
4
5V
1J
1Q
15
1CLK
1K
~1Q
14
~1CLR
7476N
7476N
VCC
5V
U1A
2
~1PR
4
1
16
1Q
15
~1Q
14
1J
4
1
1CLK
1K
16
~1CLR
3
U1B
0-0000-1111-0000-1111
QA
~1PR
QB
1J
15
1Q
0-0011-0011-0011-0011
1CLK
1K
14
~1Q
~1CLR
7476N
7476N
0-0101-0101-0101-0101
CK
INICIO
0-1111-1111-1111-1111
CK=1 RETENCION
CK=0 OPERACIN NORMAL
PR
CL
0
0
1
0
1
0
SALIDA
FLIP_FLOP
AMBIGUA
SET (Q=1)
RESET(Q=0)
OPERACIN
NORMAL
J
0
0
1
K
0
1
0
Q*
Q
0
1
Laboratorio de Digitales I
EE635M
- 10 -
a)
b)
c)
d)
e)
Tabla de estado.
Tabla de estado reducida.
Implementar el circuito con FF JK.
Hallar la secuencia de estados cuando x=0.
Hallar la secuencia de estados cuando x=1.
Solucin:
a) La tabla de estados es la siguiente y como vemos no se puede reducir as
que ser la tabla de estados reducida tambin.
b) Tabla Reducida:
0
1
2
3
4
5
6
Laboratorio de Digitales I
EE635M
Entrada x
0
1
3/0
5/1
6/0
0/0
1/0
1/0
2/0
5/1
5/1
2/0
5/1
4/0
0/0
2/0
- 11 -
Q Q
1
0
0
0
0
0
0
0
0
1
1
1
1
1
1
0
0
0
0
1
1
1
1
0
0
0
0
1
1
0
0
1
1
0
0
1
1
0
0
1
1
0
0
X
0
1
0
1
0
1
0
1
0
1
0
1
0
1
Q2 Q1 Q0
*
0
1
1
0
0
0
0
1
1
0
1
1
0
0
1
0
1
0
0
0
1
0
0
1
0
0
0
1
1
1
0
0
1
1
0
1
1
0
1
0
0
0
Z
0
1
0
0
0
0
0
1
1
0
1
0
0
0
J2
0
1
1
0
0
0
0
1
X
X
X
X
X
X
K2
X
X
X
X
X
X
X
X
0
1
0
0
1
1
J1 K1
1 X
0 X
1 X
0 X
X 1
X 1
X 0
X 1
0 X
1 X
0 X
0 X
X 1
X 0
J0
1
1
X
X
1
1
X
X
1
0
X
X
0
0
K0
X
X
1
1
X
X
1
0
X
X
0
1
X
X
Laboratorio de Digitales I
EE635M
- 12 -
K2:
K 2=Q1 + X Q0 '
J1 :
'
'
J 1=Q2 X + X Q2 Q0 '
K1:
Laboratorio de Digitales I
EE635M
- 13 -
J0 :
Laboratorio de Digitales I
EE635M
- 14 -
2
4
~1PR
1J
1Q
1CLK
1K
12
11
~1Q
~1CLR
9
10
X
13
15
16
~1PR
18
1J
1Q
1CLK
1K
21
17
20
19
22
24
~1Q
~1CLR
23
~1PR
26
25
1Q
1CLK
28
27
14
1J
1K
~1Q
~1CLR
29
32
30
33
34
31
Estado
siguiente
(Cuando x=0)
3
011
2
010
1
001
6
110
0
000
Sali
da Z
0
0
0
0
0
Laboratorio de Digitales I
EE635M
Estado
siguiente
(Cuando x=1)
0
000
5
101
4
100
2
010
1
001
- 15 -
Sali
da Z
0
1
0
0
0
35
36 Z
Laboratorio de Digitales I
EE635M
- 16 -
Laboratorio de Digitales I
EE635M
- 17 -
Laboratorio de Digitales I
EE635M
- 18 -
B
0
0
1
1
0
0
1
1
C
0
1
0
1
0
1
0
1
SALIDA
Todos los leds apagados
Todos los leds prendidos
Intermitencia de los leds
Desplazamiento de un led a la derecha
Desplazamiento de un led a la izquierda
Desplazamiento de dos leds a la derecha
Desplazamiento de dos leds a la izquierda
Leds L1, L3, L5, L7 prendidos
Laboratorio de Digitales I
EE635M
- 19 -
Dividiremos el circuito en dos partes la primera ser el contador binario 74193 que
nos dar una salida X,Y,Z que usaremos en el circuito siguiente el diagrama es el
siguiente:
CIRCUITO 1
Laboratorio de Digitales I
EE635M
- 20 -
Laboratorio de Digitales I
EE635M
- 21 -
CIRCUITO 3
Laboratorio de Digitales I
EE635M
- 22 -
Laboratorio de Digitales I
EE635M
- 23 -
CREAR EL ESQUEMATICO
ASIGNAR PINES DE ENTRADA Y SALIDA
CONECTAR LOS SIMBOLOS
EDITAR LOS NOMBRES DE LOS PINES
ASIGNAR NUMERO DE PINES
COMPILAR EL PROYECTO
SIMULAR EL PROYECTO
ESTADO ACTUAL
C
0
0
0
0
1
1
1
1
B
0
0
1
1
0
0
1
1
ESTADO
SIGUIENTE
C+
B+
1
0
0
0
1
0
1
1
0
1
A
0
1
0
1
0
1
0
1
A+
0
0
1
1
0
Jc
1
0
x
x
x
Kc
x
x
0
0
1
Aplicamos Karnaugh:
0
00
01
01
11
11
00
10
10
Jc =B A
Laboratorio de Digitales I
1
x
Kc=CBA
EE635M
- 24 -
Jb
0
x
0
1
x
Kb
x
1
x
x
0
Ja
0
0
1
x
x
Ka
x
X
x
0
1
00
00
01
01
11
11
10
10
Jb=CA
x
x
Kc=C A
00
00
01
01
11
11
10
10
Jc =C B
1
x
Kc=CBA
Laboratorio de Digitales I
EE635M
- 25 -
Laboratorio de Digitales I
EE635M
- 26 -
Laboratorio de Digitales I
EE635M
- 27 -
CREAR EL ESQUEMATICO
ASIGNAR PINES DE ENTRADA Y SALIDA
CONECTAR LOS SIMBOLOS
EDITAR LOS NOMBRES DE LOS PINES
ASIGNAR NUMERO DE PINES
COMPILAR EL PROYECTO
SIMULAR EL PROYECTO
ESTADO ACTUAL
Q1
0
0
0
0
1
1
1
1
QO
0
0
1
1
0
0
1
1
x
0
1
0
1
0
1
0
1
ESTADO
SIGUIENTE
Q1& QO&
0
1
0
0
1
0
0
0
1
0
1
1
0
1
0
0
x
0
0
0
0
0
0
0
1
EE635M
- 28 -
J1
0
0
1
0
X
X
X
X
K1
X
X
X
X
0
0
1
1
Jb
1
0
X
X
0
1
X
X
K0
X
X
1
1
X
X
0
1
Compilacin:
Simulamos:
Laboratorio de Digitales I
EE635M
- 29 -
No presenta errores:
Laboratorio de Digitales I
EE635M
- 30 -
Laboratorio de Digitales I
EE635M
- 31 -