N Q3 Q2 Q1

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1
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2
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3
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28 1
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29 1
1
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30 1
1
1
31 1
1
1
Tabla de Verdad

Q0
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1
1
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1
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0
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1
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A
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Q3
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Q1

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K3
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J2
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K2
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J1

J0

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K1
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K0
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X

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X
X

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X

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1
1

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x

Mapas de karnaugh
J3= (Q2*Q1*Q0*~A)
NAND= ~(~(Q2*Q1*Q0*~A))

K3=1

J1=(Q0*A)+(Q3*A)
J2=(Q1*Q0*A)

NAND=~(~(Q0*A)*~(Q3*A))

NAND=~(~(Q2*Q1*Q0*~A))

K1=(~Q2*A)+(Q0)+(Q2*~A)
NAND=~(~(~Q2*A)*(~Q0)*~(Q2*~A))

K2=(~Q1*~Q0*A)+(~Q3*Q0*~A)+
(Q1*~A)+(Q1*Q0)
NAND=~(~(~Q1*~Q0*A)*~(~Q3*Q0*
~A)*~(Q1*~A)*~(Q1*Q0))

J0=(Q2*Q1)+(~A)
NADN=~(~(Q2*Q1*Q0*~A))

K0=(A)+(Q2*Q1)
NAND=~(~(Q2*Q1*Q0*~A))

Diseando el circuito con flip-flops JK; resulta un circuito ms reducido a la

hora de implementarlo en comparacin con un tipo SR o tipo T.

Al pasar los resultados a NAND reducimos an ms el nmero de integrados a

implementar y as el coste total del circuito.

Dentro de las alternativas de diseo se contemplaron el pasar a NOR o usar

otro tipo de flip-flop pero se concluy que por medio de esta forma se
extenda mas el montaje y numero de componentes.