Diagrama en Bloques de la Seccin de

RF de un Telfono Celular Sony

La figura 1 muestra el diagrama en bloques del
sistema de transmisin y de recepcin de un telfono celular Sony de banda dual que opera con tecnologa GSM. Note que el telfono opera en las
bandas de 900MHz y 1.8GHz; es decir, se trata de
un equipo que no va a funcionar en determinados
pases de la regin, pero la explicacin que brindamos es vlida para todos los telfonos de caractersticas similares. La antena se acopla mediante un interruptor mecnico (se trata del sistema de encastre
de la antena) y luego por medio de una llave electrnica recibe la seal desde el transmisor o enva
la seal hacia el receptor.
Sobre la lnea de transmisin, entre la antena y
el interruptor mecnico se coloca un conector para
poder colocar una antena externa cuando su uso
sea necesario. El interruptor es tal, que al colocar la
antena externa se desconecta la antena fija.
El receptor consiste entonces, en dos etapas de
RF separadas para funcionar en E-GSM y DSC, por
medio de un filtro de superficie (SAW) para la banda de 900MHz y por medio de un filtro cermico
para la banda de 1800MHz. Un primer filtro GMSK
(Gaussian-filtered minimum shift keying, filtro gaussiano de mnimo ruido) lleva las seales, ya sea de
1800MHz o 900MHz, a un valor de frecuencia intermedia de 440MHz.
La seal de FI de 440MHz es amplificada y nuevamente convertida por un demodulador IQ (demodulador de fase o de cuadratura) de modo que las
seales resultantes son detectadas y filtradas para
obtener las seales I (fase) y Q (cuadratura) que sern procesadas por las etapas de voz, de acuerdo
con las indicaciones dadas por el microcontrolador.
Para poder realizar estas tareas con xito, se
emplea un oscilador a cristal de 13MHz VCTCXO

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Figura 1

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(voltage-controlled-temperature-compensated crystal
oscillator, oscilador a cristal controlado por tensin
con compensacin de temperatura). Dicho oscilador
genera la seal de clock para el PLL y las etapas de
banda base.
En la etapa transmisora, la seal que llega en
banda base se modula en una etapa ModuladoraGMSK para llevarlas a portadoras de las bandas
de 900MHz y 1800MHz. Vea que la modulacin
se realiza por medio de dos osciladores controlados
por tensin (VC0), uno de 195MHz para GSM y
otro de 325MHz para DCS 1800. Estas conversiones se realizan por medio de moduladores balanceados IQ y un posterior bloque sumador (APC

Loop). Cabe aclarar que todas las seales IQ y de

RF son tratadas en moduladores balanceados para
disminuir interferencias (crosstalk effects).
De acuerdo con las recomendaciones para
GSM, el transmisor y el receptor nunca son activados al mismo tiempo.

Diagrama en Bloques del

Sistema de Banda Base
El sistema de banda base consiste en dos circuitos integrados, uno digital (IC1) y otro analgico
(IC2), figura 2. La memoria externa que se puede

Figura 2

Club Saber Electrnica 5

Figura 3

manejar es de 36 MBits, 32MBits para la Flash

ROM y 4MBits para la memoria SRAM. El circuito
integrado digital IC1 se encarga de procesar la seal GSM que ya est en banda base, de acuerdo
con los protocolos de comunicaciones establecidos
en el estndar ETSI. Este circuito integrado digital se
encarga de procesar las seales por medio de un
proceso digital DSP (Digital Signal Processing) de
acuerdo a un programa interno y a los datos que se
encuentran en la memoria. Para efectuar todas estas
tareas, este circuito integrado posee al corazn
del telfono, que es el microcontrolador que efecta
las diferentes operaciones, apoyndose en una memoria RAM interna.
El circuito integrado digital tambin posee el circuito de reloj y varios puertos y compuertas CMOS
para comunicarse con otros elementos.
En definitiva, es un integrado que realiza las tareas de codificacin y decodificacin necesarias para establecer las diferentes seales de transmisin y
recepcin.
El integrado analgico IC2 posee un sistema
A/D-D/A (conversor analgico/digital y digital/analgico) que permite el procesamiento de las seales IQ y de las seales de voz.
Este integrado posee todas las etapas que permiten el procesamiento de las seales de voz, las inter-

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fases para procesar los seales I (fase) y Q (cuadratura) que pueden soportar los modos single slot y
multi slot. Tambin posee circuitos auxiliares para
el control de RF, un regulador de tensin (provee una
tensin regulada), el control de carga de la batera
y el sistema de anlisis de encendido del telfono.
Este circuito integrado tambin posee un sistema
que genera la tensin de alimentacin y la tensin
de reset.
Para comunicarse con IC1 posee un puerto serial
en banda base (BSP) y un puerto para comunicaciones de voz (VSP), ambos permiten comunicarse con
el DSP. Tambin posee un puerto serial UPS para comunicarse con el microcontrolador de IC1 y un puerto serial TSP para comunicarse con la unidad de
procesamiento de tiempo real (con el reloj), para
que ambas etapas estn en sincronismo.

Diagrama en Bloques
de la Etapa de Audio
En la figura 3 se muestra este bloque, que es un
sistema multitarea que se encarga de activar el micrfono, los parlantes (bocinas) y el timbre del vibrador. En este caso, la frecuencia de vibracin es de
130Hz. *********

I n t roduccin
La recepcin de seales en todas las bandas por
medio de un telfono celular comienzan en la antena del mvil, ya sea externa o interna.
En la figura 1 podemos apreciar un diagrama
en bloques de la etapa de antena de un telfono
Motorola Nivel 3 (en este caso hacemos referencia
a un equipo A920 que adems de las bandas normales de trabajo, tambin opera en UMTS en
2.1GHz). M001 es un interruptor mecnico que une
a la antena con el circuito interno y que desconecta
a la antena del telfono del circuito interno cuando
se conecta una antena externa. El camino de la seal de RF cambiar entonces, cuando se conecte
una antena externa al conector macho del tipo
SMA. La seal (ya sea proveniente de la antena del
telfono o de una antena externa) llega a un FEM
(Front End Module o mdulo de salida) que se encarga de seleccionar el sistema de trabajo y proveer las condiciones de operacin para dicha banda (seleccionar entre EGSM, DCS, PCS Y WCDMA). La seleccin para trabajar con tecnologa
GSM se realiza mediante lneas de control que en
el diagrama en bloques tienen el N_BAND_1 y
N_BAND_0_G. La seleccin de modo es hecha por
lneas de control (HL_TX_EN, RX_EN_LIFE, N_GSM_EXC_EN, y GSM_EXC_EN). Note la forma en
que se recepcionan seales WCDMA. Existe un
arreglo circuital que permite que mientras que el
telfono est trabajando en un sistema GSM en
cualquier banda, ste pueda descubrir seales de
una estacin de base de WCDMA. El microcontrolador podr tomar la decisin de sincronizarse con
sistema WCDMA, en funcin de cmo est programado.
De la misma manera, si el mvil est operando
en WCDMA y se detecta una estacin base EGSM
se podr tomar la decisin de emigrar de WCDMA
hacia EGSM para que el celular siga funcionando

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(ahora con otro sistema, de acuerdo con lo detectado de la estacin base). Esto no ser posible para
seales de estaciones base que operen en las bandas PCS y DCS.
Las seales recibidas en la antena entre 2110 y
2170MHz vern el interruptor de RF como un circuito abierto en cualquier posicin. Por consiguiente,
las seales de RX WCDMA (WCDMA_RX) sern enviadas hacia el receptor WCDMA a travs del bloque FL010. Este bloque debera tener una prdida
de insercin mxima de ~0.5dB. Para otra banda
que no sea WCDMA, FL010 se comporta como un
circuito abierto, impidiendo a las seales llegar hasta el receptor WCDMA.
Q902 es un dispositivo FET dual que se emplea
para seleccionar la funcin N_BAND_) o la seal
proveniente del bloque MAGIC LV a la funcin mltiple de la seal de control de N_BAND_0 que viene de la Magic LV. Con el empleo de Q902, N_GSM_EXC_EN seguir a la banda N_BAND_0.
Q906 es otro sistema de seleccin tipo FET dual
para la seleccin entre GSM y WCDMA durante la
Figura 1

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transmisin. Durante condiciones de transmisin

WCDMA, HL_TX_EN estar en un estado alto. Esto
abrir los interruptores FETs en Q906, incapacitando cualquier funcin de seal de lneas de control
NB_EXC_EN como N_BAND_0.
Q901 es usado para invertir la seal de control
que viene de Q906. Evidentemente, si Ud. no est
familiarizado con sistemas de transmisin y no conoce los principios de funcionamiento tanto de la tecnologa CDMA como de GSM, seguramente no va
a poder comprender las funciones recin especificadas pero tendr una idea de cmo es el procesamiento de las seales en torno de la antena del celular. En la figura 2 se reproduce el circuito elctrico
del circuito de antena de un mvil Motorola 920 en
el que podr encontrar en qu consiste cada uno de
los bloques nombrados.
Cabe aclarar que estamos empleando una serie
de trminos que el lector debera conocer para comprender la explicacin que se est brindando y que
ms adelante encontrar un vocabulario que lo
podr ayudar cuando se le presenten dudas sobre
algn trmino. ********************

Figura 2

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I n t roduccin
Es evidente que todos los telfonos celulares hacen lo mismo (desde el punto de vista de comunicaciones) y por ello lo explicado sobre la etapa de un
mvil puede extenderse a todos los aparatos. Continuando con la descripcin de las diferentes etapas
que componen a un telfono celular, en este apartado describiremos el diagrama en bloques de la etapa de recepcin para la tecnologa GSM. Veremos
la etapa final y luego la descripcin del sistema
que controla a este circuito, cmo se realiza la conversin de seal para obtener informacin digital
que pueda ser procesada por el microcontrolador
del telfono. La explicacin la haremos en base al
denominado Magic LV, circuito integrado (denominado como U500 en celulares Motorola) que, como veremos, es el corazn del sistema.

El Circuito Fro n t E n d
Una vez que una seal es detectada en la antena de un mvil, ya sea EGSM, PCS o DCS, primero pasa por circuitos tipo balun (balanced-unbalanced) que convierten a dicha seal en balanceada respecto de un punto de referencia (convierte
una seal desequilibrada a la condicin de lnea
equilibrada, tal como sucede en un sintonizador de
un receptor de televisin) para luego ser conducida
al circuito integrado, que realiza su tratamiento y
que en el diagrama en bloques de la figura 1 corresponde al LIFE U625. Al respecto, reiteramos
que hacemos la descripcin de cada etapa basndonos en un telfono Motorola Nivel 3 A920, pero
que lo explicado se aplica para saber cmo funciona cualquier telfono celular con similar tecnologa.
Los balunes suelen introducir prdidas del orden
de 1dB.

10 Club Saber Electrnica

El circuito integrado U625 posee un amplificador de bajo ruido (LNA) que le da a la seal el nivel apropiado para su tratamiento, un oscilador
controlado por tensin (VCO) y una etapa mezcladora convertidora para llevar a la seal recibida a
banda base. Dentro del integrado, la seal recibida es mezclada con una seal para obtener una
Frecuencia Intermedia Muy Baja (VLFI) del orden de
los 100kHz. Se emplea esta configuracin para
mejorar la salida del oscilador local (LO) cuya seal
ser mezclada con la recepcionada por la antena y
que ingresa al integrado luego de ser equilibrada
por el balum. En esta etapa se realizan compensaciones de corriente continua, con el objeto de obtener una seal menos ruidosa. En el diagrama en
bloques de la figura 1, se obtienen diferentes conversiones segn que la seal sea GSM, DCS o PCS.
Luego del tratamiento de la seal recepcionada tenemos, a la salida del integrado U625, las seales
de fase (I) y cuadratura (Q).

Para que el circuito integrado LIFE funcione sincrnicamente, se envan seales SPI de datos y reloj
desde una etapa MAGIC (regulador de tracking y
tensin de aislacin del VCO).
El integrado de tratamiento de seal de RF
(U625 LIFE) posee cuatro amplificadores de bajo
ruido (de los cuales slo se emplean tres) con dos
caminos en cuadratura para la seal: uno que puede ser usado para la banda baja de 850MHZ
900 MHz (GSM de 850MHz 900MHz) y otro para la banda alta en DCS de 1800MHz (1805MHz
a 1880MHz) en PCS de 1900MHz (1930MHz a
1990MHz). Todos los amplificadores son programables mediante interfase SPI (Serial To Parallel Interface, interfase serie a paralelo). Un bus SPI consiste en tres seales:
SPI_DATA
SPI_CLOCK
SPI_LATCH

Figura 1

Club Saber Electrnica 11

Figura 2

12 Club Saber Electrnica

Generalmente a esta interfase se la emplea para controlar una seal interna por medio de un controlador externo, que es lo que ocurre con los VCOs
del LIFE que deben ser controlados por el bloque
MAGIC_LV.
La seal RX_VCO es reenviada al prescaler de
entrada con una frecuencia que depender del canal seleccionado. La seal en este canal tiene una
amplitud de 30dB.
LIFE contiene tres osciladores controlados por
tensin (RX_VCO) los cuales operan a frecuencias
del orden de los 4GHz. Los tres osciladores internamente se tratan para que provean seales en perfecta cuadratura segn la banda seleccionada (en este ejemplo empleamos las bandas GSM =
900MHz, DSC = 1800MHz y PCS = 1900MHz).
La seal de entrada de RF de sintona (RX_TUNE) proveniente del procesador de entrada (MAGIC_LV) selecciona la frecuencia de oscilacin del
VCO a travs de la aplicacin de una tensin comprendida entre 0,5V y 4,5V.
De esta manera, las frecuencias de oscilacin de
cada VCO local depender de cada tecnologa o
banda y ser:
DCS: 3610MHz - 35759MHz,
EGSM: 3700MHz - 3838MHz,
PCS: 3859 - 3980MHz.
La seal de AGC (control automtico de ganancia) es provista por un amplificador (comn a las
tres bandas) y compartida por los cuatro amplificadores. La ganancia del amplificador de AGC se
controla por medio de la tensin presente en un
pin, utilizando un conversor DA de 6 bits.
El seteo del AGC se realiza mediante las lneas
de programacin SPIDATA, SPI_CLK y SPI_CE (figura 2).
El integrado LIFE tiene un detector de RF interno
en la entrada del amplificador de AGC.
El nivel de salida de corriente continua detectado ser comparado contra una seal de referencia,
que es seleccionable por medio del bus SPI, de modo que el umbral pueda ser puesto a 0dB, 3dB,
6dB, o 9dB debajo del nivel, que causa el mal funcionamiento de mezclador.

Si el nivel de la seal detectada es superior al nivel de referencia, la lnea AGC_GLAG ir a 1 lgico, el MAGIC_LV recibir este cambio de nivel en
la lnea y cambia la ganancia del AGC hasta el nivel necesario que haga que desaparezca ese 1
en AGC_FLAG y vuelva a 0.
Aclaremos nuevamente que tanto las seales de
fase (I/IX) como las de cuadratura (Q/QX), tienen
una frecuencia del orden de los 100kHz y representan valores bajos de frecuencia intermedia (VLIF).
El pin de entrada RX_EN_LIFE controla el estado
ON/OFF del receptor y del circuito PLL.
Para amplitudes de la seal presente en la antena del orden de 50dB, se espera tener una seal
de VLFI de salida pico a pico del orden de 1mVpp.

El Circuito Back - End

Funcionamiento del U500 Magic LV
En la figura 3 podemos ver el diagrama en bloques del sistema back end de recepcin de un telfono celular. Note que el primer bloque es la etapa Front End (GSM RX Front End).
El circuito integrado Magic LV, entre otras cosas,
procesa las seales para las bandas EGSM, DCS Y
PCS (VLIF: RX_I, RX_I_X, RX_Q, Y RX_Q_X) que son
recibidas y enviadas a un primer bloque de recepcin (un circuito integrado llamado LIFE). Simplemente, el MAGIC_LV realiza una conversin analgica a digital de las seales de fase y cuadratura
(I/Q), y enva los datos al procesador (POG) a travs de una interfase SSI (interfase serie sincrnica)).
El MAGIC_LV tambin tiene un amplificador de FI
digital programable, capaz de mejorar el rechazo
de la frecuencia imagen.
En este circuito integrado, cada canal posee un
Amplificador Mezclador (PMA), un filtro pasivo de
dos polos integrado (IFA), un amplificador adicional
seguido de un filtro activo programable de dos polos antisolapamiento (principalmente requerido para encontrar seales interferentes, Anti Aliasing Filter). Luego se tiene un conversor ADC pasabajo tipo sigma-delta, con un oscilador (clock) programable de sobremuestreo OVSCLK (sacado del oscilador de referencia) igual a 13MHz para un espacia-

Club Saber Electrnica 13

do de canal (ancho de banda) de 200kHz, con una

seal de 13 bits.
Luego de los conversores sigma - delta, en cada
canal se colocan detectores digitales y fitros. De esta manera, las seales resultantes se comparan con
un nivel definido por un detector de nivel (DET_LVL).
Si cualquiera de los niveles detectados excede el
umbral programado, entonces el pin DET_FLAG es
puesto en alto.
Esto indica que el nivel de seal es muy alto para el modulador de delta sigma. DET_FLAG es ledo
por el procesador, que responder programando o

ajustando el nivel de AGC (control automtico de

ganancia) de modo que la seal vaya bajando, proceso que contina hasta que el pin DET_FLAG tome
nuevamente un nivel bajo.
Las salidas de los moduladores de sigma-delta
son procesadas digitalmente a travs de un circuito
de cancelacin de ruido y filtros. Un segundo oscilador local digital programable (LO), basado en datos ledos desde la memoria ROM, genera oscilaciones digitales en cuadratura, con correccin programable de ganancia/fase (llamado multiplicador balanceado complejo, Balanced Complex Mod) que

Figura 3

14 Club Saber Electrnica

Figura 4

Club Saber Electrnica 15

llevan a las seales I/Q (fase y cuadratura) a banda base por medio de cuatro mezcladores de cuadratura, que proporcionan el rechazo de imagen de
los canales adyacentes. Un oscilador digital de cuadratura (Dig Quad Osc) se encarga de realizar la
correccin de ganancia y de fase, para compensar
los desajustes de las seales fase y cuadratura que
se producen durante su procesamiento. Luego de la
conversin a banda base y de la reduccin de la seal imagen, las seales de fase y cuadratura son
procesadas por filtros digitales encargados de dar
selectividad al canal (lo que significa que estos filtros son de alto factor de mrito) y un fuerte rechazo al ruido.
Un bus serie que consiste en SDFS Y SDRX, transmitir los datos RXI y RXQ en un formato de 2 seales complementarias. BDR y BFSR son salidas del

16 Club Saber Electrnica

MAGIC LV. BFSR es una seal de formacin que marca el principio de transferencia de las seales de fase y cuadratura I/Q. BDR es el conjunto de datos seriales. El reloj usado para la transferencia serial es
BCLKR. Cuando NB_RX_ACQ toma el estado alto,
MAGIC LV activar la interfaz SSI en la seccin de
receptor digital.
De esta manera comenzar la transmisin de informacin sobre el bus serial como una sucesin normal de datos I y Q que son reconocidos y procesados internamente por el receptor digital. Por ltimo,
en la figura 4 se tiene el diagrama en bloques de
las etapas intervinientes en este proceso, razn por
la cual deberemos analizar los bloques FL500 y
FL510, tema que desarrollaremos ms adelante.
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