UNIVERSIDAD FRANCISCO DE PAULA SANTANDER 1

INF-MCU
PROGRAMA DE INGENIERA ELECTRNICA
Versin: 1.0
Jhon Castro 1161104DISEO DIGITAL
Informe de las prcticasI. de laboratorio N5,6,7: Pgina: 1 de 5

ESTILOS DE PROGRAMACIN EN VHDL

Para solucionar el problema expuesto es necesario conocer
con anterioridad el entorno de trabajo de xilinx y las
INTRODUCCIN caractersticas propias de la tarjeta Nexys 2, adems de tener
en cuenta los diferentes estilos de programacin que maneja

P
el lenguaje VHDL..
ARA la implementacin, desarrollo y correcto
funcionamiento de circuitos digitales es necesario
conocer el entorno de programacin de Xilinx y cules son III. HERRAMIENTAS UTILIZADAS
los estilos posibles para la programacin en VHDL.

En el siguiente informe se dispondr a implementar un La herramienta de simulacin de Xillinx Design Suite

circuito lgico, mediante los tres estilos de programacin
estudiados descripcin funcional, descripcin de flujo de
datos y descripcin estructural; posteriormente se realizar el
proceso de simulacin mediante la herramienta
computacional Xilinx Ise Design Suite 10.1 y se obtendrn
los archivos .bit correspondientes a cada circuito para su
posterior implementacin en la tarjeta NEXYS 2.
Por ltimo, se analizaran los resultados obtenidos para
comprobar que los objetivos de la prctica se hayan
completado.
10.1 proporciona un entorno cmodo y sencillo en el
cual se puede comprobar el funcionamiento de
diversos circuitos digitales.
Digilent Adept system V2.13.1 utilizada para
implementar el cdigo en la tarjeta Nexys 2.
La tarjeta Nexyx 2 que contiene una FPGA y es
utilizada para la implementacin de los cdigos en
VHDL.

I. OBJETIVOS IV. DESARROLLO DE LA PRCTICA

El objetivo primordial de la prctica es implementar un
circuito lgico digital (vase figura 1) en la tarjeta Nexys 2
Aplicar a un sistema electrnico digital el estilo de mediante el software Xilinx Ise Design Suite utilizando los
descripcin funcional en lenguaje VHDL, para diversos tipos de programacin:
describir su comportamiento, identificar sus
componentes fundamentales al interior de cada
unidad bsica de diseo y deducir sus ventajas y Estilo de descripcin funcional o algortmica
desventajas.
Aplicar a un sistema electrnico digital el estilo de Estilo de descripcin de flujo de datos
descripcin flujo de datos en lenguaje VHDL, para
describir su comportamiento, identificar sus Estilo de descripcin estructural
componentes fundamentales al interior de cada
unidad bsica de diseo y deducir sus ventajas y
desventajas.

Describir el comportamiento de un sistema

electrnico digital utilizando el estilo de
programacin estructural de VHDL, para identificar
sus componentes fundamentales al interior de cada
unidad bsica de diseo.

II.PLANTEAMIENTO DEL PROBLEMA

Qu procedimientos son necesarios para implementar un

circuito digital mediante los diferentes estilos de Figura 1. Circuito lgico propuesto
programacin en la tarjeta Nexys 2?
Para llevar a cabo este proceso se precis de las leyes y
postulados del algebra de Boole, tablas de verdad, y de un
conocimiento bsico de la herramienta computacional a
utilizar.
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Los circuitos esquemticos se implementarn en la tarjeta

Nexys 2 mediante un archivo .bit obtenido con anterioridad.

Figura 3. Simulacin circuito lgico con ISim de Xilinx

Luego de la simulacin el paso a seguir es la asignacin de

los pines para la posterior implementacin en la Nexys 2.

Por ltimo, despus de implementar y sintetizar el circuito

se procedi a generar el archivo de programacin y con ayuda
de la herramienta Adept se implement en la tarjeta Nexys 2
dando por resultado:
Figura 2. Tarjeta Nexys 2 [1]

Para el desarrollo de la prctica se hizo necesaria la

aplicacin de las tablas de verdad correspondiente al circuito
a implementar.

A B C D F G
0 0 0 0 0 0
0 0 0 1 0 0
0 0 1 0 0 0
0 0 1 1 0 0
0 1 0 0 1 0
0 1 0 1 1 0
0 1 1 0 1 1
0 1 1 1 1 0 Figura 3. Implementacion circuitro logico en Xilinx
1 0 0 0 0 0 Entradas (0111) y salidas (11)
1 0 0 1 0 0
1 0 1 0 1 0
1 0 1 1 1 0
1 1 0 0 1 0
1 1 0 1 1 0
1 1 1 0 1 0
1 1 1 1 1 0
Tabla 1. Tabla de verdad circuito lgico

Se procedi implementar el circuito mediante los diferentes

estilos de programacin propuestos (ver anexos), luego se
opt por realizar la simulacin correspondiente, mediante la
herramienta Isim de Xilinx.

Figura 4. Implementacion circuitro logico en Xilinx

Entradas (111) y salidas (01)
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Finalmente se procedio a crear un simbolo esquematico que

realice las funciones de nuestro circuito. (Para cada estilo de
programacin se realizo uno propio)

Figura 5. Simbolo esquematico

V. CONCLUSIONES

Para la implementacin de un circuito lgico en la tarjeta

Nexys 2 se puede optar por alguno de los tres estilos de
programacin en lenguaje VHDL:

El estilo de descripcin funcional es el ms bsico de los

tres estilos de programacin en VHDL, ya que se sigue una
estructura parecida a los lenguajes de programacin
convencionales. Sin embargo, al encontrarse lejos de lo que es
realmente un circuito, se pueden plantear algunos problemas
al momento de implementarlo a partir de la descripcin de su
comportamiento.

El estilo de descripcin de flujo de datos posee la

caracterstica de describir circuitos y adems permite la
paralizacin de instrucciones, esta se encuentra ms cercana
a una descripcin estructural del mismo, siendo todava una
descripcin funcional.

El estilo de descripcin estructural es el ms complejo de los

tres, sin embargo con l se puede entender el funcionamiento
del circuito desde una perspectiva ms bsica, sirve para la
realizacin de diseos jerrquicos que involucren la conexin
de varios componentes. Sin embargo este estilo de
programacin no resulta muy aconsejable para circuitos
medianamente complejos ya que el tiempo de edicin es
mayor al de los otros estilos.

REFERENCIAS
[1] http://www.olimex.cl/images/MCI-TDD-01569_Nexys2-top-1200.jpg
[2] Ing. Jhon Jairo Ramirez Matheus, Guias de Laboratorio 1,2,3 Diseo
Digital
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ANEXO A. INFORMACIN ADICIONAL

Anexo 1. Cdigo estilo de descripcin funcional

Anexo 2. Cdigo estilo de descripcin de flujo de datos (bool)

Anexo 3. Cdigo estilo de descripcin de flujo de datos (when)

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Anexo 4. Cdigo estilo de descripcin de flujo de datos (when-concatenacin)

Anexo 5. Cdigo estilo de descripcin estructural