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UNIVERSIDAD NACIONAL MAYOR DE SAN MARCOS

Facultad de Ingeniera Electrnica y Elctrica


E.A.P. Ingeniera Electrnica

Laboratorio de Circuitos Digitales I


Informe Previo N 5

TEMA: Circuitos Codificadores y Decodificadores.

CURSO: Circuitos Digitales I

ALUMNO: Cuba Miranda, Lucero Milagros.

CDIGO: 15190005

PROFESOR: Ing. Casimiro Pariasca, scar

2017-1
UNMSM FIEE LAB. DE CIRCUITOS DIGITALES I

INFORME PREVIO N 5
1. Qu es un circuito codificador? Y un decodificador? Explique

CIRCUITO CODIFICADOR
Un codificador es un circuito combinacional con un conjunto de entradas (2N) y un nmero
de salidas N cuyo propsito es mostrar en la salida el cdigo binario correspondiente a la
entrada activada.

Por ejemplo, un codificador de 4 entradas X0, X1, X2, X3 y 2 salidas S0, S1. Si se activa la
entrada X0 mediante la introduccin de un 1, el cdigo mostrado a la salida ser S0S1=00.
Y as para el resto de las entradas: X1 activar una salida 01, X2 activar una salida 10 y
X3 activar una salida 11.

Obsrvese que el valor en binario de la salida en su conjunto 00, 01,10, 11 es igual al


nmero decimal de la entrada activada 0, 1, 2,3 que acompaa a la letra X.

Las funciones algebraicas de un codificador se pueden deducir a partir de su


funcionamiento. Por ejemplo, en el caso de que se disponga de un codificador de 4
entradas (y dos salidas) stas sern:
S0= X1 + X3
S1= X0 + X2

Para ello, se ha tenido en cuenta que la salida S0 slo vale 1 para los valores 1 y 3 (en
decimal) o 01 y 11 (en binario). La salida S1 slo vale 1 para los valores 2 y 3 (en decimal)
o 10 y 11 (en binario).
Para obtener estas funciones se ha considerado que nunca va a producirse una combinacin
a la entrada que tenga ms de un 1 y por lo tanto, no importa el valor que produce a la

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salida esa situacin. Todo ello lo podramos resumir en la siguiente tabla de verdad
resumida en la que slo se han puesto 4 combinaciones de las 24=16 posibles. Las celdas
sombreadas en azul son las salidas.

Si en algn momento se activarn ms de una entrada, la salida no estara definida, es decir,


no se puede saber a priori qu valor se obtendra. Dependiendo de cmo se haya diseado
puede haber variaciones entre unos dispositivos y otros.

CIRCUITO DECODIFICADOR
Los decodificadores efectan la operacin inversa de los codificadores. Disponen de un
conjunto N de entradas y un conjunto 2N de salidas. Cuando aparece un cdigo binario a la
entrada, se activa (tiene un 1) la salida identificada con el nmero decimal equivalente.

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En el siguiente ejemplo, se plantea un codificador de 2 a 4, que tiene la siguiente tabla de


verdad (las celdas sombreadas en azul son las salidas):

En esta tabla se disponen dos entradas E1, E0 y 4 salidas Z3, Z2, Z1 y Z0. Se activar un 1
en la salida correspondiente al cdigo introducido en la entrada.
Las funciones de salida son bastante sencillas de obtener a partir de esta tabla de verdad:
Z3 = E1E0
Z2 = E1E0
Z1 = E1E0
Z0 = E1E0
Se puede considerar que la funcin de estos dispositivos es la de generar
los 2N minitrminos de las N variables de entrada. Esta visin es muy interesante
porque pueden ser utilizados para la implementacin de cualquier funcin
algebraica del mismo nmero de variables.

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2. Explique el funcionamiento del circuito 74LS147, circuito codificador de prioridad de


entrada decimal y salida BCD.

CIRCUITO 74LS147

FUNCIONAMIENTO:
El funcionamiento del codificador es bastante sencillo, cuando se activa una de las entradas del 0 al
8 mediante un 0, sale a la salida el nmero en digital, en nivel bajo, de la entrada que ha sido
activada. Por Ej. Si se activa la entrada 4 mediante un 0, en la salida aparecer 1 0 1 1. Siendo la
salida D= 1, C= 0, B= 1, A= 1.

TABLA DE LA VERDAD

SALIDA ENTRADA

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3. Analizar la operacin del decodificador 74LS47 y su uso con un display de siete


segmentos de nodo comn. Cmo hallara experimentalmente cada uno de los
terminales de un display de siete segmentos de nodo comn?

La Figura 6.2 (a) muestra


un decodificador/manejador de BC
D a 7 segmentos (TTL 7447) que
se utiliza para manejar una
presentacin LED de 7 segmentos.
Cada segmento consta de uno o
dos LED.
Los nodos de los LED estn todos
unidos a Vcc (+5V). Los ctodos de
los LED estn conectados a travs
de resistencia limitadoras de
corriente a las salidas adecuadas
del decodificador / manejador. ste
tiene salidas activas en BAJO que
son transistores manejadores de
colector abierto que pueden dispar
una corriente bastante grande.
Esto se debe a que las presentaciones LED pueden requerir 10mA a 40mA por segundo, segn su
tipo y tamao
.

Para ilustrar la operacin de este circuito, suponer que la entrada BCD es A=0, B=1, C=0 y D=1,
que es 5 en BCD. Con estas entradas las salidas del decodificador/manejador a', f', g', c' y d' sern
llevadas al estado BAJO (conectadas a tierra), permitiendo que fluya corriente a travs de los
segmento LED a, f, g, c y d, presentando con esto el nmero 5. Las
salidas b' y e' sern ALTAS (abiertas); as que los segmentos LED b y e no enciendan.

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El decodificador/manejador 7447 est diseado para activar segmentos especficos an de cdigos


de entrada mayores de 1001 (9). La Figura 6.2 (b) nuestra cules segmentos son activados para cada
uno de los cdigos de entrada de 0000 a 1111 (15). Notar que un cdigo de entrada de 1111 borrar
todos los segmentos.

La presentacin visual LED que se utiliza en la Figura 6.2 es un tipo de nodo comn, donde
los ctodos de cada segmento se interconectan y se conectan a tierra. Este tipo de presentacin
visual tiene que ser manejada por un decodificador/manejador de datos BCD a 7 segmentos con
salidas activas en ALTO que apliquen un voltaje alto a los nodos de aquellos segmentos que vayan
a ser activados.

4. Analizar y simular el funcionamiento del decodificador 74139 , 74138 y 7415

DECODIFICADOR 74139

El circuito integrado 74139 es un circuito integrado


que tiene la funcin de un doble decodificador /
demultiplexor binario de 2 bits (1:4).
Con las tres entradas que posee el circuito podemos
realizar 4 combinaciones diferentes en binario, de 00
a 11 que nos activarn una de las salidas Yn.
Una de las utilidades que tiene en la prctica es para
seleccionar memorias y perifricos en el espacio de
memoria de los sistemas con microprocesadores.
La habilitacin del 74139 se realiza cuando la
entrada G (G1 o G2) la llevamos a nivel bajo.
Con este decodificador/demultiplexor se pueden
realizar otros ms grandes haciendo uso de la
entrada G.

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La relacin de pines de este integrado es la siguiente:


A, B: Entradas de seleccin, segn la combinacin binaria que coloquemos
tendremos activada la salida Yn correspondiente.
G: Entrada de validacin, activa a nivel bajo.
Y0, Y1, Y2, Y3: Salidas del decodificador activas a nivel bajo (0V), solo puede
haber una activa a nivel bajo.

DECODIFICADOR 74138

El circuito integrado 74138 es un circuito


integrado que tiene la funcin de decodificador /
demultiplexor binario de 3 bits (1:8).
Con las tres entradas que posee el circuito
podemos realizar 8 combinaciones diferentes, de
000 a 111 que nos activaran una de las salidas Yn.
Este circuito integrado se utiliza mucho para
seleccionar memorias y perifricos en el espacio de
memoria de los sistemas con microprocesadores.
La habilitacin del 74138 se activa slo cuando se
cumple la siguiente ecuacin de los pines de
entrada.

La relacin de pines de este integrado es la siguiente:

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A, B, C: Entradas de seleccin, segn la combinacin binaria que coloquemos


tendremos activada la salida Yn correspondiente.
G1, G2A, G2B: Entradas de validacin, la primera activa a nivel alto y las dos
siguientes a nivel bajo, si no cumplimos estas condiciones el decodificador no
funcionara.
Y0, Y1, Y2, Y3, Y4, Y5, Y6, Y7, Y8: Salidas del decodificador activas a nivel bajo
(0V), solo puede haber una activa a nivel bajo.

DECODIFICADOR 74154
El circuito integrado 74154 es un circuito integrado que tiene la
funcin de decodificador / demultiplexor binario de 4 bits (1:16).
Con las cuatro entradas que posee el circuito podemos realizar 16
combinaciones diferentes, de 0000 a 1111 que nos activaran una de
las salidas Yn.
Las salidas son del tipo Ttem pole.
La relacin de pines de este integrado es la siguiente:
A_SEL, B_SEL, C_SEL y D_SEL: Entradas de seleccin,
segn la combinacin binaria que coloquemos tendremos activada la
salida Yn correspondiente.
G1 y G2: Entradas de validacin o datos activas a nivel bajo
(0V), tenemos que tener las dos activas a nivel bajo para que
funcione el decodificador..
Y0, Y1, Y2, Y3, Y4, Y5, Y6, Y7, Y8, Y9, Y10, Y11, Y12,
Y13, Y14, Y15: Salidas del decodificador activas a nivel bajo (0V),
solo puede haber una activa a nivel bajo.

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En la imagen se pude ver el esquema y la tabla de verdad.

5. Analizar la operacin del decodificador 74LS155 como un decodificador dual 2 x 4


como un decodificador simple de 3 x 8.

DECODIFICADOR 74LS155 COMO UN DECODIFICADOR DUAL 2 X 4


Este circuito integrado contiene dos de multiplexores 1:4, que tambin pueden funcionar como
decodificadores 2 a 4.
La relacin de pines de este integrado es la siguiente:

A y B: entradas de seleccin comunes a los dos demultiplexores activas a nivel alto (5V).
1G y 2G: entradas de inhibicin o STROBE de los demultiplexores 1 y 2 respectivamente, activas a
nivel bajo (0V).
1C y 2C: entradas del dato de los demultiplexores 1 y 2 respectivamente. 1C es activa a nivel alto
(5V) y 2C es activa a nivel bajo (0V).
1Y0, 1Y1, 1Y2, 1Y3: salidas del demultiplexor 1 activas a nivel bajo (0V).
2Y0, 2Y1, 2Y2, 2Y3: salidas del demultiplexor 2 activas a nivel bajo (5V).

Con esta lgica en los pines, el dato 1C est invertido en las salidas 1Y0, 1Y1, 1Y2, 1Y3, mientras
que el dato 2C no lo est en 2Y0, 2Y1, 2Y2, 2Y3.

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La tabla de verdad y el montaje del demultiplexor 1 es la siguiente:

TABLA DE VERDAD:

Podemos observar que cuando la entrada del Strobe (1G) est a 0 y la del dato (1C) est a 1, el
demultiplexor 1 se comporta como un decodificador de dos entradas (A y B) y cuatro salidas activas
a nivel bajo.

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6. En la figura se muestra un circuito decodificador de 5 bits que utiliza el CI 74HC154.


Explicar su funcionamiento. Explique cmo funciona si el nmero binario es
A4A3A2A1A0? Qu resultado obtendremos en las salidas si la entrada binaria es
10110?

El circuito nos muestra que las entradas de habilitacin del primer codificador estn
conectadas a travs de un inversor 74LS04 a las entradas de habilitacin del otro
decodificador, es decir, solamente un decodificador est activo a la vez, por otro lado
se tienen 4 bits de entrada y por consiguiente 16 combinaciones posibles, por lo tanto si
aplicamos los datos 10110, primero notamos que el primer decodificador queda
inhabilitado, mientras que el segundo queda habilitado, la combinacin
correspondiente a los bits A3A2A1A0 es 0110 que corresponde a la ubicacin nmero
6 (decimal), que para el segundo decodificador es la nmero 6 (en la simulacin),
entonces tendremos la activacin(salida 0) del puerto 6 del segundo decodificador de
5 bits.

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7. Un circuito combinacional tiene 3 entradas X, Y, Z y 3 salidas F1, F2, F3 donde:


= +
= +
= +
Nota: /X = X negado, etc, etc.
Implementar con un CI decodificador 74LS155 y compuertas bsicas.
Tambin lo puede implementar con otros decodificadores.
Trataremos de simplificar las funciones F1, F2, F3:
1 = +
Sabemos por el lgebra Booleana que:
LEY DEL ELEMENTO NEUTRO: = 1
LEY DEL COMPLEMENTO: + = 1
Por lo tanto:
1 = ( +) +
1 = + +
1 =( + +) + ( + +) + ( + + )
1 =[( + +) ( + +) ( + + )]

2 = +

2 =/X Y Z +/X Y /Z + X /Y /Z
2 =/[(X +/Y +/Z) (X +/Y + Z) (/X + Y + Z)]

3 = +
3 = XYZ + XY/Z +/X/YZ
3 = /[(/X +/Y +/Z)( /X +/Y + Z)(X + Y +/Z)]

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Entonces el circuito ser:

8. Presente las simulaciones de los circuitos mostrados en este cuestionario previo.


Vase en la carpeta SIMULACIONES.

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