COMPLEMENTOS SOBRE M.E.F.S.

1) Tratamento da variveis externas MEFS

Entrada assncrona pode violar os tempos de Setup e Hold Metaestabilidade

Metaestabilidade ocorre quando valor intermedirio (entre 0 e 1 lgico)
assumido por um tempo indeterminado mas finito.
a) Tratamento da entrada assncrona

Soluo : no h soluo exata

Metaestabilidade

Ent_assncrona Ent_sncrona
SET SET
D Q D Q

Controlador
Q Q M.E.F.S.
CLR CLR

CLK

Mesmo aumentando o nmero de FFs a probabilidade de ocorrer

metaestabilidade nunca ser zero%.

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Tratamento da variveis externas MEFS
Entrada assncrona pode violar os tempos de Setup e Hold Metaestabilidade

b) Tratamento da entrada assncrona: Quando a entrada assncrona

pulsada com um pulso menor que o perodo

Ent_assncrona

Metaestabilidade

SET SET
Ent_sncrona
D Q D Q

Controlador
Q Q M.E.F.S.
CLR CLR

CLK

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2) Inicializao de uma MEFS

a) Automtica VCC
a) Automtica

CLEAR
R

CLEAR T
Onde: T = RC

b) Manual

D Q

Latch
CLEAR
b) Manual Q

Chave

CLEAR

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3) Eliminao de Glitches nas variveis de sada

A lgica de sada de uma MEFS tem grande potencial de gerar glitches, tambm
chamado de pulsos espurios

Exemplo:

A =0 1 SET 01
D Q Porque ?

TPLH_FF_DA

CLR
Q
Y =010
TPHL_FF_DB
B=1 0 SET
D Q
10

CLK
CLR
Q

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3) Eliminao de Glitches nas variveis de sada

Soluo:

a) Registrador M.E.F.S. Registrador

de sada Sadas Saidas

CLK

S1"
b) Portas AND S1
M.E.F.S.

SK
SK

CLK

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4) Variveis de sada pulsadas

Soluo: As sadas de uma MEFS so vistas como sinais de

nvel, portanto precisam de um tratamento

CLK
CLK Sada1

Sada Sada

Sada1
CLK
Sada2

Sada2 Sada

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5) Codificao de MEFS com Sada Direta eliminao do bloco lgico de
sada

Exemplo:

X X
Estados 0 1 Z ZQ 0 1
A Q
B C 0 1 (A) 00 10 01
Z Estados Z 0
B B D 1 0 A, C 0 A C (C) 01 00 10

C A B 0 1 B, D 1 B D (D) 11 11 00

D D A 1 (B) 10 10 11

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6) Conceito de Tri-state terceiro estado alta impedncia

Famlia CMOS CMOS significa Complementary Metal-Oxide Semiconductor

Esta tecnologia utiliza: transistores de efeito de campo ou Field Effect Transistor (FET)

Vdd
MOSFET Inversora
Canal P
PMOS
A Y
A Y

MOSFET NMOS
Canal N

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6) Conceito de Tri-state terceiro estado alta impedncia

Famlia CMOS Inversora tri-state (terceiro estado alta impedncia)

Vdd
A Y
A

Vdd
EN
EN EN A Y
Y
0 0 Z (alta impedncia)
0 1 Z
1 0 1
1 1 0

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6) Conceito de Tri-state terceiro estado alta impedncia

Famlia CMOS Inversora tri-state (terceiro estado alta impedncia)

Quando: EN=0 y=Z Quando: EN=1 Y = A

Vdd
A Vdd
A
Vdd
Vdd
EN zero
Y EN
Y

hum

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7) Conceito de Barramento

Mdulo-1 Mdulo-2 Mdulo-K

ou ou ou
Dispositivo-1 Dispositivo-2 Dispositivo-K

Como resolver ? N N N

Barramento

Mdulo-1 Mdulo-2 Mdulo-K

a) Usando MUX ou ou ou
Dispositivo-1 Dispositivo-2 Dispositivo-K

N N N

Log2 K Banco de Mux Kx1

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7) Conceito de Barramento

Mdulo-1 Mdulo-2 Mdulo-K

ou ou ou
Dispositivo-1 Dispositivo-2 Dispositivo-K

Como resolver ? N N N

Barramento

Mdulo-1 Mdulo-2 Mdulo-K

b) Usando Tri-state ou ou ou
Dispositivo-1 Dispositivo-2 Dispositivo-K
En-1
N N N
En-2

En-k

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7) Conceito de Barramento

Como realizar a comunicao para o uso do barramento

Soluo: controlador de barramento

En-k Controle
externo
Controlador
En-2
En-1
Pedido-1 Aceito-1 Pedido-2 Aceito-2 Pedido-K Aceito-k

Mdulo-1 Mdulo-2 Mdulo-K

ou ou ou
Dispositivo-1 Dispositivo-2 Dispositivo-K

N N N

CLK
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