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IDCI FRBA 2016 Ing. Rubn Lozano - Ing. Fabio Marano Gastn Pierri
Stack
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Stack
Pre
Impregned
Cooper Foil
Fiber Glass
(Lamina de
(Adhesivo)
Cobre)
Rigid Fiber
Glass (FR4)
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Ventajas
Da posibilidad de mejorar el layout en los siguientes aspectos
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Desventajas
Desde el punto de vista comercial podemos decir que:
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Qu evaluar:
Tamao del producto
Encapsulados de componentes a utilizar
Cantidad de seales a rutear
Cantidad de Alimentaciones y consumo de corriente
Tipo de seales a rutear
Frecuencia de Trabajo
Requerimientos de emisin
Target de precio del producto
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Una vez que decidimos:
Cantidad de layers de ruteo?
Cantidad de planos de alimentacin?
Orden de Layers?
Distancia entre planos?
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Stacks Standards
Segn IPC-317
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Stacks Standards
Segn IPC-317
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Stacks de Fabricantes
Sierra Circuits 4 Layers
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Stacks de Fabricantes
Sierra Circuits 6 Layers
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Stacks de Fabricantes
Circuitos Impresos SEI 4 Layers
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Stacks de Fabricantes
Circuitos Impresos SEI 6 Layers
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Layer Stack Manager
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Tipos de vias
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Lneas de Transmisin: Microstrip
Ejemplo:
W = 8 mil H = 5 mil
Zo 50
Er = 4.1 (FR4) T = 1.4 mil (1oz) 16
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Lneas de Transmisin: Microstrip
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Lneas de Transmisin: Stripline
Ejemplo:
W = 9 mil H = 24 mil
Zo 50
Er = 4.1 (FR4) T = 1.4 mil (1oz) 18
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Lneas de Transmisin: Stripline
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Lneas de Transmisin: CPW
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Calculador: TXLine
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Caso de Estudio
EP4CE40U19I7N
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Caractersticas Importantes
Tipo de Cpsulas BGA
Pitch 0,8mm
FPGA:
Cantidad de pines 484
Cantidad de pines utilizados 422
Cantidad de Alimentaciones 4
Memoria:
Cantidad de pines 60
Requiere pistas con largo e impedancia controladas 23
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Caractersticas Importantes
Tipo de Capsula BGA
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Caractersticas Importantes
Pitch 0.8mm
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BGA: Vista Lateral
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BGA: Conexiones
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Diseo PCB
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Diseo PCB
Track Width: 5mils (0,127mm)
Via Hole Size: 8mils (0,2032mm)
Via Diameter: 16mils (0,406mm)
Annular Ring: 4mils (0,106mm)
Clearance: 5mils (0,127mm)
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Caractersticas Importantes
Cantidad de pines utilizados Stack
Cantidad de Alimentaciones Definen Reglas
Tipo de seales
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Desacoples
En un diseo deben contemplarse arrays de capacitores para
desacoplar distintos tramos del espectro de frecuencias:
Capacitores de alto valor (47uF) para baja frecuencia.
Capacitores de menor valor (4.7uF 0805/0603) para
frecuencias intermedias.
Capacitores de bajo valor (0.1uF 0402/0201) para alta
frecuencia.
Cuanto mayor es el valor de capacidad para una misma
cpsula menor es el valor de ESR.
Cuanto menor es la capsula para un mismo valor de capacidad
menor es el valor de ESL.
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Consideraciones sobre
Capacitores de desacople
Placement
Los capacitores de mayor valor pueden ubicarse prcticamente
en cualquier lugar del PCB desde el punto de vista de
funcionamiento dinmico.
Los capacitores que afectan al rango de frecuencias intermedias
(4.7uF) deben ser ubicados cerca de la FPGA sin intervenir su
posicin en componentes ms crticos. Deben estar dentro de las
2 desde el borde de la FPGA.
Para los capacitores que actan sobre las frecuencias medias
altas (0.10uF 0402/0201) podemos decir que su ubicacin es
crtica. Deben estar lo ms cerca de la FPGA.
Los capacitores de desacople pueden estar en el bottom si la
distancia entre los planos y los mismos no es muy grande. 35
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Consideraciones sobre
Capacitores de desacople
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