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CONVERSORES CCCC
BIDIRECIONAIS
Florianpolis,agostode2015.
Prof.IvoBarbi
TRABALHO 01
2. Introduo
O ganho esttico pode ser determinado de diversas formas, uma delas atravs da tenso
mdia no indutor que dever ser igual a zero. Abaixo est descrito o desenvolvimento.
VLmdia = 0
V1 V2
D T V2 ( 1 D) T = 0
T
V2
Ge = =D (para 0 < D < 1) ( 1)
V1
O valor da indutncia pode ser determinado por meio do mdulo da tenso no indutor em
um intervalo de tempo, como descrito abaixo.
iL
d
VL = L i = L
dt T
Como, V2 = D V1
Observa-se que:
VL = V1 V2 ou VL = V2
|
e e
T = D T | T = ( 1 D) T
| iL
iL V2 = L
V1 V2 = L T
T |
iL
iL | D V1 = L
V1 D V1 = L ( 1 D) T
D T
| iL
iL V1 ( 1 D) = L
V1 ( 1 D) = L D T
D T |
Por ambas as formas, possvel determinar o valor da indutncia, dada por (2):
V1 D ( 1 D)
L= ( 2)
iL f
d
V1 = LF i1 RF i1 VC ( 6)
dt
d
0 = L iL RS RL iL V2 ( 7)
dt
d
C VC = i1 ( 8)
d t
Considerando:
R = RS RL
Estado topolgico 1
RF 1 V1
d
i1 = i1 VC ( 9)
dt LF LF LF
R 1 V2
d
iL = iL VC ( 10)
dt L L L
d 1 1
VC = i1 iL ( 11)
dt C C
Estado topolgico 2
RF 1 V1
d
i1 = i1 VC ( 12)
dt LF LF LF
R V2
d
iL = iL ( 13)
dt L L
d 1
VC = i1 ( 14)
dt C
RF 1 V1
d
i1 = i1 VC ( 15)
dt LF LF LF
D R D D V2
d
D iL = iL VC
dt L L L
+
( 1 D) R ( 1 D) V2
d
( 1 D) iL = iL
dt L L
__________________________________________________
R D V2 ( 16)
d
iL = iL VC
dt L L L
d D D
D VC = i1 iL
dt C C
+
d ( 1 D)
( 1 D) VC = i1
dt C
__________________________________________________
d 1 D
VC = i1 iL ( 17)
dt C C
Reescrevendo (15) e (17), encontram-se (18) e (19) com as quais pode-se obter o primeiro
ramo do circuito equivalente de valores mdios quase instantneos, visto pela fonte de entrada V1
conforme mostram as Figs. 7 e 8:
d
LF i1 = RF i1 VC V1
dt
d
V1 VC = RF i1 LF i1 ( 18)
dt
d
C VC = i1 D iL ( 19)
dt
Fig. 7 - Primeiro ramo do circuito equivalente visto pela fonte de entrada V1 .
d
L iL R iL = D VC V2
dt
L d R V2
iL iL = VC
D dt D D
V2
L d R
D iL D iL = VC
2 dt 2 D ( 20)
D D
Uma outra manipulao matemtica poderia ser feita de forma a ser obtido um outro circuito
equivalente, visto da fonte de sada V2 . Reescrevem-se (16) e (17) e obtm-se (21) e (22) das
quais j pode ser observado como representado um primeiro ramo do circuito equivalente (Figs.
11 e 12):
d
D VC V2 = R iL L iL
dt ( 21)
d
D iL = i1 C VC
dt
i1
C d ( 22)
iL = D VC
D 2 dt
D
d
V1 VC = LF i1 RF i1
dt
d
D V1 D VC = D LF i1 D RF i1
dt
d 1 i1
2 i
D V1 D VC = D LF D2 RF ( 23)
dt D D
Fig. 14 - Circuito equivalente completo visto pela fonte de entrada V2 em regime permanente.
d
RF 1
i1 = i v
dt LF 1 LF C
RF 1
s i1 ( s) = i ( s) v ( s)
LF 1 LF C
RF 1
s i ( s) = v C( s) ( 24)
LF 1
LF
D0 d
d
dt
R
IL0 iL = IL0 iL
L
L
V2
VC0 v C
L
d R D0 v C d VC0
iL = iL
dt L L
R D0 v C( s) d ( s) VC0
s iL( s) = iL( s)
L L
D0 v C( s) d ( s) VC0
s R ( 25)
iL( s) =
L L
D0 d
d
dt
1
VC0 v C = I10 i1
C
C
IL0 iL
D0 IL0 d
d 1
v C = i1 i
dt C C L C
1 D0 IL0 d ( s)
s v C( s) = i1 ( s) i ( s) ( 26)
C C L C
(25):
( R L s) iL( s) VC0 d ( s)
v C( s) = ( 28)
D0 D0
E tambm (26):
s C v C( s) = i1 ( s) D0 iL( s) IL0 d ( s)
s C v C( s) i1 ( s) = D0 iL( s) IL0 d ( s)
i1 ( s) D0 iL( s) IL0 d ( s)
v C( s) = ( 27)
s C
V1 2 D0 IL0 RF C V1 RF C D0 IL0 RF D0 IL0 LF s C LF V1 C D0 IL0 LF RF s
2 2
iL( s)
=
R D 2 R L D 2 L C R R s C L R C L R s2 C L L s3
d ( s)
0 F 0 F F F F F
5. Exemplo de Projeto
V2 50
V2
D0 D0 0.5
V1
IL0 10
fs 40000
D0 1 D0 V1 6
L L 416.667 10
fs I
RL 0.48 RS 0.02
R RL RS R 0.5
Vc 5
IL0 6
C C 12.5 10
4 fs Vc
s( f ) fsj 2 f 3
f0 4 10
10
1 6
LF 126.651 10
2 2
4 C f0
Q 5
1 LF
RF 0.637
Q C
j 1 f 1 50 1000000
s( f ) j 2 f
Por ser um conversor bidirecional, a corrente no indutor pode apresentar os dois sentidos
e, portanto, analisando a funo de transferncia iL (s)/d(s), percebe-se a existncia de duas
possveis equaes para a anlise do controle em malha fechada
33.333
20 log G 1( f ) 16.667
Ganho (dB)
20 log G 2( f ) 0
0
16.667
33.333
50
3 4 5 6
1 10 100 1 10 1 10 1 10 1 10
f
30
60
180
arg G1( f )
Fase ()
90
180
arg G2( f )
120
150 G1(s)
G2(s)
180
3 4 5 6
1 10 100 1 10 1 10 1 10 1 10
f
6. Controle
Para o funcionamento adequado do controle em malha fechada, mostrado na Fig. 16, alguns
requisitos devem ser atendidos, tais como:
Fig. 16 - Esquemtico do circuito com controle.
A frequncia de cruzamento ponto em que o ganho (em dB) do conversor igual a um. A
escolha deve ser feita cautelosamente, pois esta frequncia tambm est diretamente relacionada
com o tempo de resposta ao degrau.
Um dos detalhes mais importantes no projeto o controle de conversores estticos, que
esta frequncia deve ser, pelo menos, um quarto da frequncia de chaveamento do conversor. Isto
se deve s no linearidades ocorridas no funcionamento do conversor medida que a frequncia
de cruzamente se aproxima da frequncia de chaveamento, tornando praticamente impossvel sua
modelagem e controle.
fs
fc fc 1600
25
Considerando,
Vp = 1
Kpmax I Vp
t T
Kpmax I Vp
( 1 D) T T
Vp ( 1 D)
Kpmax ( 31)
I
Calculando:
1 1 D0
Kpmax 0.333 Kp 0.025
I
Ki = 2 Kp fz ( 32)
Como o ganho considerado muito pequeno, adotou-se uma frequncia do zero igual a
frequncia de cruzamento para acelerar a resposta do sistema. Normalmente, utilizam-se valores
inferiores frequncia de cruzamento.
fz fc fz 1600
Ki 2 Kp fz Ki 251
Desta forma, pode ser calculado o compensador, a margem de fase e obter os diagramas
de Bode do conversor com corrente positiva no indutor, G1 (s); conversor com corrente negativa no
indutor, G2 (s); compensador C1 (s) e funo de transferncia de lao aberto FTLA(s), mostrados na
Fig. 18.
Ki
C1 ( f ) Kp FTLA ( f ) G1 ( f ) C1 ( f )
s( f )
50
33.333
20 log G 1( f )
20 log G 2( f )
16.667
Ganho (dB)
20 log C1( f ) 0
20 log FTLA( f )
0 16.667
33.333
50
3 4 5 6
1 10 100 1 10 1 10 1 10 1 10
f
0
30
180
arg G1( f )
60
180
arg G2( f )
Fase ()
90
180
arg C1( f )
120
180 G1(s)
arg( FTLA( f ) )
G2(s)
150 C(s)
FTLA(s)
180
3 4 5 6
1 10 100 1 10 1 10 1 10 1 10
f
180
MF3 180 arg( FTLA ( 1200) ) MF3 45.318
7. Simulao e Resultados
A simulao foi feita utilizando o software PSIM, conforme o esquemtico mostrado na Fig. 16,
com as especificaes descritas no tpico 5. Os resultados so apresentados a seguir.
Na Fig. 19 so mostradas as formas de onda da moduladora e portadura. Nela possvel
visualizar que a derivada da portadora menor que a derivada da moduladora, garantindo o
funcionamento adequado do chaveamento do conversor.
Vmod Vpor
1
0.8
0.6
0.4
0.2
0
0.22455 0.2246 0.22465 0.2247
Time (s)
0
0.22455 0.2246 0.22465 0.2247
Time (s)
Fig. 20 - Forma de onda da corrente na entrada.
Vc
110
105
100
95
90
85
80
0.2245 0.2246 0.2247
Time (s)
iL Iref
8
0
0.22455 0.2246 0.22465 0.2247
Time (s)
Fig. 22 - Formas de onda da corrente no indutor e referncia de corrente.
Para testar a bidirecionalidade do conversor, uma forma de onda quadrada foi adicionada na
referncia de corrente, a qual condiciona a mudana do sentido da corrente no indutor. Na Fig. 23,
nota-se a corrente de entrada com formato contnuo em regime permanente e seguindo a referncia
que proporcionado pela referncia de onda quadrada na corrente.
i1
4
-2
-4
0.1 0.2 0.3 0.4
Time (s)
Fig. 23 - Forma de onda da corrente na entrada operando com bidirecionalidade.
A Fig. 24 mostra a tenso de sada do filtro e percebe-se a presena de picos (de at 112 V)
na transio de mudana no sentido da corrente no indutor. Esta caracterstica considerada
intrseca utilizao do filtro de entrada LC, sendo ela uma de suas principais desvantagens.
Vc
120
110
100
90
80
0.1 0.2 0.3 0.4
Time (s)
Fig. 24 - Forma de onda da tenso de sada do filtro com bidirecionalidade.
-5
Por fim, nas Figs. 26, 27 e 28 so mostradas, respectivamente, as formas de onda da tenso
de sada do filtro, corrente de entrada e corrente no indutor durante a inverso da referncia de
corrente no indutor de positiva para negativa. Da mesma forma,nas Figs. 29, 30 e 31,
respectivamente, a inverso da referncia de corrente no indutor de negativa para positiva.
Vc
115
110
105
100
95
90
0.245 0.25 0.255 0.26 0.265
Time (s)
Fig. 26 - Forma de onda da tenso de sada do filtro durante a transio da corrente no indutor de positiva ->
negativa.
i1
-5
10
-5
-10
-15
0.25 0.255 0.26 0.265
Time (s)
Fig. 28 - Forma de onda da corrente no indutor durante a transio da corrente no indutor de positiva ->
negativa.
Vc
115
110
105
100
95
90
85
80
0.295 0.3 0.305 0.31 0.315
Time (s)
Fig. 29 - Forma de onda da tenso na sada do filtro durante a transio da corrente no indutor de negativa ->
positiva.
i1
-5
10
-5
-10
-15
0.295 0.3 0.305 0.31 0.315
Time (s)
Fig. 31 - Forma de onda da corrente no indutor durante a transio da corrente no indutor de negativa ->
positiva.
8. Concluso
A tcnica utilizada aplicando espao de estado e ponderando as variveis de estado sobre um
perodo de chaveamento revela-se uma ferramenta muito conveniente por agregar facilidade e
velocidade ao processo de transformao de um circuito no linear em um equivalente linear.
Dessa forma, a anlise dos parmetros de projeto e do controle tornam-se mais simplificado
contrinuindo para a obteno de resultados bastante satisfatrios. Pode-se verificar esta concluso
diante da utilizao de um controlador relativamente simples (proporcional integral) para regular uma
funo de transferncia de 3 ordem.
Referncias
[1] BARBI, Ivo. Notas de Aula 1 e 2 - Prof. Ivo Barbi. FLORIANPOLIS: Do Autor, 11 e 13 de maro,
2014. 23p.
[2] BARBI, Ivo; MARTINS, Denizar Cruz. Eletrnica de potncia. 4.ed. FLORIANPOLIS: Dos Autores,
2011. 377p.
[3] BARBI, Ivo. Eletrnica de potncia. 2. ed. FLORIANPOLIS: Do Autor, 2007. 334p.
UNIVERSIDADE FEDERAL DE SANTA CATARINA
Sumrio
1. INTRODUO ........................................................................................................................ 2
4. MODELAGEM DO CONVERSOR............................................................................................ 17
5. CONCLUSO ........................................................................................................................ 28
2
1. Introduo
O conversor Flying Capacitor, Interleaved de 3 Nveis com 3 Braos (m=3), que neste
trabalho ser identificado como Conversor 06, ser estudado como sendo uma combinao dos
conversores Flying Capacitor de trs nveis e o conversor Interleaved m=3.
A tabela da Figura 1 mostra cada um dos conversores citados com as suas respectivas
regies de operao. Observa-se que o nmero de regies de operao do conversor 6 igual ao
mltiplos do nmero de regies de operao dos outros dois conversores citados.
A partir dos sinais do comando apresentados para o conversor 6 possvel fazer a anlise
das etapas de operao.
O ganho esttico pode ser encontrado analisando a tenso em uma das indutncias do
conversor. Como cada indutncia est conectada diretamente em um nico brao do conversor,
determina-se a tenso na indutncia analisando o circuito para apenas um nico brao, ou seja,
exatamente igual ao conversor Flying Capacitor de 3 nveis. Alm disso, observando a atuao
5
dos interruptores que esto associados ao primeiro brao (S1, S2, S11 e S22), conclui-se que
haver duas regies de operao, uma para 0 D 0,5 e outra para 0,5 D 1. Alm disso,
devido a simetria nos tempos de comutao entre os interruptores do mesmo brao, conclui-se
que a tenso no capacitor associado ao brao tem a metade da tenso de entrada V1.
Observando a forma de onda da tenso VLa e sabendo que seu valor mdio zero,
encontra-se o ganho esttico:
* - /20 12 = / *- 10 22 3-1
+, ,
A tenso VLa dada pela equao 3-3 no perodo DT e no perodo (0,5 D)T dada pela
equao 3-4.
/A6 = /2 3-3
+,
-
/A6 = /2 3-4
6
/A6 = A = /2 3-5
BCDE +,
BF -
/A6 = A = /2 3-6
HE +,
IJ -
MN
* P+-0.I
KL = O
Q.R
3-7
Sendo:
/2 = 1/1 3-8
KL = 3-9
W,P-IXI.+,
-.R.Q
+,
-.R.Q
Separando o termo da equao 3-9 chega-se a equao da ondulao da corrente no
indutor parametrizada:
[[[[[[
K_6 = W1 21X1 3-10
0.25
0.225
0.2
0.175
0.15
) 0.125
0.1
0.075
0.05
0.025
0
0 0.1 0.2 0.3 0.4 0.5 0.6 0.7 0.8 0.9 1
/A6 = A = /2 3-11
BCDE +,
BF -
/A6 = A = /2 3-12
HE +,
N
*IP 0J -
O
KL =
W+,P-.+-X.W,PIX
3-13
-.Q.R
Sendo:
/2 = 1/1 3-14
KL = 3-15
W,P-IXW,PIX.+,
-.R.Q
+,
-.R.Q
Separando o termo da equao 3-15 chega-se a equao da ondulao da corrente no
indutor parametrizada:
[[[[[[
K_6 = W1 21XW1 1X 3-16
0.25
0.225
0.2
0.175
0.15
) 0.125
0.1
0.075
0.05
0.025
0
0 0.1 0.2 0.3 0.4 0.5 0.6 0.7 0.8 0.9 1
As curvas de cada regio de operao pode ento ser representadas em um nico grfico
como mostrado na Figura 10.
0.25
0.225
0.2
0.175
0.15
0.125
0.1
0.075
0.05
0.025
0
0 0.1 0.2 0.3 0.4 0.5 0.6 0.7 0.8 0.9 1
0 d 1
A corrente K2 composta pela soma das correntes em cada indutor que esto defasadas
entre si de 1200. A Figura 11 mostra o comportamento da corrente K2 para a regio de operao
0 < D < 1/6. Observa-se que a freqncia da corrente K2 o trs vezes maior que a freqncia da
10
corrente em cada indutncia, resultado da combinao dos trs braos, e seis vezes maior que a
freqncia de chaveamento, favorecendo assim, o dimensionamento dos indutores de sada.
g - /2 = A BF
+, BCL
e
/2 = A BF j 3-17
BCh
f
e /2 = A BCi
d BF
3. /2 = A 3-18
+, BWCLlChlCiX
- BF
Sabendo que:
Ento:
3. /2 = A 3-20
+, BC-
- BF
3. /2 = A 3-21
+, H-
- F
No perodo analisado, < = 12, assim pode-se encontrar a expresso para K2:
K2 = 3-22
W+,Pp+-X.I
-.Q.R
K2 = 3-23
W,PpIX.I.+,
-.Q.R
K2 = W1 61X. 1 3-24
0.25
0.225
0.2
0.175
0.15
) 0.125
0.1
0.075
0.05
0.025
0
0 0.1 0.2 0.3 0.4 0.5 0.6 0.7 0.8 0.9 1
0.25
0.225
0.2
0.175
0.15
0.125
0.1
0.075
0.05
0.025
Observa-se
se que a ondulao da corrente de sada reduz proporcionalmente ao nmero de regies
de operao.
0.25 0.25
0.225 0.225
0.2 0.2
0.175 0.175
0.15 0.15
0.125 0.125
0.1 0.1
0.075 0.075
0.05 0.05
0.025 0.025
0 0
0 0.1 0.2 0.3 0.4 0.5 0.6 0.7 0.8 0.9 1 0 0.1 0.2 0.3 0.4 0.5 0.6 0.7 0.8 0.9 1
d d
0.25
0.25
0.225
0.225
0.2 0.2
0.175 0.175
0.15 0.15
0.125
0.125
0.1
0.1
0.075
0.075
0.05
0.05
0.025
0.025
0
0 0.1 0.2 0.3 0.4 0.5 0.6 0.7 0.8 0.9 1
0
A corrente de entrada est associada aos intervalos de conduo dos interruptores S1, S3 e S5
conforme pode ser observado
bservado no circuito da Figura 16. Estes interruptores operam em trs
regies distintas 0 1 , 1 1 1. Portanto, a anlise da corrente de
, , - -
q q q q
e
Regio de operao: 0 1 q,
,
K;1 = K6 =
H-
q
no intervalo de conduo de S1
A expresso para o clculo do valor eficaz da corrente K1,, pode ser escrita como:
-
K1rR = sJ tu * qO 0 o< 3-25
25
q IJ H
Regio de operao: q 1 q,
, -
Nesta regio ocorre um intervalo de tempo onde dois interruptores associados a corrente de
entrada esto em conduo, portanto a corrente de entrada K1 = 2
H-
q
e um outro intervalo onde
apenas um interruptor est em conduo, sendo ento, K1 =
H-
q
.
15
1 1,
-
q
Regio de operao:
Observa-se
se que haver corrente no capacitor somente se a chave S1 estiver em conduo
ou somente see a chaves S2 estiver conduzindo, nas outras situaes onde S1 e S2 esto
conduzindo ou bloqueadas, a corrente no capacitor nula.
Dessa forma, a maior valor de corrente eficaz no capacitor ocorrer para D = 0,5, pois
quando ocorre a maior durao no intervalo
intervalo com apenas uma das chaves em conduo.
KvrR = 3-27
HH-
q
4. Modelagem do conversor
Define-se
se ento a tenso Va dentro de um perodo de chaveamento considerando os
estados topolgicos.
/6 = 1 +1 = 1. /1 4-1
1
+, +,
- -
K2 = K6 + Kn + K?
K6 = Kn = K?, portanto:
Lembrando que em termos de valores mdios
mdios, e que
K6 = 4-2
H-
q
A funo transferncia para o controle da corrente K6 ser definida pela equao 3-28
3 que
obtida a partir do circuito equivalente
equivalent encontrado. .
/1. o + zA6 + >6. W{A + 2. {X + /2 = 0 4-3
Ou ainda:
/1. ~1 + o| WK6 + }6
X. W{A + 2. {X /2 = A BF 4-7
X
BWHLlL
= 4-10
10
HLWX +,
IWX WQl-.X
QlWQ
Observa-se
se pelo circuito do conversor, que a carga de cada capacitor controlada por apenas
um par de chaves, se for considerado o primeiro brao do conversor, pode-se
pode se definir as chaves
S1 e S2 como instrumentos de controle da tenso no capacitor 1.
Mas:
K;1 = 1, K6 4-12
12
K;2 = 1- K6 4-13
13
Ento:
K? = 1, K6 1- K6 4-14
14
importante lembrar, que embora deseje controlar duas variveis (K6 : /?1 1), inicialmente se
tem apenas uma varivel de controle que a razo cclica D. Como estratgia de controle, ser
Sendo:
21
1= 4-15
+B
+
Sendo / o sinal de controle da tenso no capacitor, ento a corrente no capacitor pode ser
expressa como:
K? = W/9o + zXK6 W/9o zXK6 4-19
>? = 2. z. K6 4-20
E ainda:
= 2. z. K6 4-21
B+i
BF
Ou ainda:
= 4-23
+WX -.HL
+WX v
corrente K6, ento a funo de transferncia para controle da tenso no capacitor fica definida
Por uma questo de controle e a bidirecionalidade do conversor, ser adotado o mdulo da
como:
= 4-24
+WX -.|HL|
+WX v
Por fim, a figura seguinte mostra o diagrama com a estratgia de controle adotada para um
brao. Para os outros dois braos necessrio apenas replicar os componentes com as
portadoras defasadas de +1200 e -1200.
22
H
Observa-see que a corrente de referencia equivale a O , uma vez que a corrente de sada
q
composta pela soma das correntes em cada um dos trs indutores.
23
A corrente de entrada mostrada para trs regies da razo cclica (0 1/3), (1/3 2/3) e
(2/3 1).
A Figura 34 mostra os sinais de comando para uma razo cclica inferior 1/3, as correntes
em cada indutor e a corrente de sada. fcil observar que a corrente de sada composta pela
soma das correntes dos indutores.
O sinal de comando para o interruptor S1, a sua portadora e o seu sinal de controle esto
apresentados na Figura 36.
Para testar a malha de controle da tenso nos capacitores, o conversor foi simulado com
tenses iniciais desequilibradas para os capacitores. Observa-se na Figura 37 que ocorreu o
equilbrio destas tenses indicando um bom desempenho da estratgia de controle para a tenso.
26
=D 4-25
HLWX +,
IWX l
WDO.X
Com base nos resultados encontrados por simulao, sugere-se que a funo de
transferncia para controle da corrente de sada, atravs de um nico controlador de corrente,
seja obtida considerando a presena dos capacitores no modelo e no como dois sistemas
desacoplados como inicialmente adotado.
28
5. Concluso
Parmetros definidos:
IL := 1 A V := 0.005 %
I2 := 10 A
fs := 20000 Hz
R L := 0.1
Vo := 1000 V
R s := 0.05
Vi := 2000 V
______________________________________________________________________________
Vi V
Vc :=
2
Vc = 5 V
I2 D
C :=
3fs Vc
5
C = 1.667 10 F
IC = 3.333 A
3
L = 2.083 10 H
_________________________________________________________________________________
f := 1 , 10 .. 10000
j := 1
s( f ) := j 2 f
Leq := L
(
R eq := RL + 2 Rs )
Vi
G( f ) := Funo de transferencia para controle da corrente no
s( f ) Leq + Req indutor
Req
p :=
Leq
p
fp :=
2
60
Gmod( f ) 40
20
0
3 4
1 10 100 110 1 10
f
________________________________________________________________________________
Controlador da corrente no indutor por brao IL(S)/D(S)
D
Kp_max := 2.Vp
IL
fs
fc :=
8
3
fc = 2.5 10 frequencia mxima de cruzamento por zero
fc
fz := frequencia do zero do compensador definida em 30 vezes
30 menor que a frequencia de cruzamento. Este valor
proporcionou uma boa margem de fase.
GfcdB := Gmod fc ( )
GsdB := 20 log
1
Vp
GsdB = 0 em dB
(
GsensordB := 20 log Gsensor )
GsensordB = 0 em dB
20
Kp := 10
Ki := fz Kp 2
Ki = 8.568 ganho Ki
1
:=
Ki
constante de tempo integradora
= 0.117
Ki
C ( f ) := Kp + funo transferencia do controlador P+I
s( f )
C mod( f ) := 20 log ( C ( f ) )
FTMA( f ) := G( f ) C ( f )
FTMAdB( f ) := 20 log( FTMA( f ) )
100
FTMAdB( f )
100
3 4
1 10 100 1 10 1 10
f
GFTMA.fc := FTMAdB fc ( )
3
GFTMA.fc = 4.823 10 Ganho em MA na frequencia de cruzamento
(2,5 kHz) aproximadamente zero
100
120
180
arg( FTMA ( f ) )
140
160
180
3 4
1 10 100 1 10 110
f
_______________________________________________________________________________
Modelo da planta para controle da tenso no capacitor:
Lembrando que:
6
C := 50 10 F
2
G2 ( f ) :=
s( f ) C funo de transferencia da planta para controle da tenso
(
Gmod2( f ) := 20 log G2 ( f ) )
1
Gs :=
Vp
GsdB := 20 log
1
Vp
GsdB = 0 em dB
(
GsensordB := 20 log Gsensor )
GsensordB = 40 em dB
______________________________________________________________________________
Determinao do ganho do compensador para atingir a fc no ponto especificado:
Pela caracterstica da planta de tenso, supem-se que um ganho ser suficinte para controlar a
tenso
20
C fc2 := 10
C fc2 = 0.393
(
C mod2( f ) := 20 log C2 ( f ) )
FTMA2 ( f ) := G2 ( f ) C2 ( f ) Gsensor
100
50
FTMAdB2( f ) 0
50
100
3 4
1 10 100 1 10 110
f
NDICE
1 INTRODUO ....................................................................................................................................................... 3
2
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Conversores Estticos cc-cc Bidirecionais
1 INTRODUO
Os atuais desafios na transmisso de energia exigem solues tcnicas flexveis e eficazes.
Os sistemas de transmisso em corrente contnua em alta tenso (HVDC) representam uma soluo
bastante atrativa para transmisso de grandes quantidades de energia por longas distncias. Sistemas
HVDC tambm so bastante aplicados em interligao de redes de energia de corrente alternada
incompatveis (redes eltricas assncronas ou de frequncias diferentes).
Conversores cc-cc so utilizados neste tipo de sistema para o controle do fluxo de potncia e
adequao dos nveis de tenso entre sistemas de transmisso e distribuio em corrente contnua ou
entre dois sistemas de transmisso ou de distribuio. Uma vez que sistemas HVDC so aplicados
para os mais variados nveis de tenso e requerem elevados nveis de potncia processada, os
conversores cc-cc em muitas vezes so submetidos a elevados nveis de tenso e corrente e, por
isso, devem ter a capacidade de operar com elevada tenso na entrada e/ou sada do conversor. Em
muitas aplicaes tambm requerido a bidirecionalidade do fluxo de potncia.
Para este tipo de aplicao, os conversores cc-cc clssicos no so capazes de atender as
exigncias citadas acima devido as suas limitaes em relao aos nveis de tenso envolvidos e a
potncia processada pelo conversor. Neste contexto, este trabalho apresenta uma proposta de um
conversor cc-cc bidirecional para aplicaes em altas tenses e altas correntes. O conversor cc-cc
bidirecional Buck+Boost Flying Capacitor Interleaved estudado neste trabalho derivado da
topologia de trs nveis mostrada na Figura 1 j estudada na literatura.
L1 D33
D1
S1 S33
S11 S3
C1 D11 D3 C3
V1 V2
S22 S4
C2 D22 D4 C4
D2 D44
S2 S44
Representando a topologia do conversor cc-cc de trs nveis de outra maneira, como mostra
a Figura 2 (a), possvel verificar que os capacitores C2 e C4 so redundantes e podem ser retirados
da topologia, uma vez que a tenso nos capacitores C1 e C3 podem ser controladas e ficam
submetidos a nveis de tenso de V1/2 e V2/2, respectivamente. A Figura 2 (b) mostra a topologia do
3
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S1 S33 S1 S33
D1 D33 D1 D33
L1 L1
C1 C3 C1 C3
S11 S3 S11 S3
D11 D3 D11 D3
V1 V2 V1 V2
S22 S4 S22 S4
D22 D4 D22 D4
C2 C4
(a) (b)
Figura 2 Topologia do conversor cc-cc de trs nveis: (a) Completa; (b) Sem capacitor redundante.
S2 S44
D2 D44
S1 S33
D1 D33
L1
V1 C1 C3 V2
S11 S3
D11 D3
S22 D4 S4
D22
4
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Porm, para aplicaes que requerem elevados nveis de corrente este conversor no
representa uma soluo atrativa, uma vez que os interruptores devem ter a capacidade de conduzir
toda a corrente de carga. Neste contexto, este trabalho tem por objetivo a proposta e o estudo de
uma topologia de conversor cc-cc bidirecional multinvel para aplicaes em elevadas correntes. A
Figura 4 apresenta a topologia do conversor cc-cc Buck+Boost Flying Capacitor Interleaved, a qual
apresenta como vantagens:
- a reduo da tenso aplicada aos interruptores (metade da tenso da fonte);
- a distribuio de corrente entre os interruptores, reduzindo assim as perdas por conduo;
- as tenses de sada de cada brao podem assumir trs nveis de tenso distintos
dependendo da regio de operao;
- e a frequncia da corrente total (corrente virtual que representa a soma das correntes nos
indutores La e Lb) quatro vezes superior frequncia de comutao dos interruptores, sendo a
frequncia de operao dos indutores individuais o dobro da frequncia de comutao dos
interruptores, permitindo reduzir o peso e volume dos elementos magnticos.
S1 S3 S66 S77
D1 D3 D66 D77
S2 S4 S55 S88
D2 D4 D55 D88
La
va1 vb1
V1 C1 C2 Lb C3 C4 V2
va2 vb2
S22 S44 S5 S8
D22 D44 D5 D8
S11 S33 S6 S7
D11 D33 D6 D7
5
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+
vmod1
vmod + S1
vp1
vp1 S11
t +_
vmod2
S2
vp2
vp2 S22
t vmod3
+
vp3 + S3
vp3 S33
t
vmod4
+_
vp4 S4
t vx vp4 S44
Ts/2 Ts 2Ts
Figura 5 Estratgia de modulao escolhida: (a) Disposio das portadoras; (b) Circuito de comando do conversor.
6
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Regio de Operao Razo Cclica Nveis de Tenso va1 e va2 Nveis de Tenso vb1 e vb2
1 0 < D < 1/4 0 V1/2 V2 V2/2
2 1/4 < D < 1/2 0 V1/2 V2 V2/2
3 1/2 < D < 3/4 V1/2 V1 V2/2 0
4 3/4 < D < 1 V1/2 V1 V2/2 0
7
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V1 C1 C2 Lb C3 C4 V2 V1 C1 C2 Lb C3 C4 V2
V1 C1 C2 Lb C3 C4 V2 V1 C1 C2 Lb C3 C4 V2
V1 C1 C2 Lb C3 C4 V2 V1 C1 C2 Lb C3 C4 V2
V1 C1 C2 Lb C3 C4 V2 V1 C1 C2 Lb C3 C4 V2
8
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V1 C1 C2 Lb C3 C4 V2 V1 C1 C2 Lb C3 C4 V2
V1 C1 C2 Lb C3 C4 V2 V1 C1 C2 Lb C3 C4 V2
(k) Dcimo primeiro estado topolgico. (l) Dcimo segundo estado topolgico.
V1 C1 C2 Lb C3 C4 V2 V1 C1 C2 Lb C3 C4 V2
(m) Dcimo terceiro estado topolgico. (n) Dcimo quarto estado topolgico.
9
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que representa a soma das corrente nos indutores La e Lb, como mencionado anteriormente.
S1 S1
t1 t2 t3 t4
S2 S2
S3 S3
S4 S4
iLb iLb
D iL D iL
iLa,iLb iLa,iLb
iLa iLa
iT D iT iT D iT
V2 V2
iC1,iC3 iLmed iLmed
iC1,iC3
-iLmed -iLmed
iC2,iC4 iLmed iLmed
iC2,iC4
-iLmed -iLmed
V1/2 V1/2
va1 va1
V2 V2
vb1 V2/2
vb1 V2/2
Estados 1 14 2 14 3 14 4 14 Estados 5 1 6 2 7 3 8 4
S1 S1
t5 t6 t7 t8
S2 S2
S3 S3
S4 S4
iLb iLb
D iL D iL
iLa,iLb iLa,iLb
iLa iLa
iT D iT iT D iT
V1 V1
vLa vLa
(V2 V1)/2 (V2 V1)/2
iLmed iLmed
iC1,iC3 iC1,iC3
-iLmed -iLmed
iLmed iLmed
iC2,iC4 iC2,iC4
-iLmed -iLmed
V1 V1
va1 V1/2 va1 V1/2
Estados 9 5 10 6 11 7 12 8 Estados 13 9 13 10 13 11 13 12
10
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DT 12 DTs
2 s V1 V2
VLamed dt V2 dt 0 (1)
Ts 0 2
0
Calculando as integrais na equao (1), obtm-se:
V1 V2 1
2 D Ts V2 2 D Ts (2)
Finalmente, o ganho esttico obtido simplificando a equao (2).
V2 D
G (3)
V1 1 D
O ganho esttico encontrado na equao (3) vlido para todas as regies de operao. O
mesmo procedimento pode ser feito para todas as regies utilizando os valores de tenso no indutor
e os intervalos de tempo correspondentes com a regio escolhida para o clculo.
11
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diferena entre os sinais moduladores ser utilizada para controlar a corrente no capacitor e,
consequentemente, exercer o controle das tenses nos capacitores (o controle dessas tenses ser
detalhado nas sees seguintes).
Essa explanao necessria para entender toda a anlise terica que ser desenvolvida a
seguir. Para facilitar a anlise considerado que a tenso de pico das portadoras igual a 1. Logo,
as razes cclicas so dadas por (4):
Vmodx
Dx Vmodx (4)
Vpx
Onde n = 1, 2, 3 ou 4. As razes cclicas tambm so descritas atravs da moduladora nica e do
sinal vx:
D1 Vmod1 Vmod Vx D Vx
D V
2 mod 2 Vmod Vx D Vx
(5)
D3 Vmod3 Vmod Vx D Vx
D4 Vmod 4 Vmod Vx D Vx
Desta forma, possvel calcular a tenso mdia na sada de cada brao. Para isso,
analisada a regio de operao 1 (0 < D < 1/4). A tenso mdia na sada do brao correspondente
aos interruptores S1 e S2 dada por (6):
1 1 s V1
DT D2Ts
V
va1 dt 1 dt (6)
Ts 0 2 0
2
Resolvendo a equao (6), tem-se:
V1
D1 D2
va1 (7)
2
Substituindo a equao (5) em (7), obtm-se o valor mdio da tenso va1:
D T 1
D1 Ts
2
1
D2 Ts
2
1 V2
1 s D2Ts
V2
vb1 dt V2 dt dt V2 dt (9)
Ts 0 2 0 0 2 0
Resolvendo a equao (9), tem-se:
V2
2 D1 D2
vb1 (10)
2
Substituindo a equao (5) em (10), obtm-se o valor mdio da tenso vb1:
12
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Por analogia, os valores mdios das tenses va2 e vb2 (correspondentes aos braos
constitudos pelos interruptores S3/S4 e S7/S8, respectivamente) so iguais aos valores mdios das
tenses va1 e vb1, respectivamente.
va 2 va1 V1 D
(12)
vb 2 vb1 V2 (1 D)
Portanto, pode-se concluir que os valores mdios das tenses de sada de cada brao do
conversor em estudo so imunes ao valor do sinal vx presente no circuito do modulador,
dependendo apenas da razo cclica D. Com isso, a tenso de sada de cada brao controlada
apenas pela razo cclica D.
iS1 iLa D1
(14)
iS 2 iLa D2
Com isso, substituindo (14) em (13), tem-se:
iS1
S1
iC1
S2
iS2
13
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Com isso, pode-se concluir que o sinal modulador no modifica o valor mdio da corrente
nos capacitores, dependo apenas da grandeza do sinal vx. Portanto, atravs do sinal vx possvel
controlar a corrente nos capacitores e, consequentemente, realizar o controle da tenso nos
capacitores C1, C2, C3 e C4.
_ _ _
+ + +
+ _
VLb V2
Figura 9 Circuito equivalente correspondente ao intervalo t1 da regio de operao 1.
As tenses nos capacitores VC1, VC2, VC3 e VC4 quando o conversor opera em regime
permanente so dadas por (17) e (18):
V1
VC1 VC 2 (17)
2
V2
VC 3 VC 4 (18)
2
Portanto, analisando a Figura 9, as tenses nos indutores La e Lb so dadas por (19) e (20):
V1 V2 Di
vLa La La (19)
2 Dt
14
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DiLb
vLb V2 Lb (20)
Dt
Considerando que as indutncias La e Lb so iguais e somando as equaes (19) e (20), tem-
se:
V1 3 V2 D(i i )
vLa vLb L La Lb (21)
2 Dt
Onde t = DTs. Sabendo que a corrente total iT corresponde a soma das correntes iLa e iLb e
substituindo (3) em (21), a ondulao de corrente total iT dada por (22):
D (1 4 D) V1
DiT (22)
2 (1 D) L f s
Com o objetivo expressar a ondulao de corrente total em funo da soma das tenses de
entrada e sada, realizada uma manipulao algbrica onde a tenso de entrada V1 pode ser
descrita como:
V1 (V1 V2 ) (1 D) (23)
Finalmente, substituindo (23) em (22), obtm-se a ondulao de corrente total.
V1 V2
DiT D (1 4 D) (24)
2 L fs
_ _ _
+ + +
Portanto, analisando a Figura 10, as tenses nos indutores La e Lb so dadas por (25) e (26):
V1 V2 Di
vLa La La (25)
2 Dt
V1 V2 Di
vLb Lb Lb (26)
2 Dt
15
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DiT
vLa vLb V1 V2 L (27)
Dt
Onde t = (4D 1)Ts/4. Substituindo (3) em (27) e realizando as devidas simplificaes, a
ondulao de corrente total iT dada por (28):
V1 V2
DiT (1 2 D) (4 D 1) (28)
4 L fs
_
+
V1 VLa
+ _ +
_ + _
Analisando a Figura 10, as tenses nos indutores La e Lb so dadas por (25) e (26):
DiLa
vLa V1 La (29)
Dt
V1 V2 Di
vLb
Lb Lb (30)
2 Dt
Somando as equaes (29) e (30), tem-se:
3 V1 V2 Di
vLa vLb L T (31)
2 Dt
Onde t = (2D 1)Ts/2. Substituindo (3) em (31) e realizando as devidas simplificaes, a
ondulao de corrente total iT dada por (32):
V1 V2
DiT (3 4 D) (2 D 1) (32)
4 L fs
16
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_
+
V1 VLa
_
+
V1 VLb
Analisando a Figura 12, as tenses nos indutores La e Lb so dadas por (25) e (26):
DiLa
vLa V1 La (33)
Dt
DiLb
vLb V1 Lb (34)
Dt
Somando as equaes (33) e (34), tem-se:
DiT
vLa vLb 2 V1 L (35)
Dt
Onde t = (4D 3)Ts/4. Substituindo (23) em (35) e realizando as devidas simplificaes, a
ondulao de corrente total iT dada por (36):
V1 V2
DiT (4 D 3) (1 D) (36)
2 L fs
Parametrizando as equaes relativas as ondulaes de corrente total de todas as regies em
relao a (V1+V2)/L.fs, ou seja, DiT = L.iT.fs / (V1+V2), obtm-se a ondulao de corrente
parametrizada para cada regio de operao.
D (1 4 D) 1
, 0 D
2 4
(1 2 D) (4 D 1) , 1 D 1
4 4 2
DiT (37)
(3 4 D) (2 D 1) , 1 D 3
4 2 4
(4 D 3) (1 D) 3
, D 1
2 4
A Figura 13 mostra um comparativo da ondulao de corrente parametrizada entre os
conversores Buck+Boost clssico, 3L-Flying Capacitor e 3L-Flying Capacitor Interleaved. Com o
aumento do nmero de nveis, o conversor 3L-Flying Capacitor consegue reduzir em quatro vezes a
ondulao mxima de corrente parametrizada em relao ao conversor Buck+Boost clssico. A
17
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0,30
Buck+Boost Clssico
0,25
0,20
0,15
3L-Flying 3L-Flying Capacitor
Capacitor Interleaved
0,10
0,05
0
0 1/8 1/4 3/8 1/2 5/8 3/4 7/8 1
Razo cclica - D
Figura 13 Ondulao de corrente parametrizada para os conversores Buck+boost clssico, 3L-Flying Capacitor e 3L-
Flying Capacitor Interleaved.
Tabela 3 Razo cclica para que determina a mxima ondulao de corrente iT para cada regio de operao.
V1 V2
L (38)
32 DiT f s
18
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iLmed D
DvC1,2 (40)
C1,2 f s
iLmed D
DvC 3,4 (41)
C3,4 f s
Analisando as formas de onda da corrente nos capacitores para esta regio, Figura 7 (a), por
exemplo, o valor eficaz da corrente pode ser descrito como:
DTs
2
i dt
2
iC1ef Lmed (42)
Ts 0
19
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Para esta regio, analisando as formas de onda da corrente nos capacitores, Figura 7 (c), por
exemplo, o valor eficaz da corrente pode ser descrito como:
(1 D )Ts
2
iC1ef
Ts
0
iLmed 2 dt (46)
Parametrizando as equaes (40) e (44) em funo de iLmed/C.fs, ou seja, DvC = C.vC.fs / iLmed,
obtm-se a ondulao de tenso parametrizada para as duas regies de operao. A Figura 14
mostra a variao da ondulao de tenso nos capacitores em funo da razo cclica.
1
D, 0 D 2
DvC (48)
1 D, 1 D 1
2
Ondulao de tenso parametrizada - vC (D)
0,60
0,50
0,40
0,30
0,20
0,10
0
0 0,25 0,5 0,75 1
Razo cclica - D
20
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Embora este conversor possa operar teoricamente com ganho de 0 < G < , pode-se
demonstrar que ele tem um desempenho timo quando G = 1, ou seja, D = 0,5. Por isso, esta
topologia bastante atrativa quando o conversor opera entre as regies 2 e 3.
S1 S1
t1 t2 t3 t4
S2 S2
S3 S3
S4 S4
2iLmed
i1 iLmed i1 iLmed
2iLmed 2iLmed
i2 iLmed i2 iLmed
S1 S1
t5 t6 t7 t8
S2 S2
S3 S3
S4 S4
2iLmed
i1 iLmed i1 iLmed
2iLmed
i2 iLmed i2 iLmed
21
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_ _ _ _
+ + + +
VC1 La Ra VC3 La Ra
V1 V2
iLa iLa
(a) Intervalo de tempo (0, D1Ts). (b) Intervalo de tempo ( D1Ts, Ts/2).
V1 di V
La La Ra iLa 2 (49)
2 dt 2
diLa
0 La
Ra iLa V2 (50)
dt
Multiplicando toda a equao (49) por D e a equao (50) por (1/2 D), tem-se:
V1 di V
D D La La D Ra iLa D 2 (51)
2 dt 2
1 di 1 1
0 D La La D Ra iLa D V2 (52)
2 dt 2 2
Somando as equaes (51) e (52), obtm-se a equao que representa o circuito equivalente
para valores mdios quase instantneos em relao a indutncia La.
diLa
D V1 La
Ra iLa (1 D) V2 (53)
dt
Realizando o mesmo procedimento para encontrar a equao que representa o circuito
equivalente para valores mdios quase instantneos em relao a indutncia Lb e somando os
resultados, obtm-se:
L d (iLa iLb ) R
D V1 (1 D) V2
(iLa iLb ) (54)
2 dt 2
Sabendo que iT = iLa + iLb e que La = Lb = L e substituindo na equao (54), tem-se:
diT
D V1 (1 D) V2 Leq
Req iT (55)
dt
A Figura 17 mostra o circuito equivalente do conversor em estudo para modelo de valores
mdios quase instantneos, onde Leq = La/2 = Lb/2 e Req = Ra/2 = Rb/2 = (4Rs + RL)/2.
22
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iT iT
La Ra
Leq Req
DV1 Lb Rb (1 D)V2 DV1 (1 D)V2
iT (s) V1 V2
(57)
d (s) s Leq Req
Ts/4 Ts/2 Ts
S1
S2
S3
S4
iT DiT
Vp1
vmod
vport1
t
23
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K p DiT Vp1
(58)
Dt Ts
Onde t = (1/2 D)Ts. Substituindo t na equao (58) e considerando a razo cclica que
proporciona a mxima ondulao de corrente total para a regio 2 (D = 3/8), o valor do ganho
proporcional do controlador de corrente dado por:
V p1
Kp (59)
8 DiT
dvC1
iC1 C1 2 I La vx (60)
dt
Perturbando, linearizando e aplicando a transformada de Laplace na equao (60), obtm-se:
2 I La
vC1 (s) vx (s) (61)
s C1
Este procedimento realizado para os capacitores C2, C3 e C4 e sabendo que IT = 2.ILa, as
funes de transferncia para o controle das tenses nos capacitores so mostradas em :
vC1 (s) IT
v (s) s C
x 1
vC 2 (s) IT
v (s) s C
x 2
(62)
v (s)
C3 T I
vx (s) s C3
vC 4 (s) IT
vx (s) s C4
24
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3 EXEMPLO DE PROJETO
Neste captulo apresentado um exemplo de projeto para o conversor cc-cc bidirecional
Buck+Boost Flying Capacitor Interleaved. De acordo com as especificaes pr-determinadas,
realizado o dimensionamento dos principais componentes do circuito de potncia do conversor e o
projeto dos controladores de corrente e tenso nos capacitores.
3.1 Especificaes
A partir das especificaes de projeto apresentadas na Tabela 4 foi realizado o projeto o
conversor proposto.
Parmetros Valor
Potncia de sada P2 = 10 kW
Tenso de entrada V1 = 1000 V
Tenso de sada V2 = 750 V
Corrente nos indutores IL = 10 A
Frequncia de comutao fs = 20 kHz
Com isso, de acordo com as especificaes de projeto conclui-se que o conversor trabalhar
na regio de operao 2. Atravs da equao do ganho esttico do conversor possvel calcular a
razo cclica nominal.
V2
D 0, 428 (63)
V1 V2
Ts T Leq
s (68)
4 100 4 100 Req
Portanto, isolando o termo Ra na equao (68), obtm-se:
4 f s La
Ra
Ra 0,8 (69)
100
Para este projeto foi adotado um valor de resistncia igual a 0,5 .
26
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L 913,5 106
Leq 456 106 H (70)
2 2
Ra 0,5
Req 0, 25 (71)
2 2
1750
GIT (s) (72)
913,5 106 s 0, 25
100
Magnitude [dB]
50
50
100
60
0
Fase [graus]
60
120
180
3 4 5 6
1 10 100 1 10 1 10 1 10 1 10
Frequncia [Hz]
Figura 19 Diagrama de Bode da funo de transferncia de lao aberto sem compensador.
27
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Ki
GC ( s) K p (73)
s
A corrente total iT apresenta frequncia quatro vezes superior frequncia de comutao dos
interruptores, como mostra a Figura 7. Com isso, neste trabalho a frequncia de cruzamento por
zero do sistema ser igual a 1/4 da frequncia da corrente total.
fiT 4 f s
f ci
20 103 Hz (74)
4 4
A restrio para os parmetros do controlador de corrente, mostrada na seo 2.10.3, deve
ser atendida, logo, o ganho proporcional calculado atravs da equao (59).
1
Kp
K p 0,043 (75)
8 2,99
Para este trabalho adotou-se o valor do ganho proporcional Kp igual a 0,03. A frequncia do
zero fz do controlador de corrente foi alocada em 1/10 da frequncia de cruzamento por zero do sistema.
f ci
2 103 Hz fz (76)
10
Portanto, o ganho integral do controlador de corrente dado por (77). A Figura 20 mostra o
diagrama de Bode da funo de transferncia de lao aberto com compensador.
120
Magnitude [dB]
60
60
fc = 20 kHz
120
60
0
Fase [graus]
60
120
MF = 84,5
180
3 4 5 6
1 10 100 1 10 1 10 1 10 1 10
Frequncia [Hz]
28
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20
GVC ( s) (78)
60 106 s
Onde, C representa as capacitncias as C1, C2, C3 e C4. O diagrama de Bode da funo de
transferncia de lao aberto sem compensador mostrado na Figura 21.
120
90
Magnitude [dB]
60
30
30
60
60
0
Fase [graus]
60
120
180
3 4 5 6
1 10 100 1 10 1 10 1 10 1 10
Frequncia [Hz]
GC ( s) K p (79)
Para desacoplar a malha de balanceamento das tenses dos capacitores da malha interna de
controle da corrente total, adotou-se a frequncia de cruzamento da planta de tenso igual a:
29
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fs
f cv
1103 Hz (80)
20
Para este trabalho adotou-se o valor do ganho proporcional Kp igual a 0,02. Para cada um
dos capacitores utilizada uma malha de controle de tenso. O diagrama de Bode da funo de
transferncia sem compensao mostrado na Figura 22.
120
90
60
30
30
fc = 1 kHz
60
60
60
120
MF = 90
180
3 4 5 6
1 10 100 1 10 1 10 1 10 1 10
30
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4 RESULTADOS DE SIMULAO
A fim de validar toda a anlise terica e metodologia apresentada nos captulos anteriores, o
conversor cc-cc bidirecional Buck+Boost Flying Capacitor Interleaved foi simulado no software
PSIM e os resultados de simulao so apresentados neste captulo. Assim, so apresentadas
formas de onda de tenso e corrente nos principais componentes do conversor em estudo operando
em regime permanente. Alm disso, so apresentados resultados de simulao para verificar a
resposta dinmica do sistema de controle.
iT
20
15
iLa iLb
10
0
0.32536 0.32538 0.3254 0.32542 0.32544 0.32546 0.325480.3255
Tempo [s]
Figura 23 Formas de onda da corrente total iT e da corrente nos indutores iLa e iLb.
31
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A Figura 24 apresenta as formas de onda das correntes nos capacitores C1, C2, C3 e C4. As
correntes nos capacitores C1 e C3 apresentam o mesmo comportamento das correntes nos
capacitores C2 e C4, diferenciando apenas pela defasagem de 90 entre si, ocasionada pela
defasagem entre os braos do conversor.
15
iC1,3
10 iC2,4
-5
-10
-15
0.32536 0.32538 0.3254 0.32542 0.32544 0.325460.32548 0.3255
Tempo [s]
Figura 24 Formas de onda das correntes nos capacitores C1, C2, C3 e C4.
504
vC1 vC2
502
500
498
496
32
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380
378
vC3 vC4
376
374
372
370
0.32536 0.32538 0.3254 0.32542 0.32544 0.32546 0.32548 0.3255
Tempo [s]
Figura 26 Detalhe das formas de onda das tenses nos capacitores C3 e C4.
vB1
600
vA1
400
200
0
0.32536 0.3254 0.32544 0.32548
Tempo [s]
Figura 27 Formas de onda das tenses va1 e vb1 correspondentes indutncia La.
33
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800
600 vB2
vA2
400
200
0
0.32536 0.3254 0.32544 0.32548
Tempo [s]
Figura 28 Formas de onda das tenses va2 e vb2 correspondentes indutncia Lb.
A Figura 29 mostra as correntes nas fontes V1 e V2, onde pode ser observado que as formas
de onda i1 e i2 apresentam trs nveis de corrente (zero, iLmed e 2iLmed), comportamento comum
regio de operao 2. Vale ressaltar que a soma das correntes i1 e i2 sempre igual a 2iLmed e,
consequentemente, igual a corrente total iT.
24
18
i1
12
6
0
(a)
24
18
i2
12
6
0
0.84
vp1
0.56
vmod1
0.28
30
iT
20 iLref
10
0
iLa,b
-10
-20
-30
35
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A Figura 32 apresenta um teste para inverso do fluxo de potncia de positivo (da fonte V1
para a fonte V2) para negativo (da fonte V2 para a fonte V1). So mostradas as correntes nos
indutores La e Lb e a corrente total iT, onde verifica-se que a malha de corrente apresenta uma rpida
resposta dinmica com overshoot de aproximadamente 6 A.
30
iT
20
10
0
iLa,b
-10
iLref
-20
-30
A Figura 33 apresenta um teste para inverso do fluxo de potncia de negativo (da fonte V2
para a fonte V1) para positivo (da fonte V1 para a fonte V2). Para este teste, o overshoot da corrente
total apresentado de aproximadamente 5 A com um tempo de acomodao levemente superior ao
do teste anterior, porm, ainda assim apresenta tempo de acomodao inferior a 1 ms.
30
iT
iLref
20
iLa,b
10
-10
-20
-30
36
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550
vC1
vC2
500
450
vC3
400 vC4
350
300
250
0 0.02 0.04 0.06 0.08 0.1
Tempo [s]
Figura 34 Comportamento das tenses nos capacitores durante o transitrio de partida do conversor.
37
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5 CONCLUSO
Este trabalho apresentou o estudo de um conversor cc-cc bidirecional Buck+Boost
multinvel para aplicaes em altas tenses e elevadas correntes. As principais vantagens do
conversor Flying Capacitor Interleaved so a reduo da tenso aplicada aos interruptores, a
distribuio de corrente entre os semicondutores, reduzindo as perdas por conduo e a reduo do
peso e volume dos magnticos devido a frequncia de operao dos indutores serem o dobro da
frequncia de comutao dos interruptores. Portanto, a topologia explorada neste trabalho soma os
benefcios do conversor Flying Capacitor relativo a esforos de tenso nos interruptores com os
benefcios do conversor Interleaved relativo a esforos de corrente nos semicondutores.
Foi realizado o estudo detalhado da topologia proposta, onde foram desenvolvidas equaes
matemticas que podem ser utilizadas para o projeto e dimensionamento do conversor. Tambm foi
explorada uma estratgia de controle simples que realizasse as seguintes funes: controle da
corrente total (corrente virtual que representa a soma das correntes nos indutores) e equilbrio das
tenses nos capacitores flutuantes. As funes de transferncia da planta de controle de corrente e
da planta de controle das tenses nos capacitores foram modeladas, bem como o projeto dos
controladores foi realizado.
Para validar o estudo da topologia proposta foram realizadas simulaes computacionais em
regime permanente e dinmico. Atravs das simulaes foi possvel validar todos os conceitos
tericos apresentados neste trabalho. Com isso, o funcionamento do conversor foi avaliado como
satisfatrio, logo, possvel concluir que os objetivos foram alcanados, tornando esta topologia
uma alternativa interessante para aplicaes em alta tenso e elevadas correntes.
38
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6 REFERNCIAS BIBLIOGRFICAS
[1] BARBI, I. Conversores CC-CC Bidirecionais. Notas de Aula (Disciplina Tpicos Especiais
em Eletrnica de Potncia: Conversores Estticos cc-cc Bidirecionais), Programa de Ps-
Graduao em Engenharia Eltrica - Universidade Federal de Santa Catarina, Florianpolis -
SC, 2014.
[3] COSTA, L. F.; MUSSA, S. A.; BARBI, I. Steady-state analysis of a 5-level bidirectional
buck+boost dc-dc converter. In: Proc. of 39th Annual Conference of the IEEE Industrial
Electronics Society (IECON 2013), p.1290-1295, 10-13 Nov. 2013.
[4] RUAN, X.; LI, B.; CHEN, Q. Three-level converters-a new approach for high voltage and
high power dc-to-dc conversion. In: 2002 IEEE 33rd Annual Power Electronics Specialists
Conference (PESC 02). v. 2, p. 663 668 vol.2, 2002.
[5] ZHANG, Junhong. Bidirectional DC-DC Power Converter Design Optimization, Modeling
and Control. Tese (Doutorado em Engenharia Eltrica), Virginia Polytechnic Institute and
State University, Virginia - USA, 2008.
39
Instituto de Eletrnica de Potncia
Conversores Estticos cc-cc Bidirecionais
40
V g22 Vmod5 Vp5 V g55
Vmod Vmod2 Vp2 Vp1 Vp6
G22 G55
V V V V V V V
V ILref 0.03
V g2 V g5
K
G2 G5
V Vmod V
Vmod V g1 V g6
1/377
IT Vmod1 G1 G6
Vmod6
V g11 V g66
V
G11 G66
IT Sign K IT Sign K
V
Vx
0.02 0.02
K K
5 3.75
V g33 V g77
Vc1 Vmod3 Vp3 Vp4 Vc3 Vmod7 Vp7 Vp8
G33 G77
V V V V V V
Vmod V g3 Vmod V g7
G3 G7
V V
V g4 V g8
Instituto de Eletrnica de Potncia
G4 Vmod8 G8
Vmod4
V g44 V g88
G44 G88
IT Sign K IT Sign K
Conversores Estticos cc-cc Bidirecionais
0.02 0.02
K K
5 3.75
Vc2 Vc4
41
INSTITUTO DE ELETRNICA DE POTNCIA
Acadmicos:
Delvanei G. Bandeira Jr.
Gilberto Valentim Silva
Roberto Buerger
Disciplina:
EEL410139 T. A. em Eletrnica de Potncia: Conversores Estticos CC-CC
Bidirecionais
Professor:
Ivo Barbi
MAIO/2014
FIGURAS
Figura 2.8 Diagramas de Bode para a funo de transferncia que relaciona tenso no capacitor
Lf com a perturbao na razo cclica: (a) diagrama de mdulo (b) diagrama de fase. ............... 27
Figura 2.9 Diagramas de Bode do controlador da tenso no capacitor C1: (a) Diagrama do
mdulo e (b) diagrama da fase. ..................................................................................................... 28
Figura 2.10 Diagrama de Bode da funo de transferncia de lao aberto compensada: (a)
Diagrama de mdulo, (b) Diagrama de fase. ................................................................................ 28
Figura 2.11 Diagrama de blocos do controlador da corrente na indutncia Lf. ............................ 29
Figura 2.12 Diagrama de blocos para implementao do controle da tenso no conversor CC-CC
multinvel modular. ....................................................................................................................... 30
Figura 2.13 Diagrama de blocos completo para o controle da do conversor CC-CC bidirecional
multinvel. ..................................................................................................................................... 31
Figura 3.1 Supercapacitor Maxwell. ............................................................................................. 32
Figura 3.2 Diagrama do conversor CC-CC bidirecional multinvel com trs mdulos composto
por supercapacitores. ..................................................................................................................... 33
Figura 3.3 Corrente submetida a variao na referncia da malha de controle, demonstrando a
inverso do fluxo de potncia........................................................................................................ 33
Figura 3.4: Corrente , corrente de referncia e razo cclica . ........................................ 34
Figura 3.5: Ondulaa da corrente ............................................................................................ 34
Figura 3.6: Comparao dos sinais de portadoras e a moduladora ............................................... 34
Figura 3.7: Formas de onda durante a descarga dos SCs, para atingir o equilbrio ...................... 35
Figura 3.8: Formas de onda durante a carga dos SCs, controlada para atingir o equilbrio.......... 36
Figura 3.9: Tenso e a tenso sobre as chaves complementares ........................................... 37
3
NDICE
G1
1
G2
1
G3
1
Vmod1 Vp1
1
Time (s)
Deve-se registrar que nesta regio de operao apenas um nico mdulo acionado
individualmente, no havendo conduo simultnea entre os mdulos.
7
G1
1
G2
1
G3
1
Vmod1 Vp1
1
Time (s)
De forma diferenciada, nesta regio de operao pode-se notar a conduo simultnea dos
mdulos.
9
G1
1
G2
1
G3
1
Vmod1 Vp1
1
Time (s)
Novamente, nesta regio de operao, pode-se notar a conduo simultnea dos mdulos.
Havendo, neste caso, a conduo de at trs mdulos simultaneamente.
11
( 1.4.1)
( 1.4.3)
3.00
Ganho Esttico
2.25
1.50
0.75
0.00
0.00 0.25 0.50 0.75 1.00
d
Podendo tambm ser representado pelo circuito equivalente apresentado na Figura 1.12
( 1.5.1)
( 1.5.2)
( 1.5.3)
( 1.5.4)
( 1.5.5)
( 1.5.6)
( 1.5.7)
{ }
0.300
di1 ( d )
1 0.250
di22 ( d ) 0.200
1
8
0.150 2 Mdulos
di31 ( d )
di32 ( d )
0.100
di33 ( d ) 3 Mdulos
1
12 0.050
0.000
0.00 0.20 0.40 0.60 0.80 1.00
d
50.0
Corrente de Sada
25.0
0.0
25.0
50.0
0.00 0.15 0.30 0.45 0.60
d
G2
1
G3
1
Vab
V1
0
I(L1)
IL
Time (s)
G1
1
G2
1
G3
1
Vab
2.V1
V1
0
I(L1)
IL
Time (s)
Para regio de operao: 2/3<D<1, obtm se VAB excursionando entre 2.V1 e 3.V1,
conforme Figura 1.17, caracterizando assim seu comportamento multinvel.
G1
1
G2
1
G3
1
Vab
3.V1
2.V1
I(L1)
IL
Time (s)
G1
1
G2
1
G3
1
Vab
2.V1
I(L1)
IL
Time (s)
20
V1<VAB<2.V1
10 0<VAB<V1
DMed
1 D=1
0.8
D=2/3
0.6
0.4
D=1/3
0.2
0
Time (s)
2. MODELAGEM E CONTROLE
Figura 2.1 Circuito equivalente durante as etapas de operao: (a) Interruptor S1 em conduo e (b) Interruptor
S1 bloqueado.
19
( 2.2.2)
( 2.2.3)
( 2.2.6)
( 2.2.7)
( 2.2.8)
[ ( ) ]
[ ] ( 2.2.9)
[ ]
[ ] ( 2.2.13)
Figura 2.2 Diagramas de Bode para a funo de transferncia que relaciona a corrente no indutor Lf com a
perturbao na razo cclica: (a) diagrama de mdulo (b) diagrama de fase.
( 2.2.15)
O ganho proporcional deve ser escolhido para assegurar que a inclinao da forma de
onda do sinal de controle no se torne maior do que a inclinao do sinal da portadora. Deste
modo tem-se:
( 2.2.16)
22
Figura 2.3 Sinais de comando e formas de onda: (a) Corrente na indutancia Lf, (b) sinal do modulador e sinal da
portadora.
A Figura 2.3 demonstra que a ondulao de corrente ocorre em um perodo que equivale
ao triplo da frequncia de chaveamento. Desta forma, a frequncia de cruzamento pode ser
escolhida at o valor de um tero da frequncia de comutao, ou seja:
( 2.2.17)
Figura 2.4 Diagramas de Bode do controlador da corrente no indutor Lf: (a) Diagrama do mdulo e (b)
diagrama da fase.
Desta forma, a funo de transferncia de lao aberto compensada corresponde equao
( 2.2.19).
( 2.2.19)
Figura 2.5 Diagrama de Bode da funo de transferncia de lao aberto compensada: (a) Diagrama de mdulo,
(b) Diagrama de fase.
24
Desta forma, foi obtida a frequncia de corte equivalente a 14,6 kHz. A margem de fase
calculada com a equao ( 2.2.20).
| | ( 2.2.20)
( 2.2.21)
proporcional. Ou seja, se um mdulo possui mais energia do que os outros dois, este mdulo
cede mais energia do que os demais, at igualar as tenses nos trs mdulos.
A estratgia de controle adotada baseia-se no controle da tenso individual de cada mdulo, a
qual discutida, como segue.
Figura 2.7 Circuito equivalente durante as etapas de operao: (a) Interruptor S1 em conduo e (b) Interruptor
S1 bloqueado.
Para o circuito da Figura 2.1 (a), sob o ponto de vista da tenso sobre o capacitor, tem-se
as seguintes equaes no intervalo
( 2.4.1)
( 2.4.2)
( 2.4.3)
( 2.4.4)
( 2.4.6)
( 2.4.8)
( 2.4.9)
( 2.4.10)
( )
( 2.4.14)
Figura 2.8 Diagramas de Bode para a funo de transferncia que relaciona tenso no capacitor Lf com a
perturbao na razo cclica: (a) diagrama de mdulo (b) diagrama de fase.
( 2.5.1)
O ganho proporcional deve ser escolhido a fim de conferir frequncia de corte adequada
planta. Como a capacitncia envolvida elevada, a frequncia em que a planta cruza o
zero da ordem de alguns dcimos de Hertz. Isto significa que, as tenses devem variar
lentamente. Desta forma a velocidade do controlador no crtica. Outro ponto consiste em
escolher ganhos elevados. Devido a presena das resistncias nos supercapacitores, a planta no
um integrador puro, como demonstrado em ( 2.4.13). Portanto existe um erro entre as tenses
de referncia e as tenses medidas nos mdulos e, ainda que pequeno, pode ser amplificado pelo
alto ganho do controlador, gerando rudo no sinal do modulador.
Com base nos critrios citados, adotou-se um ganho de 0,3 para o controlador de tenso,
ou seja:
( 2.5.2)
Figura 2.9 Diagramas de Bode do controlador da tenso no capacitor C1: (a) Diagrama do mdulo e (b)
diagrama da fase.
Desta forma, a funo de transferncia de lao aberto compensada corresponde equao
( 2.5.3).
( 2.5.3)
Figura 2.10 Diagrama de Bode da funo de transferncia de lao aberto compensada: (a) Diagrama de mdulo,
(b) Diagrama de fase.
29
Desta forma, foi obtida a frequncia de corte equivalente a 18 mHz. A margem de fase
calculada com a equao ( 2.5.4).
| | ( 2.5.4)
Figura 2.12 Diagrama de blocos para implementao do controle da tenso no conversor CC-CC multinvel
modular.
Figura 2.13 Diagrama de blocos completo para o controle da do conversor CC-CC bidirecional multinvel.
32
3. RESULTADOS DE SIMULAO
EPR 1350
Tabela 2.6.1: Especificaes do conversor cc-cc MMC simulado
Figura 3.2 Diagrama do conversor CC-CC bidirecional multinvel com trs mdulos composto por
supercapacitores.
I(L1) IRef
60
40
20
-20
-40
-60
Figura 3.3 Corrente submetida a variao na referncia da malha de controle, demonstrando a inverso do
fluxo de potncia.
34
51.5
51
50.5
50
49.5
49
48.5
A Figura 3.6 ilustra o sinal do modulado e as trs portadoras, para o ponto de maior
inclinao da moduladora para uma razo cclica de .
0.8
0.6
0.4
0.2
20
15
10
io(t)
60
40
20
0
-20
-40
-60
0dVm1 dVm2 0.1
dVm3 0.2 0.3 0.4
0.12
0.1
Time (s)
0.08
0.06
0.04
0.02
0
-0.02
-0.04
-0.06
-0.08
-0.1
-0.12
-0.14
0 0.1 0.2 0.3 0.4
Ic1med Ic2med Ic3med Time (s)
60
40
20
-20
Figura 3.7: Formas de onda durante a descarga dos SCs, para atingir o equilbrio
36
I(L1) IRef
40
0
-40
4. CONCLUSO
Foi verificado que o conversor CC-CC bidirecional MMC possui at trs nveis de
tenso na sada. A frequncia da corrente trs vezes maior do que a frequncia de
comutao, o que resulta em um indutor com indutncia at trs vezes menor em comparao ao
conversor 01.
de carros eltricos, por exemplo, este conversor com esta estratgia de controle demonstrou bons
resultados. Ressalta-se que durante a ao da malha de controle da tenso, a ondulao de
corrente cresce, pois os trs mdulos operam em regies diferentes com razes cclicas
diferentes. Quando a tenso nos capacitores atingem o equilbrio e a taxa de variao da energia
se torna igual nos trs mdulos, a ondulao de corrente pequena.
39
5. BIBLIOGRAFIA
Parmetros Principais:
(
Dl V1 1 3Dl )
Lo :=
fs IL
5
Lo = 1.111 10
2. Ondulao da corrente parametrizada
d i1( d ) := d ( 1 d)
1
d max :=
2
(
d i1 d max = 0.25 )
d i33( d ) := d
Para conversor Multinivel c/ quatro niveis (N=3): 2
(3 3 d)
Para 3 mdulos N=3 (Modular) c/ dmax=0.5 ????: 3
d i32( d ) := d
1
d i31( d ) := d ( 1 3 d ) (2 3 d)
3
1 3 5
d max31 := d max32 := d max33 :=
6 6 6
( )
d i31 d max31 = 0.083 ( )
d i32 d max32 = 0.083 ( )
d i33 d max33 = 0.083
d i22( d ) := d
1
d i21( d ) := d ( 1 2 d ) (2 2 d)
2
1 3
d max21 := d max22 :=
4 4
(
d i21 d max21 = 0.125 ) (
d i22 d max22 = 0.125)
0.300
di1( d)
1
0.250
4
di21 ( d)
di22 ( d) 0.200
1
8
0.150
di31 ( d)
di32 ( d)
0.100
di33 ( d)
1
12 0.050
0.000
0.00 0.20 0.40 0.60 0.80 1.00
d
(3 d V1 V0)
Io ( d ) := Vo ( d ) := 3 d V1
RL
50.00
25.00
Io( d)
0.00
0
25.00
50.00
0.00 0.15 0.30 0.45 0.60
d
40.00
30.00
Vo( d)
20.00
0
10.00
0.00
0.00 0.25 0.50 0.75 1.00
d
DL1 := 1
EPR := 5 1350
ESR := 5 0.0008 RL 3
Polo_G1 := = 1.4 10 [Hz]
2 L
Etot := ESR + EPR
3 V1 (
3 EPR V1 ESR IL )
G1 ( f ) := G1R( f ) :=
s( f ) L + R L ( )
Etot s( f ) L + RL + 3DL1 ESR EPR
100
50
50
Mag Gi real
Mag Gi ideal
AC Sweep
100
3 4 5 6
1 10 100 110 1 10 1 10 1 10
0
20
40
60
80 Fase Gi real
Fase Gi ideal
AC Sweep
100
3 4 5
1 10 100 110 1 10 1 10
3fs
Frequncia de Cruzamento: fc := 18000 [Hz]
5
Ki ( KP s(f ) + Ki)
Ci( f ) = KP + Ci ( f ) =
s( f ) s( f )
V0 D1 := 0.1667
Razo cclica: D := = 0.4
3 V1
KP IL
= 2 fs Vp
1 Para portadora como triangular!
D1
fs
2Vp D1
Kpmax := = 0.133
IL
fc 3
Alocao do zero controlador: fzci1 := = 1.8 10 [Hz]
10
Controlador proposto:
3
Ki := 33.333 Kp := 28.3 10
1 3
PSIM: Tpsim1 := = 30 10 Kpsim1 := Kp = 0.028
Ki
Ci( f ) := 33.3333
(85010 6 s( f ) + 1)
s( f )
Ki
Ci1( f ) := Kp +
s( f )
50
50
Magnitude de Ci
3 4 5
1 10 100 1 10 1 10 110
20
40
60
80
Fase de Ci
100
3 4 5
1 10 100 1 10 1 10 1 10
Resposta planta & controlador (FTLA1cci):
100
50
0
Mag FTLA
3 4 5
1 10 100 1 10 1 10 110
50
100
Fase FTLA
3 4 5
1 10 100 1 10 110 1 10
fc := 14600 (
MFobtida := 180 + PHS FTLA1 fc ( ) ) = 94.9
Resposta do sistema em malha fechada (FTMF):
FTLA1( f )
FTMF1( f ) :=
1 + FTLA1( f )
10
Mag FTMFi
0
20
3 4 5
1 10 100 1 10 1 10 110
20
40
60
80 Fase FTMFi
3 4 5
1 10 100 1 10 1 10 110
Controlador Cv
IL EPR
Gv( f ) := GvR( f ) := IL
C1 s( f ) C1 s( f ) ( ESR + EPR) 1
100
Mag Gv real
Mag Gv ideal
AC Sweep
200
3 4 5
0.01 0.1 1 10 100 1 10 1 10 1 10
50
100
Fase Gv real
Fase Gv ideal
AC Sweep
150
3 3 4 5
1 10 0.01 0.1 1 10 100 1 10 1 10 110
Controlador proposto da malha de tenso:
Kpv := 0.3
Cv := 0.3
50
50 Mag Cv
0
3 4 5
1 10 100 1 10 110 110
50
50
Fase Cv
3 4 5
1 10 100 1 10 110 110
FTLAv( f ) := Kpv Gv( f )
(
MFobtida := 180 + PHS FTLAv fc( ) ) = 90
50
100
Mag FTLAv
150
3 3 4 5
1 10 0.01 0.1 1 10 100 110 1 10 110
50
100
Fase FTLAv
3 4 5
1 10 100 1 10 110 1 10
FTLAv( f )
FTMFv( f ) :=
1 + FTLAv( f )
50
100
150
3 3 4 5
1 10 0.01 0.1 1 10 100 110 110 110
50
100
3 4 5
1 10 100 1 10 1 10 1 10
Controlador Cv
1
Sumrio
Introduo ..................................................................................................................................... 3
Captulo 1: Etapas de Operao e teoria do Conversor Ck ......................................................... 5
Ondulao de corrente e tenso e esforos ............................................................................. 6
Circuito Equivalente .................................................................................................................. 7
Captulo 2: Obteno das funes de transferncia ..................................................................... 9
Captulo 3: Exemplo Numrico.................................................................................................... 10
Funo de transferncia para controle da corrente de entrada............................................. 10
Validao da planta ................................................................................................................. 11
Corrente mdia IL1 em funo da razo cclica ........................................................................ 13
Controlador ............................................................................................................................. 14
Captulo 4: Resultados Experimentais ......................................................................................... 15
Captulo 5: Concluso .................................................................................................................. 19
Referncias .................................................................................................................................. 20
3
Introduo
O presente trabalho tem como objetivo principal realizar a anlise por espao
mdio de estados do conversor Ck bidirecional no isolado. O conversor Ck tambm
conhecido na literatura como conversor CC-CC a acumulao capacitiva. Isso decorre
do fato de que sua principal caracterstica realizar a transferncia de potncia entre
duas fontes de corrente. Na primeira etapa, a fonte da entrada carrega o capacitor
intermedirio do circuito. Na etapa posterior, o capacitor conectado a fonte de sada,
transferindo a energia acumulada na etapa anterior. A existncia do capacitor
intermedirio se deve ao fato de no existir a possibilidade de transferncia de
potncia entre duas fontes com a mesma caracterstica, nesse caso com caracterstica
de fonte de corrente. Tendo em vista que na primeira etapa uma fonte de corrente na
entrada conectada a uma fonte de tenso intermediria e na etapa seguinte a
mesma fonte de tenso intermediria conectada a uma fonte de corrente na sada,
esse conversor tambm pode ser chamado de conversor Boost-Buck. A Figura 1
apresenta a topologia do conversor Ck unidirecional e a Figura 2 apresenta a
topologia bidirecional.
D
G
1 D
diL1(t )
L1 dt (Rs RL )iL1(t ) Rs iL 2 (t ) V1
diL 2 (t )
L2 Rs iL1(t ) (Rs RL )iL 2 (t ) VC V2
dt
dVC (t )
i c ( t ) C i L 2 (t )
dt
diL1(t )
L1 dt (Rs RL )iL1(t ) Rs iL 2 (t ) VC (t ) V1
diL 2 (t )
L2 Rs iL1(t ) (Rs RL )iL 2 (t ) V2
dt
dVC (t )
i c ( t ) C iL1(t )
dt
Realizando a anlise por espao mdio de estados, que nada mais do que
ponderar as equaes dos estados topolgicos pelas razes cclicas associadas s
etapas de operao e em seguida realizar a soma dessas ponderaes, chegou-se ao
seguinte resultado:
diL1(t )
L1 dt
(RS RL ) RS (1 D ) IL1 V1
L diL 2 (t ) R
2 dt S (RS RL ) D . IL 2 V2
(1 D ) D 0 VC 0
C dVC (t )
dt
(RS RL ) RS (1 D ) V1
A RS (RS RL ) D e B V2
(1 D) D 0 0
E.D E.D
IL1 e IL2
f .L1 f .L2
IL1.(1 D)
VC
f .C
Circuito Equivalente
Utilizando as equaes de estado apresentadas anteriormente e realizando a
anlise para valores mdios, encontraram-se as seguintes equaes:
2DRL 2D2RL RL RS
DV1 (1 D)V2 ( )IL1
D
( 2DRL 2D2RL RL RS )
Req
D
8
Para obteno do ganho ideal do circuito, faz-se a corrente IL1 ter valor nulo,
obtendo, com isso, o mesmo ganho para o conversor Ck unidirecional.
V2 D
G
V1 1 D
9
Partindo da expresso genrica para anlise por espao mdio de estados, cujo
formato apresentado a seguir, foram introduzidas perturbaes nos estados e na
razo cclica. As principais etapas da anlise so apresentadas abaixo:
A A1D A2 (1 D )
B B1D B2 (1 D )
X AX Bu e substituindo
X X0 x
D D d
0
encontra-se a expresso:
X AX [( A1 A2 ) X0 (B1 B2 )u ]d
iL1(s ) (CLRSV1 CLRSV2 )s (DLV1 D LV1 D LV2 LV2 2DLV2 )s (2DRsV1 2DRsV2 RsV2 )
2 2 2
V1 48 V
V2 24 V
Rs 0,1
RL 0
fs 40 kHz
P 240 W
Para os valores especificados de tenso de entrada e tenso de sada, consegue-se
encontrar o valor da razo cclica associada a essa especificao.
V2 D
G D 1
V1 1 D 3
IL1 5 A IL2 10 A Vc 72 V
L1 L2 1,6 mH C 23,15 F
Foi definido neste projeto que a funo de transferncia que seria utilizada no trabalho
seria a da corrente de entrada em funo da razo cclica. Para tanto, o objetivo a partir de
agora conseguir controlar a corrente de entrada do circuito para referncias positivas e
negativas, validando com isso a bidirecionalidade do conversor Ck.
diL1(s ) (CLRSV1 CLRSV2 )s 2 (DLV1 D2LV1 D2LV2 LV2 2DLV2 )s (2DRsV1 2DRsV2 RsV2 )
d (s ) CL2RSs3 2CLRS 2s 2 (2LRSD2 2DLRS LRS )s Rs2
44996,4(s 2 8.997e6)
G(s )
(s 112,5)(s 2 12.48s 1.5e7)
Validao da planta
Foi realizada uma anlise com o auxlio do software PSIM para validar a planta
encontrada e apresentada anteriormente. A Figura 6 apresenta o circuito utilizado para
12
validao da planta. Para efeitos de validao, foi utilizado a planta G(s), que diz respeito
planta para o valor de 23,15 F do capacitor.
D[DV1 (1 D)V2 ]
IL1(D)
RS
14
Controlador
ki
C (s ) k p
s
A planilha de MathCad apresenta os clculos realizados para obteno dos parmetros
do compensador, sendo nesse relatrio apenas apresentado os resultados obtidos.
k pmx 1,333 kp 1
1
ki 4,398e3 0,277e 3
ki
15
Na transio, percebe-se que a portadora satura num valor muito inferior e isso
acarreta num efeito de que o interruptor S2 para essa transio conduz a maior parte do
tempo, como apresenta a Figura 15.
Na transio, percebe-se que a portadora satura num valor muito superior e isso
acarreta num efeito de que o interruptor S1 para essa transio conduz a maior parte do
tempo, como apresenta a Figura 16.
19
Captulo 5: Concluso
Referncias
[1] MARTINS, D. C.; BARBI, I. Eletrnica de Potncia - Conversores CC-CC Bsicos No Isolados.
3 edio. Florianpolis, 2008.
Sumrio
Introduo ......................................................................................................................... 3
Captulo 1: Etapas de Operao e Principais formas de onda .......................................... 4
Full Bridge .................................................................................................................... 4
Push-Pull com transformador ideal ............................................................................... 6
Push-Pull com transformador real ................................................................................ 7
Captulo 2: Circuito Equivalente em Regime Permanente ............................................. 10
1 etapa (0 < t < t+tlr): ................................................................................................ 10
2 etapa (t+tlr < t <T/2): ............................................................................................ 10
Modelagem para controle da corrente IL2: .................................................................. 13
Captulo 3: Exemplo Numrico ...................................................................................... 15
Ondulao de corrente no indutor de sada ................................................................. 15
Parmetros do compensador ....................................................................................... 16
Dimensionamento do circuito grampeador ................................................................. 17
Captulo 4: Resultados de Simulao ............................................................................. 19
Captulo 5: Concluso .................................................................................................... 25
Referncias ..................................................................................................................... 26
3
Introduo
Full Bridge
Nota-se que, como havia sido citado anteriormente, ocorre um phase-shift entre
os comandos dos interruptores. Esse phase-shift o responsvel por aplicar uma tenso
de trs nveis no primrio do transformador. Na primeira etapa de operao, quando os
interruptores S1 e S3 esto em conduo, com os interruptores S2 e S4 bloqueados, a
tenso aplicada nos terminais do transformador nula, como mostra a Figura 3(a).
5
Nessa primeira etapa, como ilustra a Figura 6, a tenso V0 aplicada aos terminais
da carga nula no perodo de tempo t, que contempla a defasagem entre a comutao
dos interruptores do lado Full Bridge e tambm no perodo de tempo tlr, onde o diodo
est conduzindo a corrente da indutncia de disperso enquanto esta comuta para o
interruptor complementar. O circuito equivalente para esta anlise apresentado na
Figura 8.
V0 VL2 V2 V0 0 V
Nessa segunda etapa, como ilustra a Figura 6, a tenso V0 aplicada aos terminais
da carga possui valor de V1, onde a relao de transformao do transformador. A
Figura 9 apresenta o circuito equivalente para esta etapa de operao.
V0 VL2 V2 V0 V1 V
11
Atravs da anlise das duas etapas de operao, pode-se obter uma expresso
para a tenso mdia na sada do conversor (V0), que segue:
2t 2tlr
V0 V1.(1 )
T T
Para as anlises que sero apresentadas a seguir, levou-se em considerao que
as indutncias de disperso L5 e L6 so iguais. Portanto, sero analisadas a partir de
agora como uma indutncia Ld.
2t
Vab V1 1 e V0 V1. 1 V1 lr
T
V1 2tlr
Vx Rx .IL2 Rx .
IL2 T
Para modelar de maneira correta a resistncia, deve-se obter uma expresso para
o tempo tlr. Esse tempo obtido atravs da anlise da comutao do interruptor, no
tempo em que o diodo intrnseco conduz a corrente da indutncia de disperso do
transformador. Realizando a anlise que segue:
IL IL2
Vlr Ld V1 Ld
t tlr
Ld IL2
tlr
V1
Rx 2Ld f
IL2
V1 V2 L2 Req IL2
t
O parmetro de controle da corrente de sada do conversor o parmetro , que
o phase-shift entre os sinais de comutao dos interruptores. Para tanto, realiza-se a
perturbao e linearizao em torno desse parmetro, atravs dos passos que seguem:
IL 2
V1 V2 L2 Req IL 2
t
(I i )
V1( 0 ) V2 L2 L2 L Req (IL 2 iL )
t
V1(s ) sL2 iL (s ) Req iL (s )
iL (s ) V1
(s ) sL2 Req
V1 400 V
V2 48 V
P 1000 W
f 20 kHz
(V1 V2 ) V2
IL .
2.L2 .f V1
Tendo os parmetros definidos anteriormente, consegue-se calcular o valor da
indutncia de sada L2:
16
(V1 V2 ) V2
L2 .
2.IL .f V1
Parmetros do compensador
96
G(s )
0.0006s 0.04
ki
C (s ) k p
s
1
c 136.159 k p 0.678
ki
Tendo em vista que essa sobretenso pode ser destrutiva para o componente,
optou-se pelo uso de um grampeador de tenso para garantir que a sobretenso mxima
nos terminais do interruptor tenha um valor que no o danifique.
A Figura 15 apresenta os sinais de comandos dos interruptores S1, S2, S3, S4, S5 e
S6, que fazem parte das etapas do conversor Full-Bridge e Push-Pull. Alm disso,
apresentado os sinais da moduladora e da portadora do sistema, alm do sinal que
representa a defasagem entre os sinais de comando dos interruptores S1 e S4 (ou S2 e
S3), como mostra a figura.
Para a planta obtida via anlise das etapas de operao, foi realizada uma
simulao exploratria para a validao da mesma. Para tanto, definiu-se um ponto de
operao e montou-se um circuito para a realizao da validao. Aplica-se uma
pequena perturbao na defasagem do comando dos interruptores e espera-se que a
resposta do circuito seja a mesma tanto para a funo de transferncia como para o
circuito original. A Figura 16 apresenta o resultado dessa simulao. Nota-se que o
modelo obtido analiticamente representa bem o circuito. Quando uma perturbao
imposta, tanto o circuito original quanto o modelo obtido da funo de transferncia
possuem comportamento igual, validando a planta encontrada para o conversor.
20
Como citado anteriormente, pelo fato de ter uma topologia bidirecional, quando
o fluxo de potncia da fonte V2 para V1 e ocorre o bloqueio dos interruptores S5 ou S6,
no existe um caminho para as correntes das indutncias de disperso Ld, e isso causa
uma sobretenso em cima do interruptor comandado a bloqueio. A Figura 19 nos mostra
que essa sobretenso pode ser destrutiva para o componente caso nada seja realizado
para evit-la.
Captulo 5: Concluso
Referncias
Alunos:
Mauro Andre Pagliosa
Jacson Lus de Oliveira
2 Analise do Conversor 3
2.1 Sinais de Comando . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3
2.2 Estados Topologicos . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4
2.3 Principais Formas de Onda . . . . . . . . . . . . . . . . . . . . . . . . . . . 10
2.4 Ganho Estatico . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 11
2.5 Ondulacao da Corrente na Sada . . . . . . . . . . . . . . . . . . . . . . . . 11
2.6 Razao Cclica . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 12
2.7 Tensao e Corrente nos Capacitores de Entrada . . . . . . . . . . . . . . . . 13
2.8 Esforcos nos Interruptores . . . . . . . . . . . . . . . . . . . . . . . . . . . 16
3 Modelagem e Controle 19
3.1 Circuito Equivalente . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 19
3.2 Funcao de Transferencia . . . . . . . . . . . . . . . . . . . . . . . . . . . . 21
3.3 Projeto do Controlador . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 21
4 Simulacao Numerica 24
4.1 Especificacoes de Projeto . . . . . . . . . . . . . . . . . . . . . . . . . . . . 24
4.2 Parametros Obtidos . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 24
4.3 Resultados de Simulacao . . . . . . . . . . . . . . . . . . . . . . . . . . . . 24
5 Conclusao 29
1
1 Introducao
Este trabalho apresenta uma analise do conversor CC-CC Isolado do tipo Tres Nveis -
Push-Pull.
Na secao 2 sera apresentado a estrategia de modulacao, os estados topologicos, as
principais formas de ondas, o ganho estatico do conversor a razao cclica de operacao
Na secao 3, sera apresentado a modelagem do conversor assim como o projeto do
controle.
A secao 4, os resultado de simulacao.
Por fim, as conclusoes do trabalho serao apresentadas na secao 5
2
2 Analise do Conversor
Esta secao apresenta uma analise do conversor CC-CC bidirecional isolado Tres Nveis
- Push-Pull apresentado na Figura 1.
C1
S1
S5
D1
S3 Lr
a
L R2
V b a
b
S4 V2
D2 S7
C2
S2
3
2.2 Estados Topologicos
Considerando os sinais de comando apresentados na secao 2.1 e possvel avaliar as regioes
de operacao do conversor e obter o circuito equivalente dos estados topologicos de cada
uma destas regioes. Para efeitos de analise, sera adotado que os capacitores estejam
operando em condicoes de regimente permanente e suas tensoes possam ser consideradas
constantes. Assim, cada capacitor sera representado por uma fonte de tensao constante
V 1. Nas Figuras 3 a 9 sao apresentados os estados topologicos do conversor para cada
etapa de operacao.
4
Figura 4: Circuito equivalente para referente ao estado topologico da primeira etapa de
operacao.
5
Figura 6: Circuito equivalente para referente ao estado topologico da segunda etapa de
operacao.
6
Figura 8: Circuito equivalente para referente ao estado topologico da terceira etapa de
operacao.
7
Figura 10: Circuito equivalente para referente ao estado topologico da quarta etapa de
operacao.
8
Figura 12: Circuito equivalente para referente ao estado topologico da quinta etapa de
operacao.
9
Figura 14: Circuito equivalente para referente ao estado topologico da quarta etapa de
operacao.
10
2.4 Ganho Estatico
O ganho estatico do conversor pode ser obtido atraves da tensao sobre a indutancia
de dispersao do secundario. Supondo a operacao do conversor em regime permanente
podemos encontrar a seguintes relacao analisando a primeira etapa de operacao:
LR ILR
VL5 = (1)
ta
ILR
nVi = L5 (2)
ta
ILR
ta = LR (3)
nV1
nV1 (DT ta )
Vo = (4)
T
Substituindo (3) em (4), o ganho estatico do conversor pode encontrado:
V2 2Lr f ILR
=D (5)
nV1 nV1
VL = nV1 V 2 (6)
dIo Io
VL = L =L (7)
dt t
11
LR Io
Io = (nV1 V2 )(DT ) (8)
nV1
E observando as tensoes Vsec1 e Vo mostradas na Figura 17, pode-se definir que a tensao
na indutancia de dispersao no referido intervalo de tempo ta .
12
Sabendo que a tensao no indutor e dada por (9).
LR ILR
VLR = (9)
ta
Realizando a substituicao de variaveis encontra-se a expressao que define o intervalo
de tempo ta .
Io
ta = Lr (10)
nV1
A razao cclica efetiva pode ser encontrada analisando a tensao na indutancia de sada
do conversor. Observando a Figura 19 verifica-se que a tensao na indutancia de sada
e dada pela diferenca entre a tensao de sada V2 e a tensao definida como Vo conforme
apresentado em (12).
Alem disso, a tensao media na indutancia deve ser zero conforme (11).
VLmed = 0 (11)
Vo V2 = 0 (12)
O valor medio da tensao Vo e definido observando a sua forma de onda apresentada
na Figura 17.
(DT ta )
nV1 V2 = 0 (13)
T
Io
Sabendo que ta = Lr nV 1
e isolando D da expressao obtem-se a expressao da razao
cclica efetiva mostrada em (14).
V2 + Lr Io 2 f
D= (14)
2nV1
13
Figura 20: Etapas de operacao para analise das correntes e tensoes nos capacitores.
14
Com o objetivo de simplificar o equacionamento, a forma de onda da corrente no
capacitor sera aproximada pela forma de onda mostrada na Figura 23, onde tambem e
apresentado a forma de onda da tensao no capacitor.
15
2.8 Esforcos nos Interruptores
Os interruptores S5 e S7 mostrados no circuito do conversor possuem perodos identicos de
conducao, portanto, cada um conduz a metade da corrente de carga, conforme apresentado
em (20).
Io
Is5med = Is7med = (20)
2
A expressao para o calculo da corrente eficaz nos interruptores S5 e S7 sera definida
considerando a corrente de carga isenta de harmonicos e que a comutacao da corrente
entre S5 e S7 e instantanea.
s
Z T
1 2
Is5ef = Is7ef = Io 2 dt (21)
T 0
Resolvendo a equacao (21) chega-se a expressao da corrente eficaz nos interruptores
S5 e S7 conforme apresentado em (22).
s
Z T
1 2
Is5ef = Is7ef = Io 2 dt (22)
T 0
Na operacao com potencia positiva, o proprio diodo em antiparalelo com o mosfet,
proporciona um caminho para a corrente que circula pela indutancia de dispersao associ-
ada ao interruptor no instante do bloqueio. Sendo assim, a tensao no interruptor surge
somente apos o bloqueio do diodo.
Assim, a tensao nos interruptores S5 e S7 e definida em
16
Figura 24: Interruptor S7 bloqueado.
n Io (DT ta )
Is1med = Is2med = (24)
T
Io
n Io DT Lr nV1
Is1med = Is2med = (25)
T
A expressao para o calculo da corrente media nos interruptores S1 e S2 e mostrada
em (26).
Lr Io 2 f s
Is1med = Is2med = n Io D (26)
V1
Para simplificar o equacionamento da corrente eficaz em S1 e S2 , sera considerado que
a corrente e zero no intervalo ta . Portanto, tem-se:
s Z
1 DT
Is1ef = Is2ef = (n Io )2 dt (27)
T ta
Analisando as etapas de operacao, fica evidente que a maxima tensao nos interruptores
e dada pela tensao do capacitor, que por sua vez, e a metade da tensao do barramento.
17
Figura 25: Corrente no primario do transformador e corrente nos interruptores S1 e S3 e
no diodo D1 .
18
DT por T /2. A expressao para a corrente media em S3 e S4 e dada por (23).
n Io ( T2 ta )
Is3med = Is4med = (29)
T
n Io Lr Io 2 fs
Is3med = Is4med = (30)
2 V1
E a corrente eficaz e dada por (32).
s
Z T
1 2
Is1ef = Is2ef = (n Io )2 dt (31)
T ta
r
1 Lr Io fs
Is1med = Is2med = n Io (32)
2 nV1
Os esforcos de corrente nos diodos D1 e D2 tambem sao equacionados observando a
forma de onda corrente mostrada na Figura 25.
n Io T2 DT
ID1med = ID2med = (33)
T
1
ID1med = ID2med = n Io D (34)
2
3 Modelagem e Controle
3.1 Circuito Equivalente
Definindo o ponto da tensao Vo conforme mostrado na figura do circuito do conversor
TL:Push-Pull, pode-se redesenhar o circuito equivalente do conversor em funcao da tensao
Vo . Observa-se que a tensao no indutor de sada fica definida como sendo a diferenca entre
as tensao V2 e Vo . Nesta analise esta sendo considerado que a tensao dos capacitores de
entrada e fixa no valor V1 .
A forma de onda da tensao Vo e conhecida a partir da analise das etapas de operacao
descritas anteriormente.
VL = Vo V2 (35)
19
Entao e possvel definir que a tensao no indutor possui dois nveis constantes, um para
cada intervalo de tempo definido.
VL = V2 , durante 2 d 2 d (37)
onde d e definido em (38)
ta
d = (38)
T
Substituindo (10) em (38) obtem-se (39)
Lr i
d = (39)
n V1 T
Ou ainda:
Lr i f s
d = (40)
n V1
Multiplicando (36) e (37) pelo correspondente intervalo de tempo e substituindo VL
por , obtem-se as equacoes (41) e (42).
di
(1 + 2 d 2d)L = nV1 (1 + 2 d 2d) V2 (1 + 2 d 2d) (41)
dt
di
(2d d)L = V2 (2d d) (42)
dt
Somando as expressoes (41) e (42) para obter a expressao com da corrente no indutor
de sada com o valor medio quase instantaneo em um perodo de chaveamento obtem-se
(44).
di
L = nV1 (1 + 2 d 2d) V2 (43)
dt
Lr ifs
Substituindo d por vV1
, chega-se a expressao para o modelo simplificado do con-
versor em estudo.
di
L = nV1 (1 2d) + 2 Lr i fs V2 (44)
dt
Um modelo do circuito equivalente do conversor para regime permanente pode ser
di
construdo a partir da expressao (44) tomando L dt = 0.
20
Figura 27: Circuito equivalente para regime permanente
i = i + I (45)
d = d + D (46)
As perturbacoes mostradas em (45) e (46) sao introduzidas na expressao (44).
d(i + I)
L = nV1 + 2Lr (i + I) fs 2nV1 (d + D) V2 (47)
dt
Mantendo apenas os termos de primeira ordem da equacao (47) obtem-se a equacao
linearizada em (48). E aplicando a transformada de Laplace chega-se a funcao de trans-
ferencia para controle da corrente de sada mostrada em (49) e (50).
di
L = 2Lr fs i 2nV1 d (48)
dt
I(s) 2nV1
= (50)
D(s) sL + 2Lr fs
21
Figura 28: Resposta em frequencia da planta, do controlador e do sistema compensado.
22
Figura 30: Circuito esquematico em Malha Fechada para controle da corrente de sada
do conversor.
23
4 Simulacao Numerica
4.1 Especificacoes de Projeto
Os resultados de simulacao serao apresentados para a especificacao de projeto mostrada
na tabela abaixo:
24
pondem aos valores calculados para o ponto de operacao especificado.
25
Figura 33: Corrente e sinal de comando S5 e S7 .
26
Figura 36: Tensao nos capacitores de entrada e corrente de sada.
A Figura (38) mostra que a derivada do sinal modulador e suficientemente menor que
a da portadora assegurando que nao ocorrerao pulsos indesejados.
A Figura (39) mostra que a derivada do sinal modulador e suficientemente menor que
27
a da portadora assegurando que nao ocorrerao pulsos indesejados.
28
5 Conclusao
Este trabalho apresentou o funcionamento atraves da analise das etapas de operacao do
conversor TL:Push-Pull. A analise matematica com a obtencao das principais equacoes
para dimensionamento do conversor tambem foi apresentada e validada por simulacao
numerica.
Destaca-se no circuito de potencia, o cuidado com a tensao de bloqueio nos interrup-
tores S5 e S7 quando o conversor estiver operando com potencia negativa, pois, diante da
presenca de indutancias parasitas e principalmente a indutancia de dispersao, e necessario
proteger estes interruptores de sobretensao com circuitos externos.
Em relacao a dinamica do conversor, os resultados de simulacao mostraram uma boa
robustez do conversor, tanto do equilbrio das tensoes nos capacitores de entrada quanto
do controle da corrente de sada.
29
INSTITUTO DE ELETRNICA DE POTNCIA
Departamento de Engenharia Eltrica
Centro Tecnolgico
NDICE
1 INTRODUO ....................................................................................................................................................... 3
2
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Conversores Estticos cc-cc Bidirecionais
1 INTRODUO
O interesse pelo uso de veculos eltricos vem ressurgindo ao longo dos ltimos anos devido
s vantagens encontradas nestes tipos de automveis, como a reduo do consumo de combustveis
fsseis e a no emisso de poluentes no meio ambiente. Junto com esse crescimento, vem o
surgimento do conceito de redes eltricas inteligentes, a insero de fontes alternativas na gerao
de energia. Um tpico recente de pesquisas uso dos destes veculos eltricos como parte destas
redes.
Neste cenrio crescente, as tecnologias que envolvem os sistemas eletrnicos de potncia
so um ponto essencial no desenvolvimento das redes inteligentes e dos veculos eltricos. Nestas
aplicaes requerida a bidirecionalidade do fluxo de potncia. Conversores cc-cc so utilizados
neste tipo de sistema para o controle do fluxo de potncia e adequao dos nveis de tenso entre
estes sistemas. Estes conversores so submetidos a elevados nveis de tenso e corrente e, por isso,
devem ter a capacidade de operar com elevadas tenses e correntes.
Neste contexto, este trabalho tem por objetivo a proposta e o estudo de uma topologia de
conversor cc-cc bidirecional isolado para aplicaes com altas tenses no barramento de
alimentao e elevadas correntes no barramento secundrio, e.g., em aplicaes onde um sistema de
recarga de VEs conectado a uma rede eltrica inteligente. O conversor cc-cc bidirecional
conectado a um estgio de processamento de energia, responsvel pela correo de fator de potncia
e elevao da tenso da fonte de alimentao, e a um sistema de armazenamento de energia, um
banco de baterias ou de supercapacitores, como ilustrado na Figura 1. Neste trabalho proposto um
conversor assimtrico formado a partir da associao das topologias meia-ponte a montante e push-
pull alimentado em corrente a jusante, a topologia do conversor apresentada na Figura 2.
3
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A topologia do conversor cc-cc meia-ponte assimtrica com push-pull foi escolhida por
apresentar as seguintes vantagens:
Poucos componentes na estrutura topolgica;
empregado o controle por modulao fixa;
Possibilidade de obteno comutao sob tenso nula (Zero-Voltage Switching -
ZVS) naturalmente.
4
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S2
Vport S4
S1,S3
S2,S4
DTs Ts/2 Ts 2Ts
Para a anlise das etapas de operao, considerado que o fluxo de potncia positivo
quando flui da fonte V1 para a fonte V2 e negativo quando flui da fonte V2 para a fonte V1. O
conversor meia-ponte assimtrica com push-pull apresenta dois estados topolgicos devido
estratgia de modulao adotada, e cada estado topolgico apresenta duas etapas de operao. As
5
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duas etapas a mais correspondem s etapas de comutao que so caracterizadas pela transferncia
da corrente entre as indutncias de disperso do secundrio do transformador Lr1 e Lr2. Para a
anlise foi considerado que as tenses nos capacitores esto balanceadas, os semicondutores so
ideais, a relao de transformao do transformador unitria e o fluxo de potncia est direcionado
da fonte V1 para a fonte V2.
A Figura 5 apresenta as quatro etapas de operao do conversor meia ponte assimtrico para
o fluxo de potncia positivo. Na primeira etapa de operao, mostrada na Figura 5 (a), os
interruptores S1 e S3 so comandados a conduzir. Com isso a corrente no enrolamento primrio flui
atravs do interruptor S1 e a tenso submetida ao enrolamento primrio igual a tenso no capacitor
C1. No lado secundrio do transformador, o interruptor S4 est desabilitado e, portanto, toda a
corrente de carga flui atravs do interruptor S3.
Na segunda etapa de operao, mostrada na Figura 5 (b), os interruptores S2 e S4 so
comandados a conduzir, enquanto os interruptores S1 e S3 so bloqueados. Nesta etapa, devido
presena da indutncia de disperso Lr1, a corrente de carga que flua atravs do interruptor S3 na
etapa anterior, no pode ser interrompida de maneira abrupta, caso contrrio poderia causar
sobretenso e possvel destruio do interruptor. Com isso, uma vez que o interruptor S3 est
bloqueado, a corrente na indutncia de disperso Lr1 flui atravs do diodo D3 at o momento em que
atinge o nvel zero. Enquanto isso, a corrente na indutncia de disperso Lr2 cresce medida que a
corrente na indutncia de disperso Lr1 decresce. Esta etapa termina quando a corrente na indutncia
de disperso Lr1 atinge o nvel zero e toda a corrente de carga flui atravs do interruptor S4.
A terceira etapa de operao, mostrada na Figura 5 (c), anloga primeira etapa de
operao com os interruptores S2 e S4 esto conduzindo e, com isso, a corrente no enrolamento
primrio flui atravs do interruptor S2 e a tenso submetida ao enrolamento primrio igual a tenso
no capacitor C2. No lado secundrio do transformador, o interruptor S3 est desabilitado e, portanto,
toda a corrente de carga flui atravs do interruptor S4.
Finalmente, na quarta etapa de operao mostrada na Figura 5 (d), os interruptores S1 e S3
so comandados a conduzir, enquanto os interruptores S2 e S4 so bloqueados. Analogamente
segunda etapa, devido presena da indutncia de disperso Lr2, a corrente de carga que flua
atravs do interruptor S4 na etapa anterior, no pode ser interrompida de maneira abrupta e, com
isso, a corrente na indutncia de disperso Lr2 flui atravs do diodo D4 at o momento em que atinge
o nvel zero. Enquanto isso, a corrente na indutncia de disperso Lr1 cresce medida que a corrente
na indutncia de disperso Lr2 decresce. Esta etapa termina quando a corrente na indutncia de
disperso Lr2 atinge o nvel zero e toda a corrente de carga flui atravs do interruptor S3.
6
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8
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Ts/2 Ts
Dt1 Dt2
S1,S3
DTs
S2,S4
(1 D)V1
|vab| DV1
(1 D)V1/n
(DV1)/n
vO
iLr1 iLr2
I2
2DV1/n
vS3
2(1 D)V1/n
vS4
DiL2
iL2
(1 D)(V1/n) V2
vL2
(DV1/n) V2
V2
DiLm
iLm
(1 D)V1
vLm
DV1
4 1 2 3 4
Etapas de Operao
9
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Ts/2 Ts
Dt1 Dt2
S1,S3
DTs
S2,S4
(1 D)V1
|vab| DV1
(1 D)V1/n
(DV1)/n
vO
iLr1,2
iLr2 iLr1
I2
2DV1/n
vS3
2(1 D)V1/n
vS4
DiL2
iL2
(1 D)(V1/n) V2
vL2
(DV1/n) V2
DiLm
iLm
(1 D)V1
vLm
DV1
4 1 2 3 4
Etapas de Operao
DI Lr
VLr Lr . (1)
Dt
10
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Assim, para a quarta etapa de operao, a tenso sobre a indutncia de disperso igual a
tenso sobre o capacitor C1 refletida para o secundrio do transformador e a variao de corrente
iLr igual a corrente total na carga I2. Logo, o intervalo de tempo t1 calculado a partir da
equao (2):
Lr I 2
Dt1 (2)
1 D V1sec
Para a segunda etapa de operao, a tenso sobre a indutncia de disperso ser igual a
tenso sobre o capacitor C2 refletida para o secundrio do transformador e a variao de corrente
iLr igual a corrente total na carga I2. Com isso, o intervalo de tempo t2 calculado a partir de (3)
Lr I 2
Dt2 . (3)
D V1sec
(1 D)
Dt2 Dt1. (4)
D
1 DTs Ts
VO 1 D V1sec dt DV1sec dt . (5)
Ts Dt1 ( DTs Dt2 )
VO 2D 1 D V1sec 2I 2 Lr f s . (6)
A partir de (6) pode ser obtido o circuito equivalente do conversor em regime permanente,
mostrado na Erro! Fonte de referncia no encontrada..
11
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A resistncia Req responsvel pela perda de razo cclica e pode ser denominada como uma
resistncia no dissipativa, uma vez que a mesma no representa uma resistncia fsica e depende
apenas dos parmetros da indutncia de disperso e da frequncia de comutao. Logo, a resistncia
no dissipativa Req obtida a partir da equao (7)
Req 2 Lr f s . (7)
Sabendo que a tenso mdia sobre o indutor L deve ser igual a zero, tem-se que a tenso
mdia antes do indutor v0med igual a tenso da fonte v2. Com isso, o ganho esttico do conversor
em estudo considerando a perda de razo cclica oriunda das indutncias de disperso encontrado
a partir de (6). Reorganizando a equao (6), obtm-se
V2 2 D 1 D 2 I 2 Lr f s
G . (8)
V1 n V1
VO
G 2D 1 D (9)
V1
12
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Como se pode observar na equao (8), devido a queda de tenso na indutncia de disperso,
existe uma perda de razo cclica proporcional a corrente de sada I2. Na Figura 11 ilustrada a
caracterstica de sada do conversor, i.e., o ganho esttico do conversor em funo da perda de razo
cclica para vrios valores de indutncia de disperso.
iab
iLm iLp
Lm Lp
I ab I Pr i I Lm 0. (10)
13
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I Pr i I Lm . (11)
D I 2 1 D I 2 2D 1 I2
I Pr i . I Pr i (12)
n n
I2/n
iPri
DTs Ts
I2/n
I Lm
2D 1 I2 . (13)
n
Dt D Ts Dt1 (14)
diL DiL
vL L (1 D) V1 V2 L (15)
dt D Ts Dt1
D (1 D) (1 2 D) V1 I 2 Lr 2 n I 2 Lr f s
DiL 1 (16)
n L fs L (1 D) V1
14
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D (1 D) (1 2 D) V1sec
DiL (17)
L fs
DiL D 1 D 1 2 D . (18)
D 1 D (1 2 D) V1sec
L . (19)
DiL f s
15
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VC1 (1 D) V1 , (21)
VC 2 D V1 , (22)
Onde, D representa uma razo cclica genrica. Assim, para cada razo cclica especfica
existe uma relao entre as capacitncias que possibilita uma distribuio equilibrada da corrente
fornecida por V1. Como critrio de projeto pode-se adotar a relao de capacitncias para razo
cclica nominal [3].
Considerando o conversor com o capacitor equivalente apresentado na Figura 3, pode-se
dimensionar os capacitores do barramento do lado primrio do transformador. O valor da
capacitncia do capacitor equivalente, e dos capacitores C1 e C2 dado por (23), (24) e (25),
respectivamente.
I
2D(1 D) 2
Ceq n , (23)
DVCeq f s
C1 (1 D) Ceq , (24)
C2 D Ceq . (25)
16
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di2
2 D (1 D) V1sec Rpri i2 Rs i2 L Req i2 (26)
dt
A equao (26) ento reescrita considerando a resistncia RT que corresponde soma das
resistncias Req, Rs e Rpri.
di2
2 D (1 D) V1sec RT i2 L (27)
dt
d i2 i2
2 D d 1 D d V1sec RT i2 i2 L dt
(28)
2 V1sec d (s) 1 2 d (s) s L i2 (s) RT i2 (s) (29)
Desta forma, isolando o termo que relaciona a corrente na fonte V2 e a razo cclica na
equao (29), obtm-se a funo de transferncia para o controle da corrente no indutor L.
i2 (s) 2 V1sec (1 2 D)
(30)
d (s) s L RT
17
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que os tempos DTs e (1 D)Ts . A modelagem por espaos de estado consiste em definir as
equaes para os estados dependentes para cada um dos intervalos estabelecidos na Figura 17.
O circuito equivalente para obteno do modelo de pequenos sinais apresentado na Figura
18. O objetivo desta modelagem o controle da corrente no indutor de sada L2 , no entanto, para
que tal modelo fosse obtido foram considerados quatro estados dependentes, sendo eles: tenses nos
capacitores C1 e C2 , e correntes nos indutores Lm e L2 . Como no idealidades foram consideradas
as resistncias parasitas em cada elemento.
Figura 18 - Circuito equivalente do conversor para obteno do modelo para pequenos sinais.
18
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19
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Assim como na primeira etapa de operao, na terceira etapa ocorre a transio da corrente
nas indutncias de disperso, conforme apresenta a Figura 23 com o seu respectivo circuito
equivalente descrito na Figura 24.
20
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O circuito equivalente para a quarta etapa de operao apresentado na Figura 25 com o seu
respectivo circuito equivalente referenciado ao lado primrio do transformador demonstrado na
Figura 26.
O sistema de equaes pode ser escrito conforme a equao (35), onde x representa o vetor
dos estados a que se deseja controlar.
dx
A x B (35)
dt
Este sistema linearizado em torno do ponto de operao nominal do conversor ao substituir
o vetor x pela expresso apresentada em (36), em tal expresso, x e d representam uma pequena
perturbao em torno do ponto de operao do conversor.
x X x
dx dX dx dx
(36)
dt dx dt dt
D D d
Sabendo que os vetores x e X so definidos por:
vC1 VC1
vC2 VC
x , X 2 (37)
i I
Lm Lm
iL IL
2 2
Com as matrizes de estado ponderadas pelos seus respectivos tempos de atuao, como
observado na Figura 17, so representadas na equaes (38) e (39).
A
1
Ts
Dt1 A1 ( DTs Dt1 ) A2 Dt2 A3 1 D Ts Dt2 A4 (38)
22
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B
1
Ts
Dt1 B1 ( DTs Dt1 ) B2 Dt2 B3 1 D Ts Dt2 B4 (39)
vC1 (s)
vC2 (s)
1
i ( s) s I Dt1 A1 ( DTs D t1 ) A2 Dt 2 A3
1 D Ts Dt 2
A4
Lm
(40)
iL (s)
2
A2 A4 Xd (s) ( B2 B4 )d (s)
A soluo da equao (40) para o modelo de pequenos sinais para o controle da corrente no
indutor L2 apresentada na equao (41).
23
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Para validar o modelo obtido, com auxlio do software PSIM, foi realizada uma simulao
do conversor operando em malha aberta, onde se aplicou, simultaneamente, uma perturbao na
razo cclica do conversor e na funo de transferncia apresentada na equao (41). O resultado
desta simulao apresentado na Figura 28.
Com base no modelo obtido, sua resposta em frequncia foi analisada perante variaes
paramtricas das no idealidades nos elementos de potncia que constituem a topologia do
conversor. Destaca-se que, quanto menores forem os valores da resistncia parasitas, maior ser a
potncia processada, porm, maiores sero os esforos para o controle deste conversor. Estes
resultados so apresentados na Figura 29.
24
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Outra situao, agora para diferentes valores dos capacitores C1 e C2 , tambm foi analisada.
Nota-se que, atravs do diagrama de Bode ilustrado na Figura 30, quanto maior forem os valores de
tais capacitores mais estvel o conversor ser. Haja vista que para capacitncias de maior valor a
fase do sistema se afasta de -180. Entretanto, sabemos que na pratica no recomenda-se capacitores
de valores elevados, em virtude do seu alto custo, peso e volume. Este fato coloca em evidncia a
importncia em se obter de um modelo que represente o conversor de maneira precisa e que permita
o projeto de um controlador que garanta sua estabilidade em toda faixa de operao.
Figura 30 - Resposta em frequncia para o modelo de pequenos sinais para diferentes valores
para os capacitores C1 e C2 .
25
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3 EXEMPLO DE PROJETO
Neste captulo apresentado um exemplo de projeto para o conversor cc-cc meia-ponte
assimtrico com push-pull. De acordo com as especificaes pr-determinadas, realizado o
dimensionamento dos principais componentes do circuito de potncia do conversor e o projeto do
controlador de corrente.
3.1 Especificaes
A partir das especificaes de projeto apresentadas na Tabela 1 realizado o projeto do
conversor proposto. Na Tabela 2 so apresentados os parmetros do transformador.
Parmetros Valor
Potncia de sada P2 = 3 kW
Tenso de sada V2 = 48 V
Parmetros Valor
Com isso, a partir das especificaes de projeto e do circuito equivalente mostrado na Figura
15 possvel calcular a razo cclica nominal.
D 0, 416.
O valor da resistncia no dissipativa dada por (7), responsvel pela perda de razo cclica
do conversor, igual a
26
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V1 400
n 3, 2
L 32 106 H
10,39 DiLmax f s 10,39 9,375 40 103
I 62,5
2 Dnom (1 Dnom ) 2 2 0, 416 (1 0, 416)
Ceq n 3, 2 59,5 106 F .
DVCeq f s 4 40 103
Optou-se por utilizar capacitores de polipropileno com valores iguais a 100 F / 630V, do
fabricante EPCOS.
, foi utilizado o controlador PI, cuja funo de transferncia apresentada na equao (42).
27
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s z
Cv ( s) kc (42)
s
A funo de transferncia de lao aberto no compensada, em funo da no existncia de
filtragem ou condicionamento de sinal na leitura da corrente iL2 , que na prtica dever existir em
Logo, para que a frequncia de cruzamento seja igual a 10kHz o ganho do controlador ser
definido conforme a equao (47).
c
kc 0.01565083245 (47)
c z FTLAnc ( j )
2 2
28
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4 RESULTADOS DE SIMULAO
A fim de validar toda a anlise terica e metodologia apresentada nos captulos anteriores, o
conversor cc-cc meia-ponte assimtrico com push-pull foi simulado no software PSIM e os
resultados de simulao so apresentados neste captulo. Assim, so apresentadas formas de onda
de tenso e corrente nos principais componentes do conversor em estudo operando em regime
permanente. Alm disso, so apresentados resultados de simulao para verificar a resposta
dinmica do sistema de controle.
29
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32
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A Figura 43 apresenta um teste para inverso do fluxo de potncia de negativo (da fonte V2
para a fonte V1) para positivo (da fonte V1 para a fonte V2). Atravs da forma de onda da corrente no
indutor L, verifica-se que a malha de corrente apresenta uma rpida resposta dinmica com
overshoot de aproximadamente 8 A e com um tempo de acomodao de aproximadamente 20 ms.
A Figura 44 apresenta um teste para inverso do fluxo de potncia de positivo (da fonte V1
para a fonte V2) para negativo (da fonte V2 para a fonte V1). Para este teste, o overshoot da corrente
33
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34
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35
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5 CONCLUSES
Este trabalho apresentou o estudo de um conversor cc-cc bidirecional isolado meia-ponte
assimtrico associado com push-pull alimentado em corrente para aplicaes em altas tenses no
barramento de alimentao e elevadas correntes no barramento secundrio. As principais vantagens
do conversor so: o uso de poucos componentes na estrutura topolgica, o emprego do controle por
modulao fixa; e a possibilidade de obteno comutao sob tenso nula (Zero-Voltage Switching -
ZVS) naturalmente.
Foi realizado o estudo detalhado da topologia proposta, onde foram desenvolvidas equaes
matemticas que podem ser utilizadas para o projeto e dimensionamento do conversor. Tambm foi
explorada uma estratgia de controle simples que realizasse o controle da corrente no indutor de
armazenamento de energia.
Durante o estudo, pode-se verificar que o conversor apresenta uma grande sensibilidade
variaes paramtricas, interao entre os elementos do circuito; O que indica a necessidade de um
controle mais elaborado.
A funo de transferncia da planta de controle de corrente no indutor foi modelada, bem
como o projeto do controlador foi realizado. Observou-se que o balano das tenses nos capacitores
de armazenamento de energia ocorreu de forma natural, no necessitando de malha de controle
adicional.
Para validar o estudo da topologia proposta foram realizadas simulaes computacionais em
regime permanente e dinmico. Atravs das simulaes foi possvel validar todos os conceitos
tericos apresentados neste trabalho. Com isso, o funcionamento do conversor foi avaliado como
satisfatrio, logo, possvel concluir que os objetivos foram alcanados, tornando esta topologia
uma alternativa interessante para aplicaes com altas tenses no barramento de alimentao e
elevadas correntes no barramento secundrio.
Os esforos de tenso nos semicondutores diferentes, devido modulao assimtrica. Alm
disso, o conversor apresenta a necessidade de um circuito de grampeamento das tenses nos
interruptores da topologia push-pull quando opera com fluxo de potncia negativo.
36
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6 REFERNCIAS BIBLIOGRFICAS
[1] YILMAZ, M.; KREIN, P.T. Review of the Impact of Vehicle-to-Grid Technologies on
Distribution Systems and Utility Interfaces. Power Electronics, IEEE Transactions on,
vol.28, no.12, p. 5673-5689, Dez. 2013.
[2] BARBI, I. Conversores Estticos cc-cc Bidirecionais. Notas de Aula (Disciplina Tpicos
Especiais em Eletrnica de Potncia: Conversores cc-cc Bidirecionais), Programa de Ps-
Graduao em Engenharia Eltrica - Universidade Federal de Santa Catarina, Florianpolis -
SC, 2014.
[3] BARBI, I.; Souza, F. P. Conversores CC-CC isolados de alta freqncia com comutao
suave. Florianpolis : Ed. dos autores, 1999.
[4] COLLING, Ivan Eidt. Conversor cc-cc meia-ponte ZVS-PWM: anlise, projeto e
experimentao. Dissertao (Mestrado em Engenharia Eltrica), Universidade Federal de
Santa Catarina, Florianpolis - SC, 1994.
37
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38
INSTITUTO DE ELETRNICA DE POTNCIA
Acadmicos:
Delvanei G. Bandeira Jr.
Gilberto Valentim Silva
Roberto Buerger
Disciplina:
EEL410139 T. A. Eletrnica de Potncia: Conversores Estticos CC-CC Bidirecionais
Professor:
Ivo Barbi, Dr.-Ing.
MAIO/2014
Figura 1.33 Valor Eficaz da corrente nos interruptores 3,4, parametrizado em relao
corrente na carga. ......................................................................................................... 19
Figura 1.34: Valor Eficaz da corrente no enrolamento primrio do transformador pela
perda de razo cclica. .................................................................................................. 20
Figura 1.35 Valor Eficaz da corrente no enrolamento secundrio do transformador pela
perda de razo cclica. .................................................................................................. 20
Figura 2.1.1 Circuito equivalente durante as etapas de operao: (a) Interruptor S1 em
conduo e (b) Interruptor S1 bloqueado. ..................................................................... 22
Figura 2.1.2 Diagramas de Bode para a funo de transferncia que relaciona a
corrente no indutor L com a perturbao na razo cclica: (a) diagrama de mdulo (b)
diagrama de fase. .......................................................................................................... 24
Figura 2.1.3 Sinais de comando e formas de onda: (a) Corrente na indutancia L, (b)
sinal do modulador e sinal da portadora. ....................................................................... 25
Figura 2.1.4 Diagramas de Bode do controlador da corrente no indutor Lf: (a) Diagrama
do mdulo e (b) diagrama da fase. ................................................................................ 25
Figura 2.1.5 Diagrama de Bode da funo de transferncia de lao aberto compensada:
(a) Diagrama de mdulo, (b) Diagrama de fase. ........................................................... 26
Figura 2.1.6 Diagrama de blocos do controlador da corrente na indutncia L. ............. 27
Figura 2.1.7 Circuito do grampeador usado para P<0 ................................................... 27
Figura 2.1.1 Diagrama do conversor CC-CC bidirecional Tipo-T/Push-Pull. ................. 28
Figura 3.2.1: Comportamento da corrente de carga ...................................................... 29
Figura 3.2.2: Ondulaa da corrente 2 ....................................................................... 29
Figura 3.2.3: Comparao dos sinais de portadoras e a moduladora ........................... 30
Figura 3.2.4: Tenso aplicada ao primrio do transformador e tenso na entrada
da indutncia 2 ............................................................................................................ 30
Figura 3.2.5: Atuao do grampeador de tenso sobre a chave 5 do Push-Pull ......... 31
Figura 3.2.6: Corrente 1 do resistor 1 do circuito grampeador ............................. 31
3
NDICE
S2
V1 S5
L5
a T1
L2 R2
a b Vab
S3 S4
b
V2
V1 L6
S1 S6
Habilitados:S1+S5 Conduzindo:S1+S5
Figura 1.8 - Etapas de funcionamento (1/6) - P>0.
7
Habilitados:S3+S4+S5+S6 Conduzindo:S3+S4+S5
Figura 1.9 - Etapas de funcionamento (2/6) - P>0.
Habilitados:S2+S6 Conduzindo:S2+D5+S6
Figura 1.10 - Etapas de funcionamento (3/6) - P>0.
Habilitados:S2+S6 Conduzindo:S2+S6
Figura 1.11 - Etapas de funcionamento (4/6) - P>0.
8
Habilitados:S3+S4+S5+S6 Conduzindo:S3+S4+S6
Figura 1.12 - Etapas de funcionamento (5/6) - P>0.
Habilitados:S1+S5 Conduzindo:S1+S5+D6
Figura 1.13 - Etapas de funcionamento (6/6) - P>0.
Aps a anlise das principais etapas de operao, ainda que com algumas
simplificaes, tais como a relao de transformao unitria e a ausncia de
limitadores de tenso, algumas simulaes exploratrias podem ser efetuadas,
conforme sequncia Figura 1.14 a Figura 1.16.
9
Habilitados:S1+S5 Conduzindo:S1+S5
Figura 1.17 - Etapas de funcionamento (1/4) - P<0.
11
Habilitados:S3+S4+S5+S6 Conduzindo:S3+S4+S5
Figura 1.18 - Etapas de funcionamento (2/4) - P<0.
Habilitados:S2+S6 Conduzindo:S2+S6
Figura 1.19 - Etapas de funcionamento (3/4) - P<0.
Habilitados:S3+S4+S5+S6 Conduzindo:S3+S4+S6
Figura 1.20 - Etapas de funcionamento (4/4) - P<0.
12
( 1.5.2)
D
Figura 1.25 - Perda de razo cclica - Push-Pull - P>0.
( 1.5.3)
4 ( 1.5.4)
4
( 1.5.5)
2 ( 1.5.6)
( 1.5.7)
4 ( 1.5.8)
1 ( 1.6.2)
2
2
Isolado o indutor e aplicando uma parametrizao em funo dos parmetros
constantes na equao ( 1.6.2), obtm-se a equao ( 1.6.2).
16
1 ( 1.6.3)
2
2
O grfico da Figura 1.28 demonstra o comportamento da indutncia parametrizada em
funo da razo cclica, para diferentes valores de perda de razo cclica.
Figura 1.28 Variao da indutncia para diferentes pela razo cclica, para diferentes valores de perda
de razo cclica.
Figura 1.29 Circuito equivalente por valores mdios do conversor bidirecional Tipo T Push-Pull.
Aplicando a lei de Kirchhoff das tenses no circuito equivalente da Figura 1.29 resulta
na equao ( 1.7.1).
1 ( 1.7.1)
. . ( 1.8.1)
1 4 .
. .
. . 4 .
3 6 5 ( 1.8.2)
Figura 1.31 Valor Eficaz da corrente nos interruptores , , parametrizado em relao corrente na
carga.
18
2 1 ( 1.9.2)
Figura 1.32 Valor Eficaz da corrente nos interruptores , , parametrizado em relao corrente na
carga.
( 1.9.3)
1
, .
.
1 ( 1.9.4)
,
2
19
Figura 1.33 Valor Eficaz da corrente nos interruptores , , parametrizado em relao corrente na
carga.
3 3 2 ( 1.10.2)
Figura 1.34 Valor Eficaz da corrente no enrolamento primrio do transformador pela perda de razo
cclica.
3 3 2 ( 1.10.4)
Figura 1.35 Valor Eficaz da corrente no enrolamento secundrio do transformador pela perda de razo
cclica.
21
2 ( 1.11.2)
,
2
3 3 2 ( 1.11.3)
,
3
, 32,01 A 35,84 A
, 20,5 A 19,66 A
, 34,64 A 34,33 A
, 25 A 24,68 A
48,99 A 48,09 A
48,99 A 48,09 A
Tabela 1 Comparativo de esforos obtidos calculados e obtidos por simulao.
2. MODELAGEM E CONTROLE
Em conversores CC-CC bidirecionais o objetivo consiste em controlar a corrente na
indutncia , para controlar o fluxo de energia entre as fontes de tenso na entrada e
na sada. Conforme foi verificado na seo 1.7 a corrente sensvel variaes na
razo cclica, tornando invivel a operao deste conversor em malha aberta.
O controle da corrente feito ajustando a corrente de referncia da malha de
controle, se ela for positiva o fluxo de energia ocorre da fonte para . Se ela for
negativa a fonte recebe a energia de . Esta estratgia de controle necessita da
realimentao do valor mdio da corrente, e produz uma razo cclica na sada do
controlador, aqui denominada de razo cclica mdia.
Figura 2.1.1 Circuito equivalente durante as etapas de operao: (a) Interruptor S1 em conduo e (b)
Interruptor S1 bloqueado.
( 2.1.2)
0
( 2.1.3)
( 2.1.4)
( 2.1.5)
( 2.1.6)
( 2.1.7)
120
100
80
60
40 Teorico
20 AC Sweep
0
3 4
1 10 100 110 110
90
100
110 Teorico
AC Sweep
120
3 4
1 10 100 110 110
Figura 2.1.2 Diagramas de Bode para a funo de transferncia que relaciona a corrente no indutor L
com a perturbao na razo cclica: (a) diagrama de mdulo (b) diagrama de fase.
( 2.1.10)
Figura 2.1.3 Sinais de comando e formas de onda: (a) Corrente na indutancia L, (b) sinal do modulador e
sinal da portadora.
A Figura 2.1.3 demonstra que a ondulao de corrente ocorre em um perodo
que equivale ao duplo da frequncia de chaveamento. Desta forma, a frequncia de
cruzamento pode ser escolhida at o valor da metade da frequncia de comutao, ou
seja:
( 2.1.12)
2
20
20
Ci
40
3 4
1 10 100 110 110
20
40
60
80 Ci
100
3 4
1 10 100 110 110
Figura 2.1.4 Diagramas de Bode do controlador da corrente no indutor Lf: (a) Diagrama do mdulo e (b)
diagrama da fase.
26
40 10 1 ( 2.1.14)
375
150
100
50
FTMA
0
0
50
3 4
1 10 100 110 110
100
150
FTMA
200
3 4
1 10 100 110 110
Figura 2.1.5 Diagrama de Bode da funo de transferncia de lao aberto compensada: (a) Diagrama de
mdulo, (b) Diagrama de fase.
Desta forma, foi obtida a frequncia de corte equivalente a 4,3 kHz. A margem
de fase calculada com a equao ( 2.1.15).
180 | 2 | ( 2.1.15)
47,2 ( 2.1.16)
3. RESULTADOS DE SIMULAO
I 50 A
5%
C C 2 H
R 2000
Tabela 2 Especificaes do conversor CC-CC MMC simulado.
I(L2) Iref
60
40
20
-20
-40
-60
I(L2) Iref
51
50.5
50
49.5
49
Vport Vmod
1.5
0.5
Vab V0
400
200
-200
-400
Vs5 Vsnubber
300
200
100
0
V0
200
150
100
50
0
0.09228 0.0923 0.09232
Time (s)
I(R6)
0.171
0.1708
0.1706
0.1704
0.1702
0.17
0.1698
2 ( 3.2.1)
4. CONCLUSO
Foi verificado que o conversor CC-CC bidirecional Tipo T Push-Pull possui trs
nveis de tenso na sada. A frequncia da corrente duas vezes maior do que a
frequncia de comutao, o que resulta em um indutor com indutncia at duas vezes
menor.
32
5. BIBLIOGRAFIA
[1] Barbi. Ivo, Notas de Aula: T.A. Eletrnica de Potncia: Conversores Estticos CC-
CC Bidirecionais - Santa Catarina. Universidade Federal de Santa Catarina,
14/05/2014.
UNIVERSIDADE FEDERAL DE SANTA CATARINA
INSTITUTO DE ELETRNICA DE POTNCIA
RELATRIO
DISCIPLINA
Professor:
Ivo Barbi
Equipe:
Davi Rabelo Joca
Jssica Santos Guimares
Rodrigo de Souza Santos
1. Introduo
Atualmente, a converso de energia atravs de conversores
estticos cc-cc possui grande importncia. Dentre as diversas
aplicaes, pode-se destacar a rea de telecomunicaes. Nessas
aplicaes, comumente, conversores estticos isolados so
empregados.
As razes para a utilizao dessa classe de conversores, alm da
isolao galvnica inerente a isolao, a possibilidade de obter
maior ganho esttico, aproveitando-se da relao de transformao e
a reduo dos esforos de tenso sobre os interruptores.
Alm disso, torna possvel a utilizao de diversas configuraes
de topologias para estgios a montante e a jusante do transformador,
ampliando a variedade de aplicaes.
Figura 1.3 Conversor cc-cc isolado bidirecional hbrido a capacitor chaveado em ponte
completa.
Figura 1.4 Conversor cc-cc isolado unidirecional hbrido a capacitor chaveado em meia
ponte.
Captulo 2
2. Anlise Esttica
Nesse captulo ser realizada a anlise esttica do conversor
estudado. A anlise compreende o estudo do modulador, os possveis
estados topolgicos e as principais formas de onda do conversor.
D= (2.2)
7
Captulo 3
3. Modelagem em Espao de
Estados
Feita a anlise dos estados topolgicos, torna-se necessrio obter
as equaes que representam o comportamento do conversor, em
regime esttico ou dinmico. Para isso, o conversor ser modelado
em espao de estados, que uma ferramenta eficiente e sistemtica
para obteno dos modelos requeridos.
Figura 3.2 Circuito equivalente para a primeira etapa de operao sem o capacitor
redundante.
diLr n2 Lr
Lr = 2 (R iL + V2 ) (3.3)
dt n Lr + L
diL L
L = 2 (R iL + V2 ) (3.4)
dt n Lr + L
diLr 1 L
Lr = (n V1 n vC2 V2 R iL )(3.11)
dt n (L + n2 Lr )
diL L
L = (n V1 n vC2 V2 R iL ) (3.12)
dt L + n2 Lr
1 nL
L (n2 Lr +L) L1 (n2 LLr +L)
| {z }
B2
diLr 1 n2 Lr
Lr = (V2 + R iL ) (3.16)
dt n (L + n2 Lr )
diL L
L = (V2 + R iL ) (3.17)
dt L + n2 Lr
2 3
1 1
RC3 C2 RC3 C2 0 0
6 7
6 1 1
0 0 7
6 RC3 C3 RC3 C3 7
x_ = 6 7 x +
6 0 0 0 L1r (nnL rR 7
4 2 L +L)
r 5
0 0 0 L1 (n2 LLR
r +L)
| {z }
2 A3
3 (3.18)
0 0
6 7
6 0 0 7
6 7
6 7 U
6 0 1 2nLr 7
4 Lr (n Lr +L) 5
0 L1 (n2 LLr +L)
| {z }
B3
diLr 1 n2 L
Lr = (V2 + R iL n vC2 ) (3.21)
dt n (L + n2 Lr )
diL 1 L
L = (n vC2 V2 R iL ) (3.22)
dt n L + n2 Lr
x_ = A x + B U (3.24)
Sendo definida a mdia ponderada dos estados definida como:
0 =AX+BU (3.31)
O vetor X representado pelo valor esttico dos estados no
ponto de operao, conforme representado em (3.32).
28
2 3
VC2
6 7
6 VC3 7
X=6
6
7
7 (3.32)
4 ILr 5
IL
ILr = 0 (3.34)
n D V1
V2
IL = 2 (3.35)
R
Novamente refora-se que em regime permanente,
independentemente do valor D, as tenses nos capacitores sempre
sero iguais metade da tenso V1.
A corrente no indutor L, que indica a potncia transferida entre
as fontes, controlada diretamente pelo valor de D sendo ponderada
pela relao de transformao n .
Figura 3.8 Simulao da corrente de carga em funo do duty-cycle para vrios valores
de resistncia do indutor.
Figura 3.9 Simulao da corrente de carga em funo do duty-cycle para vrios valores
de resistncia do indutor.
Figura 3.10 Simulao da corrente de carga em funo do duty-cycle para vrios valores
de resistncia do indutor.
Figura 3.11 Simulao da corrente de carga em funo do duty-cycle para vrios valores
de resistncia do indutor.
x_ = A x + B U (3.37)
x=X+x
^ (3.38)
+ d^
d=D (3.39)
Em seguida o sistema deve ser linearizado. Porm, para a
representao em espao de estados, a soluo genrica em bem
conhecida [5]. A soluo para o conversor em estudo dada por
(3.40).
33
2 3
vC2
6 vC2 7 (A2 + A4 ) (A1 + A2 )
s6 7=Ax ^ + ^
X d+
4 iLr 5 2 2 (3.40)
i2
(B2 + B4 ) (B1 + B2 )
+ U d^
2 2
vC2 (s)
=0 (3.41)
^
d(s)
vC2 (s)
=0 (3.42)
^
d(s)
iLr (s)
=0 (3.43)
^
d(s)
iL(s) V1 n
= (3.44)
^
d(s) 2 R + s (2 Lr n2 + 2 L)
Figura 3.12 Simulao da corrente de carga em funo do duty-cycle para vrios valores
de resistncia do indutor.
Captulo 4
4. Projeto do Conversor
Neste captulo apresentado um exemplo de projeto para o
conversor CC-CC bidirecional simtrico hbrido a capacitor chaveado
em ponte completa.
4.1 ESPECIFICAES
Parmetro Valor
Tenso na fonte de entrada V1 = 800 V
Frequncia de chaveamento fs = 80 kHz
Relao de transformao n = 1:7
Variao de corrente no indutor iL = 30 %
Razo cclica D = 0,88
Potncia na sada Po = 2400 W
Tenso na fonte de sada V2 = 48 V
Corrente na sada I2 = 50 A
iL
vL = L (4.1)
t
Da anlise da Figura 4.1, pode-se afirmar que
iL
Vo V2 = L . (4.2)
T
D
2
Onde as tenses indicadas so definidas por (4.3) e (4.4).
V1
Vo = n (4.3)
2
V1
V2 = n D (4.4)
2
Substituindo (4.3) e (4.4) em (4.2) e isolando o valor da
indutncia L , pode-se obter (4.5).
V1 (1 D) D
L= (4.5)
4 iL fs
37
L = 3; 35 H (4.6)
Lr = 500 nH (4.7)
C1 = C2 = 400 F (4.8)
38
C3 = 100 F (4.9)
Grampeador Especificao
Rg 2,2 k
Cg 100 nF
Indutncia de
Lr = 500 nH -
disperso
Capacitores de C1,2 = 4 x 100 F B32778G4117
barramento / RSE = 4 m (EPCOS)
Capacitor C3 = 100 F / B32778G4117
flutuante RSE = 4 m (EPCOS)
Interruptores
RDS(on) = 20 m IPB60R199CPA
(S1, S2, S3, S33, S4,
(Infineon)
S44)
Interruptores IPI64N25S3-20
RDS(on) = 20 m
(S5, S6) (Infineon)
Indutncia na
6,7 H -
sada (L)
Circuito Rg = 2,2 k e
Vg = 160 V
grampeador 100 nF
40
V1
n
G (s) = 2 (4.10)
R2 + s (n2 Lr + L)
Captulo 5
5. Resultados de Simulao
Nesta seo, sero apresentados os principais resultados da
simulao do conversor. Os parmetros da simulao foram
previamente definidos no Captulo anterior.
5.1 SIMULAES
(a)
44
(b)
Figura 5.1 Esquemtico do circuito de potncia. (a) Primrio (b) Secundrio.
Figura 5.3 Formas de onda da corrente no indutor, referncia de controle e razo cclica.
Figura 5.5 Formas de onda da corrente no indutor, referncia de controle e tenses nos
capacitores.
Figura 5.6 Formas de onda das tenses aplicada ao primrio do transformador e a tenso
retificada aplicada ao secundrio.
Figura 5.7 Formas de onda das tenses aplicada ao primrio do transformador, a tenso
retificada aplicada ao secundrio e a tenso no capacitor de grampeamento.
Figura 5.8 Formas de onda das tenses no circuito grampeador e nos interruptores no
lado secundrio, considerando potncia negativa.
48
Captulo 6
6. Concluses
Este relatrio teve o objetivo de apresentar uma nova topologia
de conversor cc-cc bidirecional isolado simtrico. Alm de propor a
topologia, o relatrio tambm contm um estudo sucinto quanto
anlise esttica, modelos equivalentes e dimensionamento, sempre
com validao dos resultados atravs de simulaes numricas.
Uma das principais novidades na topologia proposta a utilizao
de um estgio a capacitor chaveado no sub-estgio conectado ao
primrio do transformador. Esse tipo de topologia, que foi concebida
a partir dos multiplicadores de tenso, permite a utilizao de
tenses maiores na entrada sem aumentar os esforos de tenso nos
semicondutores. A Figura 6.1 apresenta uma extenso da topologia
proposta, onde cada interruptor fica submetido a um tero da tenso
de entrada.
Uma desvantagem do estgio a capacitor chaveado so os esforos
de corrente sobre os interruptores. necessrio que a constante de
tempo do circuito SC (Capacitor mais resistores parasitas) seja
muito maior do que o tempo de conduo ou bloqueio dos
interruptores. Isso pode ser obtido atravs do aumento das
capacitncias, das resistncias parasitas ou pelo aumento da
frequncia de comutao do conversor.
Outro ponto interessante nesse conversor a independncia da
tenso dos capacitores em relao ao fluxo de energia. Foi visto que,
tanto na anlise esttica quanto na anlise dinmica, que os
capacitores no sofrem influncia do parmetro D, que responsvel
pelo controle da energia trocada entre as duas fontes. Grande parte
dessa vantagem provavelmente fruto da modulao Phase-Shift,
que faz com que os interruptores do lado primrio sempre possuam
razo cclica igual a 0,5.
49
Figura 6.1 Conversor proposto com mais estgios no conversor do lado primrio.
Referncias Bibliogrficas
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Bidirecionais. Universidade Federal de Santa Catarina, 2014.
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Asymmetrical Half-Bridge Converters With Voltage
Autobalance for High Input-Voltage Applications, IEEE Trans.
Power Electron., vol. 28, no. 8, pp. 36653674, Aug. 2013.
[3] X. Zhang, C. Yao, C. Li, L. Fu, F. Guo, and J. Wang, A Wide
Bandgap Device-Based Isolated Quasi-Switched-Capacitor
DC/DC Converter, IEEE Trans. Power Electron., vol. 29, no.
5, pp. 25002510, 2014.
[4] I. Barbi and F. Pttker, Conversores CC-CC Isolados de Alta
Freqncia com Comutao Suave, vol. Um, 1 vols.
Universidade Federal de Santa Catarina, 1999.
[5] R. W. Erickson and D. Maksimovic, Fundamentals of Power
Electronics, Second. Kluwer Academic Publishers, 2001.
[6] S. Ben-Yaakov, Behavioral Average Modeling and Equivalent
Circuit Simulation of Switched Capacitors Converters, IEEE
Trans. Power Electron., vol. 27, no. 2, pp. 632636, 2012.
[7] G. B. Martins, Estudo de Conversores a Capacitores
Chaveados, Dissertao de Mestrado, UFSC - Universidade de
Santa Catarina, Florianpolis, SC, 2013.