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CIRCUITOS DIGITALES II
PROYECTO FINAL
I. INTRODUCCION
II. OBJETIVOS
Multivibrador Astable
[segundos]
La frecuencia con que la seal de salida oscila est dada por la frmula:
el perodo es simplemente:
Tambin decir que si lo que queremos es un generador con frecuencia
variable, debemos variar la capacidad del condensador, ya que si el
cambio lo hacemos mediante los resistores R1 y/o R2, tambin cambia
el ciclo de trabajo o ancho de pulso (D) de la seal de salida segn la 4
siguiente expresin:
Hay que recordar que el perodo es el tiempo que dura la seal hasta
que sta se vuelve a repetir (Tb - Ta).
Multivibrador monoestable
FLIP FLOP
Las figuras nos muestran del lado izquierdo de la lnea verde el pin de
entrada de Reloj del FF, el lado derecho nos muestra el circuito interno
del FF.La diferencia entre CK y CK se debe al retraso en la propagacin
que cualquier compuerta tiene, desde que se aplica una seal en la
entrada, hasta que esta se refleja en al salida. Esta diferencia en tiempo,
nos permite obtener un pulso de salida solamente cuando ocurre la
transicin para la que estn diseados, y por lo tanto accionar el FF.
Registro Bsico NAND tipo Sncrono
Dejaremos de lado la conexin interna de los FF, ya que para nuestra
comodidad, todos podemos encontrarlos en forma de circuitos
integrados, as que nos ocuparemos solamente de su
funcionamiento.La siguiente figura nos muestra un Registro Bsico
Sincronizado por una seal de reloj. Es la forma ms bsica de un FF
controlado por la seal de reloj. (La falta del crculo en la entrada de
CLK significa que slo ser activa en los TPP) (Slo se muestra la salida
Normal (Q), ya que como dijimos, la salida negada siempre es inversa)
EL CONTADOR DIGITAL
Fig. 1
Fig. 2
14
Fig. 3
Fig. 4
16
Fig. 1
18
ENTRADA VISITANTE
CADA INGRESO EL
CONTADOR CRECE
PERMANECE ENCENDIDO EL
DISPLAY EN A=10 NO
LED VERDE
SI
PISO CON CUPOS PARA
INGRESO
ENCIENDE LED ROJO
4.3. MATERIALES
Transistor 2N3904
2 Display siete segmentos
Integrado 74LS08 (AND)
Integrado 74LS192
Timer 555
Integrado 7447
Switch
2 LED
Resistencia 1M, 100K, 10K, 330
Capacitor 0.22uF 19
R2 U6 U6 U2 U2
R2 15 3 7 13
10k 15 3 D0 7 Q0 13 A QA
10k D0 Q0 1 A 2 QA 1 12
1 2 D1 1 Q1 12 B QB
D1 Q1 10 B 6 QB 2 11
U7 10 6 D2 2 Q2 11 C QC
D2 Q2 9 C 7 QC 6 10
8
U7 9 7 D3 6 Q3 10 D QD
8
D3 Q3 D QD 4 9 (COM)
4 9 BI/RBO QE (COM)
4 3 5 BI/RBO 12 QE 5 15
4 3 R Q 5 12 UP 5 TCU 15 RBI QF
R Q UP TCU 4 RBI 13 QF 3 14
VCC
4 13 DN 3 TCD 14 LT QG
VCC
7 DN TCD 11 LT QG
7 DC 11 PL
DC R1 R6 PL 14 7447
R1 R6 14 MR 7447
100K 5 1M MR
5 CV
100K CV 1M 74LS192
74LS192 (COM)
(COM)
2 6
TR TH
GND
2 6
TR TH
GND
1
U3 U5
1
U3 15
U5 3 7 13
ENTRADA 15 3 D0 7 Q0 13 A QA
D0 Q0 1 A 2 QA 1 12
ENTRADA 1 2 D1 1 Q1 12 B QB
10 6 2 11
IMPLEMENTACION
D1 Q1 D2 B QB C QC
10 6 9 2 Q2 7 11 6 10
C1 D2 Q2 D3 C
Q3 QC D QD
C1 9 7 6 10 4 9
0.22uf D3 Q3 D QD BI/RBO QE
0.22uf 5 4 12 9 5 15
UP BI/RBO QE RBI QF
5 12 4 5 TCU 15 3 14
UP TCU DN RBI 13 QF LT QG
4 13 11 3 TCD 14
DN TCD PL LT QG
11 14 7447
PL MR
14 7447
MR
R3 74192
R3 74192
10k
10k
U8 R9(1)
8
U8 R9(1)
8
4 3
4 3 R Q
VCC
R Q
7
VCC
7 DC
DC R4 R5 R9
R4 100K R55 1M
U1:A R9 330
5 CV U1:A
100K CV 1M 2 330
2 3
3 1
5
4
5
4
2 6
TR TH
GND
2 6 74LS08 U1:B
TR TH
GND
74LS08 U1:B 74LS08 D1
1
555 74LS08 D1 DISPONIBLE
1
555 DISPONIBLE
SALIDA
SALIDA C2
C2 0.22uF
6
0.22uF
Q1
6
Q1
R7 R8
R7 R8 330
10k 330
10k
2N3904
2N3904 D2
D2 LLENO
LLENO
CONTADOR DIGITAL
PROYECTO FINAL
CIRCUITOS DIGITALES II
R2 U6 U2
10k 15 3 7 13
D0 Q0 A QA
1 2 1 12
D1 Q1 B QB
10 6 2 11
U7 D2 Q2 C QC
9 7 6 10
8
D3 Q3 D QD
4 9 (COM)
BI/RBO QE
4 3 5 12 5 15
R Q UP TCU RBI QF
4 13 3 14
VCC
DN TCD LT QG
7 11
DC PL
R1 R6 14 7447
MR
100K 5 1M
CV
74LS192
(COM)
2 6
TR TH
GND
1
U3 U5
15 3 7 13
ENTRADA D0 Q0 A QA
1 2 1 12
D1 Q1 B QB
10 6 2 11
D2 Q2 C QC
C1 9 7 6 10
D3 Q3 D QD
0.22uf 4 9
BI/RBO QE
5 12 5 15
UP TCU RBI QF
4 13 3 14
DN TCD LT QG
11
PL
14 7447
MR
R3 74192
10k
U8 R9(1)
8
4 3
R Q
VCC
7
DC
R4 R5 U1:A R9
100K 5 1M 330
CV
2
3
1
5
4
2 6
TR TH
GND
74LS08 U1:B
74LS08 D1
1
555 DISPONIBLE
SALIDA
C2
0.22uF
6
Q1
R7 R8
330
10k
2N3904
D2
LLENO
CONTADOR DIGITAL
PROYECTO FINAL
CIRCUITOS DIGITALES II