Sistemas Digitales EIE 348-2

Presentación de la asignatura y del profesor

Prof. Sebastián Matus Toro

Escuela de Ingeniería Eléctrica – PUCV
Curso obligatorio de Pregrado
 Presentación del profesor
Profesor: Sebastián Matus Toro

Horario de consultas

Además del horario de clases, el profesor estará disponible para resolver sus
dudas los días martes y jueves de 10:00 a 13:00 horas en el Laboratorio de
Control Automático de la Escuela de Ingeniería Eléctrica.

Email de contacto

Adicionalmente, pueden realizar sus consultas al email sebastian.matus@pucv.cl

Ayudante

El ayudante del curso será Cristian Turra. Su correo es cristian.turra.guarda@gmail.com

Sistemas Digitales – Prof. Sebastián Matus

 Resultados de aprendizaje
Al finalizar el curso, los estudiantes serán capaces de:

 Desarrollar sistemas digitales a partir de procedimientos de diseño, que

serán capaces de resolver problemas del ámbito de la Ingeniería
eléctrica/electrónica.
 Describir el funcionamiento de los sistemas digitales a partir de sus
componentes individuales, con la finalidad de reconocer el funcionamiento
del sistema en su totalidad.
 Implementar sistemas digitales con puertas lógicas y/o biestables, para la
resolución de problemas que requieren el uso de la lógica digital.
 Plantear sistemas digitales en base a modelos de sistemas reales para
optimizar procesos del ámbito de la ingeniería eléctrica/electrónica.

Sistemas Digitales – Prof. Sebastián Matus

 Temario del curso
CAPÍTULO 1: INTRODUCCIÓN A LOS CONCEPTOS DIGITALES
1.1 Magnitudes binarias y niveles lógicos
1.2 Operaciones y funciones lógicas
1.3 Circuitos integrados e instrumentación

CAPÍTULO 2: SISTEMAS DE NUMERACIÓN, OPERACIONES Y CÓDIGOS

2.1 Sistemas de numeración decimal, binario, octal y hexadecimal
2.2 Conversiones entre sistemas de numeración
2.3 Aritmética binaria (suma, resta, multiplicación y división)
2.4 Códigos BCD, Gray y ASCII

CAPÍTULO 3: REPRESENTACIÓN EN PUNTO FLOTANTE

3.1 Notación de cantidades fraccionarias y en formato punto flotante
3.2 Rango de valores representables en un registro Punto Flotante
3.3 Representación normalizada IEEE 754
3.4 Representación de valores especiales: +Infinito y –infinito
3.5 Valores ilegales NaN: Not a Number

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 Temario del curso
CAPÍTULO 4 ÁLGEBRA DE BOOLE Y SIMPLIFICACIÓN LÓGICA
4.1 Operaciones y expresiones booleanas
4.2 Leyes y reglas del álgebra de Boole
4.3 Teoremas De Morgan
4.4 Análisis booleano de circuitos lógicos
4.5 Simplificación lógica mediante el álgebra booleana y mediante Mapas de
Karnaugh

CAPITULO 5 PUERTAS LÓGICAS

5.1 Puertas lógicas básicas NOT, AND, OR
5.2 Puertas NOR, NAND, XOR, XNOR
5.3 Familias de lógica de función fija TTL y CMOS (análisis de datasheets y
parámetros)

CAPITULO 6 ANÁLISIS DE LA LÓGICA COMBINACIONAL

6.1 Circuitos lógicos combinacionales básicos
6.2 Tablas de verdad, cronogramas de tiempo, circuito
6.3 Implementación de la lógica combinacional
6.4 Propiedad universal de las puertas NAND y NOR

Sistemas Digitales – Prof. Sebastián Matus

 Temario del curso
CAPITULO 7 FUNCIONES DE LA LÓGICA COMBINACIONAL
7.1 Sumadores y comparadores combinacionales
7.2 Codificadores y decodificadores
7.3 Convertidores de código y comprobadores de paridad
7.4 Multiplexores y demultiplexores

CAPITULO 8 LATCHES, FLIP-FLOPS Y TEMPORIZADORES

8.1 Componentes básicos de la lógica secuencial
8.2 Latches RS, D, T
8.3 Flip-flops RS, JK, D, T
8.4 Aplicaciones típicas con flip-flops
8.5 Monoestables y temporizadores

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 Temario del curso

CAPITULO 9 APLICACIONES DE CIRCUITOS SECUENCIALES

9.1 Contadores
9.2 Registros de desplazamiento
9.3 Unidades aritméticas ALU

CAPITULO 10 ANÁLISIS Y SÍNTESIS DE CIRCUITOS SECUENCIALES

10.1 Concepto de máquinas de estados finitos
10.2 Modelos secuenciales y sus representaciones
10.3 Proceso de análisis de circuitos secuenciales
10.4 Proceso de síntesis (diseño) de circuitos secuenciales

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 Evaluación

Cátedras. Tres evaluaciones escritas (Certámenes con pauta):

• P1 = 26% de la nota de presentación, fecha 10/10/2018.
• P2 = 22% de la nota de presentación, fecha 14/11/2018.
• P3 = 22% de la nota de presentación, fecha 12/12/2018.

Talleres en clases, previo a la prueba de cátedra, con la misma estructura.

o T1 = 5% de la nota de presentación, fecha 03/10/2018.
o T2 = 5% de la nota de presentación, fecha 07/11/2018.
o T3 = 5% de la nota de presentación, fecha 5/12/2018.

Evaluación de actividades de laboratorio.

o Desarrollo de proyecto. Especificaciones en Aula Virtual. El laboratorio vale un
15% de la nota de presentación

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 Evaluación
Nota de Presentación (60%)
NP =(P1*0.26)+(P2*0.22)+(P3*0.22)+(T1*0.05)+(T2*0.05)+(T3*0.05)+(L1*0.05)+(L2*0.05)+(L3*0.05)

Examen (40%)
Los contenidos del examen corresponden a lo visto en todas las unidades del curso.
Condiciones de eximición

Nota de presentación mayor o igual a 5,5. No obstante, cualquier ofrecimiento de

eximición a examen con una nota inferior a 5.5, estará supeditado a una asistencia a
clases mayor o igual al 75%.

Nota: Esto puede estar sujeto a cambios durante el semestre

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 Evaluación
Nota de Presentación (60%)
NP =(P1*0.26)+(P2*0.22)+(P3*0.22)+(T1*0.05)+(T2*0.05)+(T3*0.05)+(L1*0.05)+(L2*0.05)+(L3*0.05)

Examen (40%)
Los contenidos del examen corresponden a lo visto en todas las unidades del curso.
Condiciones de eximición

Nota de presentación mayor o igual a 5,5.

No obstante, cualquier ofrecimiento de eximición a examen con una nota inferior a 5.5,
estará supeditado a una asistencia a clases mayor o igual al 75%.

Nota: Esto puede estar sujeto a cambios durante el semestre

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 Bibliografía
Libro base:

Título: “Fundamentos de Sistemas Digitales”, Onceava edición.

Autor: Thomas Floyd

Editorial: Prentice Hall

Bibliografía complementaria:

Título: “Problemas de Circuitos y Sistemas Digitales”, España, 1999

Autor: Carmen Baena

Título: “Sistemas Electrónicos Digitales”, España, 2008

Autor: Enrique Mandado

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