CLOCK SEÑALES Y CIRCUITOS RELACIONADOS

SEÑAL (CLK) DE RELOJ

• Onda cuadrada periódica que conmuta indefinidamente de (0  1) y de (1  0) a

intervalos fijos.

• Actúa en sistemas, circuitos y dispositivos secuenciales sincrónicos, haciendo que

las transiciones de estado ocurran solo cuando su valor sea (0) o (1) o también,
cuando se presenten los flancos de subida o de bajada.

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SEÑAL (CLK) DE RELOJ (Cont.)

Nivel alto → Valor o rango de tensión máximo, definido para la señal.

Período → Tiempo entre transiciones sucesivas, de igual dirección.
Frecuencia → Inverso del período o número de pulsos por segundo (Hz)..
Ancho de pulso → Tiempo de un periodo en que la señal está en nivel alto.
Ciclo de servicio → Relación entre ancho del pulso y período de la señal.
Transición positiva → Cambio de la señal, de nivel bajo a alto adyacentes.
Pulso positivo → Cambios de la señal, de nivel bajo a alto y a bajo adyacentes.

CMRE 2
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SEÑAL (CLK) DE RELOJ (Cont.)

Hipótesis.
El funcionamiento sincrónico de los sistemas secuenciales, supone que:

• El estado sólo cambia una vez por ciclo de reloj y el cambio es simultáneo en
todos los dispositivos secuenciales (compuestos por biestables).
• Tras un cambio de estado, las entradas de dichos biestables tienen tiempo de
alcanzar un valor estable antes del siguiente cambio de estado.

CMRE 3
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CIRCUITOS ACTIVADOS POR SEÑAL DE RELOJ (CLK)

ACTIVADO POR REACCIONA ANTE SEÑAL DE RELOJ (CLK)

Nivel alto Uno (1) lógico

Nivel Bajo Cero (0) lógico

Pulso positivo Cambio 0-1-0

Pulso Negativo Cambio 1-0-1

Flanco de subida Transición de 0 a 1

Flanco de bajada Transición de 1 a 0

CMRE 4
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GENERADOR DE PULSOS COMO SEÑAL DE RELOJ

Algunas veces llamado Base de tiempo, consta de:

• Un oscilador que genera una frecuencia alta y estable.

• Un conformador de pulsos o adaptador de impedancias
• Un divisor de frecuencia en partes exactas para lograr la frecuencia requerida.

El generador de pulsos puede ser fácilmente derivado de varias formas:

• A partir de la línea de red domestica (50/60 Hz), que va a alimentar al equipo.

• Utilizando resonadores cerámicos para obtener frecuencias de oscilación estables.
• Haciendo uso de las características naturales del cristal de cuarzo, en circuitos y
equipos alimentados por baterías.

CMRE 5
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RELOJ DE LÍNEA DE 1 HZ

• Se llama reloj de línea porque se deriva de la línea AC que opera a 50/60 Hz.
• Se usa tecnología CMOS, por mayor rango de tensión de alimentación, por su alta
impedancia a los parásitos y por su bajo consumo.
• (RS), (R1), el diodo Zener (DZ) y la compuerta (CD4093B) actuando como
inversor, conforman un mejorador de pulsos de red recortados a 4,7 V.
• La compuerta entrega pulsos con flancos verticales y frecuencia de 50/60 Hz.
• Los pulsos de salida se llevan a un divisor por 5/6 y de ahí a otro divisor por 10
para obtener la frecuencia de 1Hz.

CMRE 6
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RELOJ DE LÍNEA DE 1 HZ Y SU INVERSA

Se obtienen un par de señales complementarias (𝐶𝐿𝐾) y (𝐶𝐿𝐾 ) a partir de:

• Bobinados secundarios del transformador de alimentación
• Reguladores Zener de 5,1 V.
• Compuertas Schmitt, usadas como separador para evitar el efecto de carga.
• Divisores de frecuencia para obtener la de 1 Hz.

CMRE 7
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RELOJ DE LÍNEA DE 1 HZ Y SU INVERSA (Cont.)

• Se extraen las señales (𝐶𝐿𝐾) y su inversa (𝐶𝐿𝐾 ) de la línea de red, por medio de
secundario con derivación central, para mejorar el retardo que se introduciría al
emplear un inversor lógico a la salida de (𝐶𝐿𝐾).
• La señal (𝐶𝐿𝐾) de 50/60 Hz se aplica a la entrada del divisor octal Johnson
CD4022B, se elige la conexión adecuada para dividir por 5 o por 6 y así obtener
10 Hz en la salida (CO).
• El divisor decimal Johnson CD4017B se conecta para dividir la frecuencia de su
señal de entrada, por 10.
• Así se produce una señal de salida de un 1 Hz que sirve muy bien como referencia
muy exacta de 1 segundo de tiempo.

NOTA IMPORTANTE.
Hoy en día, la mayoría de equipos, permiten seleccionar frecuencia de red 50/60 Hz.
Si selecciona 50 Hz en un país de 60 Hz, un reloj tendría 72 p/s y se adelantaría.
Si selecciona 60 Hz en un país de 50 Hz, ¿Que pasaría con el reloj?.

CMRE 8
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CLK DE 1 HZ SIN DISPONER DE LA FRECUENCIA DE LA RED

• Implementar sencillo multivibrador astable de frecuencia ajustable y bastante

estable, con resistor (RX), compuerta Schmitt y capacitor de tantalio (CX).
• Otra compuerta se usa como separador para evitar que se afecte la frecuencia.
• La señal se lleva a la cadena de divisores de frecuencia, hasta obtener 1 Hz.
• Un posible error en la frecuencia del oscilador, aparecerá en la salida, pero
dividido por (f).

CMRE 9
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CONTADOR ASINCRÓNICO COMO DIVISOR DE FRECUENCIA

• Los integrados CD4020B, CD4024B, CD4040B son divisores de frecuencia

programable.
• Su misión es dividir la frecuencia presente en su entrada de reloj.
• En la figura, se muestran los valores por los que se dividiría la frecuencia de
entrada, dependiendo del pin de salida.

Tomado de: http://www.kemisa.es/tutorial_cd4040.php

CMRE 10
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CONTADOR ASINCRÓNICO COMO DIVISOR DE FRECUENCIA (Cont.)

Si cada salida del contador se conecta a una entrada de una compuerta AND y la
salida de ella se conecta al pin de (Reset), se obtendrá una división de la frecuencia
del reloj, por dos.

La división que se ha obtenido con ayuda

de la compuerta, es correspondiente a la
ponderación binaria o peso
correspondiente a cada pin.

De esta manera es posible dividir

frecuencia por cualquier valor deseado
menor a 2𝑁 , siendo (N) el número de
bits del contador

Tomado de: http://www.kemisa.es/tutorial_cd4040.php

CMRE 11
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CONTADOR ASINCRÓNICO COMO DIVISOR DE FRECUENCIA (Cont.)

Ejemplo.

Se quiere diseñar un reloj con el que se pueda obtener un pulso cada minuto a partir
de los 50 Hz de la red eléctrica y utilizando el contador CD4040B.

• Los 50 Hz equivalen a 50 pulsos por segundo.

• Por lo que en un minuto, serían 3000 pulsos.

• Se debe dividir por 3000 la frecuencia de la red eléctrica para obtener un pulso por
minuto.

CMRE 12
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CONTADOR ASINCRÓNICO COMO DIVISOR DE FRECUENCIA (Cont.)

El equivalente en binario del número 3000, es (101110111000), por lo tanto basta

conectar las salidas correspondientes a los (1) lógicos a las compuerta AND.

PIN 1 15 14 12 13 4 2 3 5 6 7 9
PESO 2048 1024 512 256 128 64 32 16 8 4 2 1
3000 1 0 1 1 1 0 1 1 1 0 0 0

Tomado de: http://www.kemisa.es/tutorial_cd4040.php

CMRE 13
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GENERADOR DIGITAL DE SEÑALES DE RELOJ

• El CI 4060B contiene una cadena de divisores, unos inversores y una sección de

oscilador que se pone a punto con unos pocos componentes discretos externos.
• Para aproximar la frecuencia deseada, el oscilador interno sólo requiere un
capacitor (C1), un resistor fijo R4 y otro ajustable VR1, externos.

CMRE 14
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GENERADOR DIGITAL DE SEÑALES DE RELOJ, MEJORADO

• El oscilador del circuito anterior debe ser mejorado para lograr sincronización
precisa entre dispositivos que lo requieran.
• Se utiliza un pequeño cristal de cuarzo de 32.768 KHz, ayudado con los inversores
internos del 4060B.
• A partir de esta frecuencia y utilizando
la cadena de divisores del CI, se
pueden obtener varias frecuencias
distintas o muchas más si se utiliza un
segundo divisor.

CMRE 15
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CIRCUITOS ANTI-REBOTES

Todos los contactos electromecánicos de teclas, pulsadores, interruptores, relés y

otros, al activarse una sola vez, no generan como cabe esperar un solo impulso, si no
que debido a sus propiedades mecánicas y a la presencia de resortes que tratan de
mantener los contactos, rebotan y generan aleatoriamente varios impulsos
indeseados (de muy corta duración).

Esto no es un problema en aplicaciones industriales, pero si puede llegar a serlo en

circuitos digitales, ya que estos rebotes se transforman en aperturas y cierres
indeseados, que pueden ser interpretados como señales de reloj o como secuencias
de entrada.

Se puede eliminar estos falsos impulsos, de alguna de las siguientes formas:

a. Introduciendo retardos por software, que omita los rebotes.
b. Usando circuitos anti-rebotes hardware utilizando redes R-C, inversores (Schmitt
trigger), cerrojos S-R, o la combinación de ellos.

CMRE 16
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CIRCUITOS ANTI-REBOTES (R-C) SIMPLES

Revisar:
• Constantes de tiempo de carga y descarga del capacitor.
• Forma de onda del pulso de salida.

CMRE 17
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CIRCUITO ANTI-REBOTES CON SCHMITT TRIGGER

CMRE 18
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CIRCUITO ANTI-REBOTES CON CERROJO (LATCH) S-R

• Un cerrojo S-R, puede actuar como circuito anti-rebote.

• El interruptor en la posición superior, fija la salida (Q=1), en algunos nseg.
• Cuando el contacto rebota unos mseg. después, la salida (Q) reafirma su valor y
no cambiará hasta que se lleve el interruptor a la posición inferior donde el circuito
se comporta de forma dual.

CMRE 19
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CIRCUITOS ANTI-REBOTE MEJORADOS

• Una compuerta Schmitt, después del circuito R-C, también actúa como anti-rebote.

• La constante de tiempo del circuito R-C, debe ser mayor o igual que la duración de
las oscilaciones de rebote del dispositivo mecánico utilizado. Valores típicos de
prueba son: R = 220 Ω (Máximo 390 Ω) C = 10 uF.

• Para mayor efectividad, se conecta la red R-C entre dos compuertas Schmitt. La
primera trabaja como mejorador de onda y elimina oscilaciones de poca variación.
En este caso, la constante de tiempo del circuito R-C, debe ser menor.

CMRE 20
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CIRCUITO SINCRONIZADOR, MONOPULSO Y ELIMINADOR DE REBOTE

Circuito para sincronizar una entrada manual (X) (pulsador o interruptor) con la señal
CLK en circuito secuencial y que independientemente del tiempo de activación, se
genere en la salida (Z) solo un pulso sincronizado y libre de rebotes de contacto.

DIAGRAMA DE ESTADOS DIAGRAMA DE BLOQUES

CMRE 21
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CIRCUITO SINCRONIZADOR, MONOPULSO Y ELIMINADOR DE REBOTE (Cont.)

ESTADO X Z X Z
Q1 Q0
ACTUAL 0 1 0 1
A A B 0 00 00 01 0
B D C 1 01 10 11 1
C D C 0 11 10 11 0
D A B 0 10 00 01 0
EST. SGTE Q1* Q0*
𝑄1∗ = 𝐷1 = 𝑄0 𝑄0∗ = 𝐷0 = 𝑋 𝑍 = 𝑄1 𝑄0
Notar que estado A= estado D, pero no se hace para detectar flanco negativo de (X).

CMRE 22
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CIRCUITO SINCRONIZADOR, MONOPULSO Y ELIMINADOR DE REBOTE (Cont.)

• Circuito detector de flanco positivo, un módulo muy útil para el diseño secuencial.
• Para detectar un flanco positivo en (X) basta retener el valor de dicha señal
durante dos unidades de tiempo seguidas y seleccionar el estado (01).
• El flanco de bajada en (X) se detecta con el estado (10): 𝑍 = 𝑄1 𝑄0
• Para detectar ambos flancos, el de subida y el de bajada, será necesaria una
compuerta XOR
𝑍 = 𝑄1 𝑄0 + 𝑄1 𝑄0 = 𝑄0 ⊕ 𝑄1

CMRE 23
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BIBLIOGRAFÍA.

Revisar la bibliografía del curso. Además:

 FIERRO, Gustavo. Manual de circuitos lógicos. U. del Cauca.

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