Documente Academic
Documente Profesional
Documente Cultură
Electron
Production &
Trading of
Educational
S.R.L. Equipment
MANUAL DE INSTRUCŢIUNI
Electron S.R.L. - MERLINO - MILAN ITALY Tel (++ 39 02) 9065 9200 Fax 9065 9180
Web – www.electron.it , e-mail – electron@electron.it
B1136D06.DOC 05/2006
1
CUPRINS
1 – Generalităţi
2 – Descriere
3 – Pregătirea staţiei de lucru
4 – Inventarul de componente
1 – Sumar
2 – Operaţia ŞI-NU
3 – Operaţia ŞI
4 – Operaţia SAU
5 – Operaţia SAU-NU
6 – Bistabil RS (Flip-Flop)
7 – Circuit astabil
1 – Semi-adunarea
2 – Adunarea totală
3 – Scăderea numerelor binare
1 – Convertor zecimal-binar
2 – Convertor binar-zecimal
3 – Convertor binar-7 segmente
2
1 – Divizor de frecvenţă (cu 2)
2 – Registru paralel
3 – Numărător binar crescător
4 – Numărător binar descrescător
5 – Numărător presetabil divide-cu-n
6 – Registru de deplasare
3
CAPITOLUL 1 – GENERALITĂŢI ŞI DESCRIEREA SISTEMULUI
1 – Generalităţi
B1136 este o unealtă generală pentru pregătirea de circuite electronice atât cu scopuri
de dezvoltare cât şi de antrenament.
4
2 - Descriere
8 indicatori de stare logică. Acestea oferă o indicaţie optică a stării semnalelor din
circuitul în curs de testare.
Indicatorii optici sunt stinşi pentru nivele logice joase (sub 1.2VDC) iar in rest sunt
aprinşi.
Tensiunea maximă de intrare este de 12V (pentru uzul de circuite logice de nivel
mare).
8 generatoare de stări logice, numerotate S0 până la S7. Acestea oferă comutare fără
salturi între nivele TTL, sub controlul celor 8 comutatoare.
5
4 generatoare mono-puls, fiecare controlate de câte un buton (B0 până la B3).
Fiecare generator produce un impuls jos-inalt-jos de aprox. 40mspentru fiecare
apăsare a butonului aferent. Ieşirile sunt de nivel TTL.
6
Fig.1 – Vederea din faţă a staţiei de lucru
7
Fig.1 – Vederea din faţă a staţiei de lucru
8
9
3 – Pregătirea staţiei de lucru
Conectaţi un capăt se sârmă la Indicatorul de Nivel Logic Nr.0 şi celălalt capăt la ieşirea
TTL a generatorului.
Reglaţi selectorul la cea mai joasă frecvenţă. LED-ul se va aprinde la intervale regulate.
Frecvenţa de pâlpâire e ajustabilă cu butonul de reglaj.
Mutaţi selectorul pe poziţiile superioare. La un moment dat, LED-ul nu va mai pâlpâi şi
va rămâne semi-aprins.
4 – Inventarul de componente
12
4.2 – Componente comandate de client
Circuite integrate
50 buc – 555
50 buc – 74HC00
50 buc – 74HC02
50 buc – 74HC08
50 buc – 74HC11
50 buc – 741
50 buc – 74HC74
50 buc – 74HC138
50 buc – 74HC112
50 buc – 74HC147
50 buc – 74HC161
50 buc – 74HC137
50 buc – 74HC163
50 buc – 74HC193
50 buc – 14008 (Echivalent 74HC283)
REZISTOARE
50 buc – 100, ¼ W
50 buc – 560, ¼ W
50 buc – 1K, ¼ W
50 buc – 2K2, ¼ W
50 buc – 3K9, ¼ W
50 buc – 10K, ¼ W
50 buc – 100K, ¼ W
50 buc – 1M, ¼ W
VARIOUS
13
CAPITOLUL 2 – MULTIVIBRATOARE TRANZISTORIZATE
1 – Circuitul bistabil
Bistabilul constă, în fond, într-un amplificator cu două etaje, cuplate în curent continuu,
a cărui ieşire este aplicată la intrarea primului etaj. Defazajul de 180° introdus de
fiecare etaj face ca semnalul reaplicat la intrare are un defazaj de 360° faţă de intrare,
adică reacţia este pozitivă.
Dacă condiţiile de biasing în curent continuu (de analizat) sunt puse corect, unul dintre
cele două etaje va fi ON (saturat) şi selălalt va fi OFF (întrerupt). Oricare dintre cele
două etaje poate fi ON la un moment dat, iar celălalt va fi OFF. Se spune că circuitul
are două stări stabile, de unde vine denumirea dată, de BISTABIL.
14
– Introduceţi un cablu cu un capăt în mufa GND şi cu celălalt capăt atingeţi pentru un
interval scurt de timp colectorul tranzistorului închis (sau baza tranzistorului
deschis). Cei doi tranzistori îşi vor schimba starea.
– Repetaţi comutarea până la asigurarea înţelegerii mecanismului de comutare.
15
2 – Bistabilul cu condensatori de accelerare
Acţiunea reacţiei pozitive care permite bistabilului de bază să comute dintr-o stare în
cealaltă poate fi modificată pentru a permite tranziţii mai rapide prin adăugare unor
condensatori de accelerare, după cum se arată în fig.2.
16
3 – Operarea circuitului bistabil în modul de comutaţie
S-a experimentat deja că, print-un scurt impuls la masă, aplicat colectorului
tranzistorului oprit sau bazei tranzistorului pornit comută circuitul în starea
complementară.
Dacă se aplică la colector, impulsul nu trebuie să fie neapărat la masă, ci e suficient să
fie la un nivel suficient de scăzut pentru a scoate din saturaţie baza celuilalt tranzistor.
Această afirmaţie poate fi tradusă într-o ecuaţie, pentru a calcula amplitudinea minimă a
impulsului. În orice caz, pentru a asigura comutarea corectă, impulsul trebuie să fie
negativ, îngust, şi amplu.
18
4 – Bistabilul nesaturat, cu cuplaj pe emitor
Aspectul esenţial al acestui ircuit este că emitoarele sunt legate împreună şi sunt puse la
masă printr-un singur rezistor, R5.
VB1 = VC · R5/(R2+R4+R5)
IQ1 = VE1/R5
Pentru funcţionarea corectă ca bistabil, este necesar ca VC1 să fie suficient de jos
pentru ca VB-E al Q2 să fie sub 0.7V, adică:
20
5 – Circuitul astabil
Figura 6 Arată principiul circuitului astabil: ambii tranzistori sunt polarizaţi în regiunea
de conducţie.
După această fază, unul dintre cei doi condensatori care păstrează unul dintre tranzistori
oprit (de exemplu C2 care menţine Q1 oprit) tinde să se descarce prin rezistorul de
polarizare a bazei tranzistorului (R5) până în momentul în care Q1 ajunge în stare de
conducţie şi se repetă comutarea.
Tensiunea de colector a oricăruia dintre cei doi tranzistori are forma de undă
dreptunghiulară. Acest circuit este de fapt deseori folosit ca generator de semnal.
21
CAPITOLUL 3 – PORŢI LOGICE ELEMENTARE
Subiectul acestui capitol este constituit de 4 circuite capabile de efectuarea unor operaţii
elementare de algebră Booleană asupra a două variabile logice, A şi B.
Cele 4 circuite sunt construite din combinaţii de Rezistoare, Diode şi Tranzistori şi
reprezintă exemple de construcţie a circuitelor logice cu componente distcrete, ca o
alternativă la circuitele integrate digitale.
22
1 – Adunarea logică (SAU LOGIC)
Ieşirea este joasă când atât A cât şi B sunt joase, şi devine înaltă când A, B sau ambele
sunt înalte.
Pentru testarea acestei funcţii folosiţi un indicator de nivel logic, conectat la ieşirea
circuitului.
23
2 – Produsul logic (ŞI LOGIC)
Ieşirea este joasă când oricare dintre A sau B, sau ambele, sunt joase.
Ieşirea este înaltă doar când atât A cât şi B sunt înalte.
24
3 – Adunarea logică negată (SAU-NU LOGIC)
Ieşirea este înaltă când ambele intrări sunt joase şi devine joasă când A, B sau ambele
sunt înalte.
25
4 – Produsul logic negat (ŞI-NU LOGIC)
Ieşirea este înaltă când una dintre intrările A, B sau ambele sunt joase, şi este joasă când
atât A cât şi B sunt înalte.
26
CAPITOLUL 4 – PORŢI DIGITALE
1 – Sumar
Aparatele digitale pot executa operaţii şi funcţii foarte complexe pe baza a doar câteva
operaţii logice elementare.
Pentru toate experimentele din cele ce urmează se va folosi o sursă de tensiune de +5V
pentru acest circuit integrat.
Nu lăsaţi intrările nefolosite ale circuitului integrat în aer. Conectaţi-le la masă (GND)
respectiv +5V, după cum convine fiecărei situaţii.
27
2 – Funcţionarea ŞI-NU
Această operaţie va fi efectuată asupra a doi operanzi de câte un singur bit. Simbolul
aceste operaţii elementare şi tabelul de adevăr sunt prezentată în Fig.1A şi 1B. Vom
comsidera ca fiind “0” nivelul logic jos (0 până la 0.8V) şi “1” nivelul logic înalt
disponibil la ieşirile Generatoarelor de Nivel Logic (circuite cu comutator).
Verificaţi tabelul de adevăr din Fig.1B. Concluzia observaţiilor dvs. Poate fi rezumată
în modul următor:
“Operaţia ŞI-NU produce un semnal jos (0) la ieşire când ambele intrări sunt la nivel
logic înalt (1).”
28
3 – Operaţia ŞI
Fig.2A – Poarta ŞI
Fig.2B – Circuitul echivalent pentru Fig.2A
Pregătiţi echipamentul în modul ilustrat mai sus, după care consultaţi tabelul de adevăr
din Fig.2C. Folosiţi comutatoarele S0 şi S1 pentru a introduce diferite nivele logice la
intrările circuitului, respectiv un indicator de nivel logic la ieşire pentru a observa
semnalul final.
Nu lăsaţi intrările nefolosite ale circuitului integrat în aer. Conectaţi-le la GND (masă)
sau la +5V, în funcţie de cum convine necesităţilor.
“Operaţia ŞI produce la ieşire un nivel logic înalt (1) când ambele întrări se află la nivel
logic înalt (1)”.
29
4 – Operaţia SAU
Figura 3A ilustreay[ simbolul unei porţi SAU cu două intrări. Figura 3B este
echivalentă cu 3A pentru că am înseriat două inversoare. Din materia teoretică ştim că
un inversor poate fi trecut de la ieşirea unei porţi la intrări, cu condiţia ca poarta să-şi
schimbe funcţia din SAU în ŞI sau invers, după cum este cazul şi aici.
Astfel ajungem la combinaţia din Fig.3D, echivalentă în funcţionare cu poarta iniţială
SAU.
Recreaţi montajul din Fig.3D, după care verificaţi tabelul de adevăr din Fig.3E.
Nu lăsaţi intrările nefolosite ale circuitului integrat în aer. Conectaţi-le la GND (masă)
sau la +5V, în funcţie de cum convine necesităţilor.
“Funcţia SAU are la ieşire un nivel logic înalt (1) când cel puţin una dintre intrări este
la nivel logic înalt (1)”.
30
5 – Operaţia SAU-NU
“Operaţia SAU-NU va produce la ieşire un nivel logic jos (0) când cel puţin una dintre
intrări este la un nivel logic înalt (1)”.
31
6 – Bistabilul RS (Flip-Flop)
Figura 5A ilustrează o combinaţie de două porţi ŞI-NU care are funcţionalitatea unui
circuit cu două stări. Acest circuit are posibilitatea de a memora care dintre cele două
intrări A şi B a fost ultima adusă la un nivel logic jos.
– Dacă A este adus la un nivel jos, U1 ajunge la un nivel înalt iar U2 la un nivel jos,
stare care va rămâne şi dacă A este adus înapoi la un nivel înalt.
– Dacă B este adus la un nivel jos, U1 ajunge la un nivel jos iar U2 la un nivel înalt,
stare care va rămâne şi dacă B este adus înapoi la un nivel înalt.
– Dacă A şi B sunt aduse la nivel jos simultan, atunci ambele ieşiri sunt la nivel logic
jos. Când A şi B sunt readuse la nivel înalt, starea ieţirilor va fi determinată de
intrarea care ajunge ultima la nivel înalt. Dacă cele două intrări A şi B ar fi legate
împreună şi aduse la nivel înalt simultan, starea circuitului ar fi în fond haotică.
în practică, mici inegalităţi dintre cele două porţi fac ca una dintre stări să fie mai
probabil de atins decât celalată.
Realizaţi montajul din Fig.5A, după care testaţi tabelul de adevăr din Fig.5B.
32
FIG.5B—Tabelul de adevăr al circuitului din fig.5A
33
7 – Circuitul astabil
– Presupunem că C este iniţial descărcat. Acesta menţine intrarea la un nivel logic jos.
În consecinţă, intrarea este la un nivel logic înalt.
– Pragul de comutare al porţii este atins din nou li ciclul se repetă. LED-ul
indicatorului de nivel logic pâlpâie.
Montajul pentru analiza funcţionării circuitului astabil este prezentat în Fig.6A.
34
CAPITOLUL 5 – ADUNAREA/SCĂDEREA NUMERELOR BINARE
1 – Semi-adunarea
b3 b2 b1 b0
X = 11() = B(H) = 1 0 1 1 (B)
Y = 3() = 3(H) = 0 0 1 1 (B)
X0 + Y0 = 1+1 = 0, surplus 1
X1 + Y1 + surplusul anterior = 1+1+1 = 1, surplus 1
X2 + Y2 + surplusul anterior = 0+0+1 = 1, surplus 0
X3 + Y3 + surplusul anterior = 1+0+0 = 1, surplus 0
O adunare binară este rezultatul unei secvenţe de operaţii elementare de adunare bit cu
bit. Fiecare operaţie elementară generează o sumă şi un surplus.
Această operaţie elementară se numeşte SEMI-ADUNARE, şi are următorul tabel de
adevăr:
SEMI-ADUNAREA 0 0 0 0
0 1 1 0
1 0 1 0
1 1 0 1
35
Sau, de asemenea:
SUM Xn Yn Xn Yn SEMI-ADUNAREA ÎN MODUL 2
CARRY Xn Yn
Sau, de asemenea:
Toate circuitele integrate sunt de tip CMOS, fiind astfel sensibile la eventuale
descărcări electrostatice. Observaţi instrucţiunile de manipulare pentru aceste circuite
36
TABLE 1
OR
X AND
Y
SUM
OR
X
Y CARRY
NO R NO R
CARRY
HALFSUM IN MO DE
X
XY
SUM
Montaj de test 2
XY 1buc 4069 – inversor
Y
1buc 4073 – ŞI
CARRY 1buc 4071 – SAU
HALFSUM IN MO DE
X
X XOR Y
SUM Montaj de test 3
1pc 4073 – ŞI
X AND Y
Y CARRY 1pc 4070 – SAU
EXCLUSIV
HALFSUM IN MODE
37
2 – Adunarea totală
(=1 dacă doar unul dintre termeni este egal cu 1 sau toţi trei sunt 1)
Cele două ecuaţii de mai sus pot fi transpuse în următorul tabel de adevăr:
0 0 0 0 0
0 1 0 1 0
1 0 0 1 0
Adunarea totală 1 1 0 0 1
(X XOR Y) (XY)
0 0 1 1 0
0 1 1 0 1
1 0 1 0 1
1 1 1 1 1
(X XOR Y) (X+Y)
Semi-adunare 0 0 0 0
0 1 1 0
1 0 1 0
1 1 0 1
(X XOR Y) (XY)
Observăm imediat că prima jumătate a tabelului adunării totale (când C=0) este identic
cu tabelul de adevăr al semi-adunării.
A doua jumătate a tabelului de adevăr al adunării totale (când C=1), rezultatul este
complementar rezultatului semi-adunării, când surplusul de la ieşire este egal cu (X
SAU Y).
Astfel, putem construi un sumator total ca în fig.1.
38
X
Y
HALFSUM
R0 C0 R1 C1
INPUT CARRY
Surplus intrare
RESULT CARRY
Circuitul din interiorul liniei întrerupte este practic un Selector de Date dublu, care
poate scoate pe ieşiri R0, C0 sau R1, C1 în funcţie de surplusul de la intrare.
Această funcţie este efectuată de către un circuit integrat de tip 4019.
39
3 – Scăderea numerelor binare
The same procedure used for the case of the binary addition can be used to develop the
case of binary subtraction. The result can be placed in the form of equations and truth
tables as follows:
0 0 0 0 0
0 1 0 1 1
1 0 0 1 0
SUBTRACTOR 1 1 0 0 0
(X XOR Y) (X Y)
0 0 1 1 1
0 1 1 0 1
1 0 1 0 0
1 1 1 1 1
(X XOR Y) (X Y)
40
CAPITOLUL 6 – CONVERTOARE DE COD
Figura 1 ilustrează montajul de test. Pentru oricare intrare zecimală (D1….D7) la nivel
înalt (logic), circuitul integrat va genera codul binar corespunzător.
INTRĂRI IEŞIRI
D7 D6 D5 D4 D3 D2 D1 B3 B2 B1
0 0 0 0 0 0 1 0 0 1
0 0 0 0 0 1 0 0 1 0
0 1 0 0 0 0 0 1 1 0
41
2 – Convertor binar-zecimal
Folosiţi indicatoarele de nivel logic pentru analiza semnalelor de la ieşire. Ţineţi cont
de faptul că circuitul integrat HC138 are ieşirile negate (active la nivel jos). Alcătuiţi
tabelul de adevăr pentru circuitul testat.
42
3 – Convertor binar – 7 segmente
43
CAAPITOLUL 7 – CIRCUITE FLIP-FLOP
Circuitul basculant de bază a fost deja studiat şi experimentat de către elevi. Totuşi, este
util de reparcurs principiile sale, pentru un studiu complet al diferitelor tipuri de circuite
flip-flop. Vedeţi Fig.1.
Când S coboară la nivel jos (cu R rămas la nivel înalt), ieşirea Q trece la nivel logic
înalt.
Când R coboară la nivel jos (cu S rămas la nivel înalt), ieşirea Q trece la nivel logic jos.
44
2 – Circuitul flip-flop de tip D
Folosiţi: U1=4069
U2=4011
45
3 – Circuitul flip-flop de tip JK
Verificaţi tabelul de adevăr al circuitului JK, care ar trebui să arate ca cel de mai jos.
X X 1 0 X X 1 0
X X 0 1 X X 0 1
X X 1 1 X X 1 1
46
CAPITOLUL 8 – APLICAŢII ALE CIRCUITELOR FLIP-FLOP
Figura 1 ajută atât la explicarea principiului de funcţionare din spatele divizorului, cât şi
la ilustarea montajului efectiv de test.
Un singur circuit flip-flop dintre cele două disponibile în acelaşi circuit integrat
e utilizat aici, cu ieşirea legată la intrarea D a Q aceluiaşi circuit. Astfel, în
momentul tranziţiei jos-înalt a semnalului de ceas, nivelul ieşirii va fi memorată.
Imediat, va prelua Q valoarea complementară, pregătind Q astfel operaţia de comutare
pentru următorul impuls de tact.
Generatorul de semnal inclus pe panoul frontal al aparatului 1136-D este folosit pentru
producerea semnalului de tact. Generatorul de semnal dreptunghiular trebuie reglat
pentru nivele compatibile TTL (0/+5V).
Se pot folosi şi generatoarele de mono-impulsuri cu buton pentru a produce un semnal
de intrare pentru circuit.
Starea bitului de ieşire se poate observa folosind unul dintre indicatorii de nivel logic.
47
2 – Registru paralel
Un al doilea buton este folosit pentru readucerea stării registrului la starea zero-total
(RESET).
48
3 – Numărător binar crescător
Cele 4 bistabile ale celor două circuite integrate 4013 pot fi configurate pentru a
funcţiona ca un numărător binar cu patru trepte.
49
4 – Numărător binar descrescător
50
5 – Numărător divizor cu n
51
6 – Registru de deplasare
Comenzile de deplasare sunt efectuate prin apăsările butonului de deplasare. Datele sunt
introduse prin stânga şi ies prin dreapta.
Datele de intrare vor fi “0” sau “1” în funcţie de poziţia comutatorului generatorului de
nivel logic.
52
CAPITOLUL 9 – CIRCUITUL CMOS CU PRAG SCHMITT
Circuitul CMOS cu prag Schmitt este alcătuit din două porţi inversoare cascadate.
Ieşirea celei de-a doua porţi este aplicată cu aceeaşi polaritate la intrarea primei porţi,
astfel încât se creează un histerezis la intrare. Consultaţi fig.1.
Acest circuit de bază poate fi aplicat într-o varietate de situaţii, unele fiind descrise în
paragrafele următoare.
În oferta de circuite integrate CMOS există modele care au deja circuitul Schmitt inclus
deja. Exemple ar fi 40106, 4093 etc.
53
1 – Generarea de nivele logice din semnale cu evoluţie lentă
Aici, un potenţiometru controlat manual este folosit pentru generarea unui semnal cu
evoluţie lentă pentru intrarea trigger-ului Schmitt. Acesta din urmă comută la nivele
bine stabilite, şi cu histerezis. Astfel sunt posibile tranziţii adecvate ale nivelelor, după
necesităţile bunei funcţionări a circuitelor logice.
54
2 –Generator de întârziere
Circuitul Schmitt poate fi folosit pentru generarea unei întârzieri la pornirea şi/sau la
oprirea unei multitudini de aplicaţii, cum ar fi controlul cu întârziere al unui releu.
Figurile 3, 4 şi 5 ilustrează montajele de test pentru cele trei cazuri.
Observaţi că, în toate cele tri cazuri, potenţiometrul P1 este folosit pentru crearea unei
constante de timp cu un condensator mare (C1). Setarea optimă a P1 trebuie găsită
55
experimental. O setare excesivă (rezistenţă prea mare) a P1 poate împiedica
funcţionarea temporizatorului.
Alegând o constantă de timp RC adecvată, se pot realiza următoarele aplicaţii:
56
3 – Generator de temporizare
57