Formato Trabajo Sena 1 Sumador Restador Con Visualizaciionnnnzzzzz

Regional Meta Centro de Industria y servicios del META
Mantenimiento Electrnico e Instrumental industrial
Produccin y transformacin 2011
Regional META Centro de Industria y servicios del META Mantenimiento electrnico E Instrumental industrial
Fecha:
22 / 11 / 2011
Sistema de Gestin de la Calidad
Jhon Daza Pedro Alvis Numero de ficha 229393 NIS 12427612
Fecha:
22 / 11 / 2011
Autores
Control del Documento Nombre Cargo Dependencia Firma Centro de Jhon daza Jhon Fredy daza Industria y Aprendiz Pedro alvis servicios del Pedro alvis META Tema SUMADOR RESTADOR CON VISUALIZACION DINAMICA
Fecha 22/ 11 / 2011
Fecha:
22 / 11 / 2011
SUMADOR - RESTADOR CON VISUALIZACION DINAMICA
JHON FREDY DAZA SALGADO PEDRO JAVIER ALVIS Q.
TRABAJO DE INVESTIGACION IVAN DARIO DUARTE
SENA CENTRO DE INDUSTRIA Y SERVICIO DEL META MANTENIMIENTO ELECTRONICO E INSTRUMENTAL INDUSTRIAL FICHA: 229393 2011
Fecha:
22 / 11 / 2011
INFORME
INTRODUCCION Electrnica digital
Circuito digital de un reloj binario en una placa de pruebas. La electrnica digital es una parte de la electrnica que se encarga de sistemas electrnicos en los cuales la informacin est codificada en dos nicos estados. A dichos estados se les puede llamar "verdadero" o "falso", o ms comnmente 1 y 0, refirindose a que en un circuito electrnico digital hay dos niveles de tensin. Electrnicamente se les asigna a cada uno un voltaje o rango de voltaje determinado, a los que se les denomina niveles lgicos, tpicos en toda seal digital. Por lo regular los valores de voltaje en circuitos electrnicos pueden ir desde 1.5, 3, 5, 9 y 18 voltios dependiendo de la aplicacin, as por ejemplo, en una radio de transistores convencional las tensiones de voltaje son por lo regular de 5 y 12 voltios al igual que se utiliza en los discos duros IDE de computadora. Se diferencia de la electrnica analgica en que, para la electrnica digital un valor de voltaje codifica uno de estos dos estados, mientras que para la electrnica analgica hay una infinidad de estados de informacin que codificar segn el valor del voltaje. Esta particularidad permite que, usando lgebra Booleana y un sistema de numeracin binario, se puedan realizar complejas operaciones lgicas o aritmticas sobre las seales de entrada, muy costosas de hacer empleando mtodos analgicos.
Fecha:
22 / 11 / 2011
La electrnica digital ha alcanzado una gran importancia debido a que es utilizada para realizar autmatas y por ser la piedra angular de los sistemas micro programados como son los ordenadores o computadoras.
CONTENIDO 1 OBJETIVOS 2 SUMADOR RESTADOR CON VISUALIZACION DINAMICA. 3 MATERIALES 4 INTEGRADOS Y COMPUERTAS.. 5 DIAGRAMA DE FLUJO 6 MAPAS DE KARNOUGH TABLA DE VERDAD.. 7 DISEO CIRCUIT- MAKERT. 8 FOTOGRAFIAS DEL MONTAJE.. 9 CONCLUSIONES
Fecha:
22 / 11 / 2011
OBJETIVOS
Comprobar el funcionamiento del diseo de un sumador restador utilizando compuertas bsicas. Con el apoyo del simulador CIRCIT MAKERT verificar el diseo y funcionamiento del circuito desarrollado. Realizar suma resta, que nos indique que sumamos y restamos. Emplear mapas de karnaugh y tablas de verdad para la visualizacin del sumador restador. Obtener diagramas de flujo para comparar la realizacin del sumador restador.
Fecha:
22 / 11 / 2011
Materiales
2. display de 7 segmentos nodo comn 8. resistencias de 1 kilo ohmio 1. resistencia de 70,69 kilo ohmio 3. integrados compradores 7485 1. integrado multiplexor - 74244 1. integrado codificador - 7447 2. transistores npn - 2n2222 4. integrados sumadores 7483 1. diswitch de 8 entradas 2. compuertas XOR 7486 4. compuertas AND - 7408 2. compuertas OR 7432 2. condensadores 103 1. resistencia de 2.88 k 1. integrado 555 3. compuertas 7404 4 protoboard - W-3 102 5. metros de cable conductor
Fecha:
22 / 11 / 2011
Integrados y Compuertas 7483 Integrado sumador
7485 Integrado comparador
Fecha:
22 / 11 / 2011
Integrado codificador 7447
Fecha:
22 / 11 / 2011
7408 and multiplicadora
Compuerta 7486 X -OR
Fecha:
22 / 11 / 2011
Integrado multiplexor 74244
compuerta OR 7432
Fecha:
22 / 11 / 2011
Compuerta NOT 7404
Transistor npn
Fecha:
22 / 11 / 2011
Integrado 555
Condensador 103
Fecha:
22 / 11 / 2011
Display de nodo Comn
Fecha:
22 / 11 / 2011
INICIO INGRESAR N
SUMA O RESTA Resta
COMPLEMENTO 1 B
Suma VISUALIZACION Z A+B
COMPLEMENTO 1 Z
HAY DESBORDE Si
Z+1
No
Fecha:
22 / 11 / 2011
Tablas de verdad y mapas de karnaugh
1 1 0 1 0 0
0 0 1 1 1 0 0
1 0 0 0 0 1
0 1 1 1 0 0
0 0 0 0 1 1
0 0 1 1 0 1
0 1 0 1 0 1
0 0 1 0 1 0
B A
0 0
0
0
1
1
1 1
1
3
1 1
0
2
A C + BC
Fecha:
22 / 11 / 2011
C1
B4
B3
B2
B1
0 0 0 0 1 1 1 1
0 0 1 1 0 0 1 1
0 1 0 1 0 1 0 1
0 0 X X 0 0 X 1
0 0 X X 1 1 X 0
0 1 X X 1 1 X 0
0 1 X X 0 0 X 1
0 0 X X 0 0 X 0
BC A
0 0
0
0
1
1
1 X
1
3
1 1
0
2
Fecha:
22 / 11 / 2011
BC A
0 0
0
0
0 1
1
1
1 X
1
3
0
2
1
AC B4BC A
0 0
0
0
1
1
1 X
1
3
0
2
1
AB
Fecha:
22 / 11 / 2011
B3BC A
0 0
0
0
0 1
1
1
1 X
1
3
0
2
1
AB +AC
0 0 0 0 1 1 1 1 0
1 1 1 1 1 1 1 1 1 1 1 1
1 1 1 1 1 1 1 1
Fecha:
22 / 11 / 2011
20 > X > 19 ABC + ABD + ABC = 1
C1
B4
B3
B2
B1
0 0 0 0 1 1 1 1
0 0 1 1 0 0 1 1
0 1 0 1 0 1 0 1
0 1 0 X 0 X X X
0 0 1 X 0 X X X X
0 0 1 X 1 X X X
0 1 0 X 1 X X X
0 0 0 X 0 X X X
BC A
0 0
0
0
1
1
1 X
1
3
1 1
0
2
X
B
Fecha:
22 / 11 / 2011
B1 A
0 0
0
0
1
1
1
3
0
2
1
4 5
X
7 6
X
C
BCB3 A
0 1 0
0
0
1 1X X
0
2
X
4
X X
X
A+B
Fecha:
22 / 11 / 2011
BCB2 A
0 0
0
0
1
1
1
3
0
2
1
4 5
X
7 6
A+C
Fecha:
22 / 11 / 2011
SUMADOR - RESTADOR
L11 L1 74LS83
s4 s3 s2 s1
L9 L10 L8
L7
A4 A3 A2 A1 B4 B3 B2 B1
A0 A1 A2 A3
Cin Cout
U6A 74LS83
s4 s3 s2 s1
A4 A3 A2 A1 B4 B3 B2 B1
Cin Cout
B0 B1
U5B U6C
B2 B3
U5C
U6B
U12A U12C
U6D
U12B
Fecha:
22 / 11 / 2011
VISUALIZADOR
V+
V+
DISP1
abcdefg. abcdefg.
DISP2
U13C
U13D V11 5V V10 5V U8A U9A U2E U18A U15C U15A U18B U15B U10D
B
V8 0V
C
V9 0V V7 0V U2D
A4 A3 A2 A1 B4 B3 B2 B1
U14 74LS83
s4 s3 s2 s1
A3 A2 A1 A0
U3 74LS47
Cin Cout
g f e d c b a
U2C U18C U18D U20A U19A U19B U15D U19D U24A U1 74LS244
Ya3 Ya2 Ya1 Ya0 Yb3 Yb2 Yb1 Yb0
test RBI RBO
U19C U2F
A4 A3 A2 A1 B4 B3 B2 B1
U21 74LS83
s4 s3 s2 s1
OEa Ia3 Ia2 Ia1 Ia0 OEb Ib3 Ib2 Ib1 Ib0
U11D U13A
U13B
U22B
U23A
Cin Cout
V1 5V U23B V2 0V
Fecha:
22 / 11 / 2011
Visualizacin dinmica
Fecha:
22 / 11 / 2011
Fecha:
22 / 11 / 2011
Fecha:
22 / 11 / 2011
Fecha:
22 / 11 / 2011
Fecha:
22 / 11 / 2011
Fecha:
22 / 11 / 2011
Fecha:
22 / 11 / 2011
Fecha:
22 / 11 / 2011
Fecha:
22 / 11 / 2011
Conclusiones
. Realizamos el sumador- restador con visualizacin dinmica, Se presentan algunos problemas que al fin de ver el datasheet Que era nuestro problema, para que nos funcionara correctamente, El sumador restador con visualizacin dinmica Y con una gran dedicatoria sobre este proyecto llegamos a nuestro final correctamente dndonos una vez ms un positivo. En este montaje nos dio a conocer un integrado llamado el 555 que es una gran importancia en este circuito, que al saberlo manipular dio lo que queramos un positiv En el sumador-restador se nos presenta un problema con la compuerta NOT la negadora que estaba en mal estado, nos caus gran problema para terminar este gran proyecto Gracias al trabajo en equipo se pueden realizar los trabajos ms cmodamente
El trabajo y la lucha llama siempre a los mejores.

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Fecha 22/ 11 / 2011

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Integrados y Compuertas 7483 Integrado sumador

7485 Integrado comparador

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Integrado codificador 7447

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7408 and multiplicadora

Compuerta 7486 X -OR

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Integrado multiplexor 74244

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Compuerta NOT 7404

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Sistema de Gestin de la Calidad

Display de nodo Comn

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SUMA O RESTA Resta

Suma VISUALIZACION Z A+B

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Tablas de verdad y mapas de karnaugh

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20 > X > 19 ABC + ABD + ABC = 1

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