TEMA 7: 7 Entrada / salida serie

ngel Rodrguez Castao Dpto. Ingeniera de Sistemas y Automtica p g Escuela Superior de Ingenieros Universidad de Sevilla

TEMA: TEMA Entrada /salida serie

1. Transmisin paralelo y serie 2. 2 Transmisin serie sncrona y asncrona 3. Interfaces normalizadas 3.1 Norma RS-232C 3.2 3 2 Bucle de corriente

1. Transmisin paralelo y serie

Paralelo: Cada palabra o dato se transmite de una vez Hay un conjunto de lneas paralelas entre origen y destino (cada una corresponde a 1 bit) Muy usada en distancias cortas (por ejemplo dentro de un ordenador) d d ) Serie: Hay una sola lnea por la que se transmiten sucesivamente los bits que componen cada dato Se usa cuando las distancias son largas (menos conexiones -> ms barato) Ms lentas que la paralela
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1. Transmisin paralelo y serie

Serie ( ): (): Se suele usar para transmitir caractres alfanumricos a perifricos o entre ordenadores Tambin adecuado para cuando se quiera transmitir a grandes distancias, pudiendo utilizarse canales de comunicaciones existentes: lneas telefnicas Velocidad de transmisin: parmetro de la comunicacin serie. Se mide en baudios y es el n de bits transmitidos por segundo

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1. Transmisin paralelo y serie 2. 2 Transmisin serie sncrona y asncrona 3. Interfaces normalizadas 3.1 Norma RS-232C 3.2 3 2 Bucle de corriente

2. Transmisin serie sncrona y asncrona

Asncrona No se establece una temporizacin rgida Los datos pueden ser transmitidos en cualquier momento El TX debe indicar al RX mediante alguna seal cuando se va a enviar un dato vlido por la lnea en forma de serie de bits. Adems i d lid l l f d i d bi Ad de los propios datos, se necesitan seales auxiliares de protocolo Sncrona Sometida a temporizacin rgida TX y RX deben estar perfectamente sincronizados

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2.1. Transmisin serie asncrona

Los caracteres se transmiten por separado: TX carcter a carcter El tiempo de separacin entre caracteres puede ser cualquiera (con una separacin mnima) Sin embargo, dentro de cada carcter la temporizacin s es rgida: a cada bit le corresponde un instante y duracin (Tbit) precisos Por tanto, es TX asncrona a nivel de caracteres, pero sncrona a nivel de bits De acuerdo con la norma de TX serie asncrona ms extendida (RS-404) Se definen dos niveles lgico: Nivel lgico 0 SPACE, Nivel lgico 1 MARK Cuando la lnea no transmite se dice que est en estado de reposo: MARK. d l l d d d
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2. Transmisin serie asncrona

Cada carcter va precedido por el nivel lgico 0 durante un Tbit. Se denomina bit de start o bit de arranque N de bits por carcter definido: 5, 7, 8. Se transmite primero el bit menos significativo Todo ca cte te odo carcter termina co u bit de stop (bit de parada), de duracin 1, a con un b t (b t pa ada), du ac , 1.5 2 Tbit (si detrs no viene otro carcter la lnea vuelve al estado de reposo) Despus del bit ms significativo, puede incluirse un bit de paridad, que es un mecanismo elemental de deteccin de errores:
Paridad Par: El bit de paridad se pone a 0 1 de forma que el n de 1s totales sea par Paridad Impar: El bit de paridad se pone a 0 1 de forma que el n de 1s totales sea impar

La referencia de tiempos que emplea el receptor para recibir los bits del dato es el flanco de bajada del bit de arranque.
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2. Transmisin serie asncrona

Para que el formato de la transmisin quede definido, TX y RX deben ponerse de acuerdo en: Velocidad de transmisin, define el Tbit. Existen velocidades normalizadas: transmisin Tbit 4800, 9600, 19200 baudios N d bi de datos de bits d d Uso de paridad y de qu tipo p q p
Sin Paridad Con Paridad: Par, Impar, Fija a 0, Fija a 1

N de bits de stop: 1, 1.5 2 Niveles d t Ni l de tensin asociados a los niveles lgicos i i d l i l l i

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2. Transmisin serie sncrona

Los caracteres no se envan por separado, sino formando bloques de gran longitud. Es ms eficiente, ya que no hacen falta bits de start y stop. g y q p Al no haber separacin entre caracteres, la nica forma de recibir correctamente es llevar la cuenta del n de bits que compone cada carcter n carcter. En la tx asncrona, la sincronizacin se hace al inicio de cada carcter (flanco descendente del bit de start). En la sncrona hay que hacerlo al inicio del bloque: cualquier pequea diferencia en la frecuencia de los relojes es crtica. Deben usar una misma seal de reloj en lugar de tener cada uno la suya. j g y Para conseguir eso hay 2 opciones: 1. Usar una lnea especfica para transmitir la seal de reloj 2. Modular la seal de reloj con la seal de informacin y enviarlas por una nica l i lnea
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2. Transmisin serie sncrona

Delante del bloque de datos se incluyen unos caracteres especiales de sincronizacin (conocidos tanto por Tx como por Rx) que permiten que el Rx tenga tiempo para adecuarse a la frecuencia con que vienen los datos datos. As se puede extraer la frecuencia de reloj antes de que empiecen a llegar los datos (til para el caso 2 de sincronizacin)

Entre cada 2 tramas o bloques de datos (cuando no hay caracteres que transmitir), en lugar de dejar la lnea en reposo, se contina transmitiendo t iti ) l d d j l l ti t iti d los caracteres de sincronizacin, para mantener al Rx sincronizado

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2. Transmisin serie sncrona y asncrona

Integrados / dispositivos para comunicacin serie comunes UART: Universal Asynchronous Receiver Transmitter USART: Universal Synchronous/Asynchronous Receiver Transmitter DUART: Dual Universal Asynchronous Receiver Transmitter

La comunicacin, adems de sncrona o asncrona, puede ser: Simplex: un solo sentido. Uno recibe, el otro transmite Half-duplex (semi-duplex): Tx y Rx en ambos sentidos pero no simultaneamente Full-duplex (duplex): Tx y Rx al mismo tiempo

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