Documente Academic
Documente Profesional
Documente Cultură
0 0 1 0 1 0 1 0 ā
t
0 1 1 0 1 1 0 1
ab
1 0 0 0 1 1 0 1 t
a⋅b
1 1 0 1 0 1 0 0 t
NU ŞI ŞI-NU a+b
t
a+b
t
000 0
001 0
010 0
011 1
100 0
101 1
110 1
111 1
DeM
f ab bc ac ab bc ac
Doua moduri de implementare ale funcției votului majoritar, inainte si
dupa aplicarea formulei De Morgan
In general se doreste ca un circuit sa fie implementat cu cat mai putine tranzistoare si sa contina cat mai
putine trasee de legatura
Astfel, este evident ca un circuit este mai avantajos cu cat are un numar mai mic de porti si care au mai
putine intrari
Din punct de vedere al minimizarii si al numarului de porti ultimele doua implementari par la fel de
complexe si mult mai eficiente decat prima
Daca tinem cont de numarul de tranzistoare care compun structura portilor, concluzia poate fi diferita
In tehnologia CMOS este nevoie de 2 tranzistoare pentru un inversor, de 4 pentru o poarta SI-NU , respectiv
SAU – NU cu 2 intrari
VDD VDD
Mp1 Mp2
VDD a Mp1
Mp
f b Mp2
Vin Vout
a Mn1 f
Mn
b Mn2
Mn1 Mn2
In tehnologia CMOS este nevoie de 2*n tranzistoare pentru o poarta SI-NU , respectiv SAU – NU cu n
intrari
a Mp1
VDD
b Mp2
f
Mp
a Mn1
Vin Vout c Mp3
f
Mn b Mn2
c Mn3
In tehnologia CMOS este nevoie de 2*n+2 tranzistoare pentru o poarta SI-NU , respectiv SAU – NU cu n
intrari ( 2n pentru poarta SI-NU (SAU-NU) si inca 2 tranzistoare pentru inversor
AND2 OR2
VDD VDD
f = ab b
a f = a+b
Aceasta rezulta folosind doua principii de baza: atat simplificarea expresiilor logice cat si folosirea functiilor
negate
a) Circuitul rezultat din forma canonica; b) Schema dup aminimizare; c) Schema dupa aplicarea formulei De
Morgan
´ 𝑎
𝑓 =𝑏+ ´ 𝑐´ +𝑎𝑐𝑑 g bc cd cd abc
h x z yz y t k x y x z t yt yz
Tabelul de adevar
f1 f2 f3 a b
a b
a>b a=b a<b
0 0 0 1 0
0 1 0 0 1 f1
1 0 1 0 0
1 1 0 1 0
f2
si
A B f1 f2 f3
Exemplu. Proiectarea unui comparator pentru a1 a0 b1 b0 A>B A=B A<B
cuvinte de 2 biti. 0 0 0 0 0 1 0
0 0 0 1 0 0 1
Se compara cuvintele A=[a1a0] si B=[b1b0] 0 0 1 0 0 0 1
0 0 1 1 0 0 1
Circuitul are 3 iesiri care semnalizeaza daca 0 1 0 0 1 0 0
cele doua cuvinte sunt egale (f2=1) sau in 0 1 0 1 0 1 0
0 1 1 0 0 0 1
caz contrar, care din ele este mai mare ( f 1=1 0 1 1 1 0 0 1
daca A>B sau f3=1 daca A<B) 1 0 0 0 1 0 0
1 0 0 1 1 0 0
Intrarile sunt biti cuvintelor care se compara 1 0 1 0 0 1 0
1 0 1 1 0 0 1
Tabelul de adevar defineste cele trei functii 1 1 0 0 1 0 0
1 1 0 1 1 0 0
de 4 variabile 1 1 1 0 1 0 0
1 1 1 1 0 1 0
a1 a0 b1 b0
Implementarea functiilor de
iesire dupa minimizare f1
f2
R
5V I0 Y0 a
a
I1 Y1 b
... I2 Y2 c f b
g
Y3 d
Y4 e e c
...
...
a b g Y5 f
d
Y6 g
Decodificatorul BCD / 7
segmente cu afisare xyzt a b c d e f g
exclusiv numerica primeste
0 000 1 1 1 1 1 1 0
numai coduri binare pe 4 0 001 0 1 1 0 0 0 0
biti de la 0 la 9, furnizate de 0 010 1 1 0 1 1 0 1
numaratoare in cod BCD 0 011 1 1 1 1 0 0 1
(zecimale) 0 100 0 1 1 0 0 1 1
Pentru primele 10 coduri binare se 0 101 1 0 1 1 0 1 1
afiseaza cele 9 cifre de la 0 la 9. 0 110 1 0 1 1 1 1 1
Pentru celelalte 6 coduri, de la 10 la 0 111 1 1 1 0 0 0 0
15, valorile generate sunt indiferente 1 000 1 1 1 1 1 1 1
1 001 1 1 1 1 0 1 1
(“X” in tabelul de adevar).
1 010 x x x x x x x
Circuitul proiectat este unul cu iesiri 1 011 x x x x x x x
multiple, generand 7 functii a 4 1 100 x x x x x x x
variabile fiecare 1 101 x x x x x x x
1 110 x x x x x x x
1 111 x x x x x x x
d xy e xy f xy
Implementarea cu porti zt 00 01 11 10 zt 00 01 11 10 zt 00 01 11 10
logice a decodificatorului 00 1 X 1 00 1 X 1 00 1 1 X 1
BCD / 7 segmente 01 1 X 1 01 X 01 1 X 1
11 1 X X 11 X X 11 X X
10 1 1 X X 10 1 1 X X 10 1 X X
g xy
zt 00 01 11 10
00 1 X 1
01 1 X 1
11 1 X X
10 1 1 X X
a x z yt yt
b y zt z t
c y z t
d x yz yt yz t
e y t zt
f x z t yz yt
g x yz yz yt
x y z t x y z t x y z t
a b
f
decodificatorul BCD / 7
segmente este un circuit xyzt a b c d e f g
care comanda afisajul de tip
0 000 1 1 1 1 1 1 0
7 segmente notate cu litere 0 001 0 1 1 0 0 0 0
de la a la e si primind 0 010 1 1 0 1 1 0 1
coduri binare pe 4 biti 0 011 1 1 1 1 0 0 1
0 100 0 1 1 0 0 1 1
Pentru primele 10 coduri binare se 0 101 1 0 1 1 0 1 1
afiseaza cele 9 cifre de la 0 la 9. 0 110 1 0 1 1 1 1 1
Pentru celelalte 6 coduri, de la 10 la 0 111 1 1 1 0 0 0 0
15, se afiseaza literele de la a la f. 1 000 1 1 1 1 1 1 1
1 001 1 1 1 1 0 1 1
Pentru elementele care lumineaza
1 010 1 1 1 1 1 0 1
primind valoarea “HIGH” circuitul 1 011 0 0 1 1 1 1 1
genereaza “1” pentru ca elementul sa 1 100 1 0 0 1 1 1 0
lumineze si “0” pentru ca elementul 1 101 0 1 1 1 1 0 1
sa ramana stins 1 110 1 1 0 1 1 1 1
Circuitul este unul cu iesiri multiple, 1 111 1 0 0 0 1 1 1
generand 7 functii de 4 variabile
a y t x t x z yz xy z x yt
e x y zt x z y t
b y z x y x z t x z t x zt x z t
Circuite integrate digitale – Circuite cu porți logice 25
Exemplu – decodificator Cod Hexagesimal –7 segmente
Se da funcția: f ab bc
a a 1
Elemente
neutre: 1 a a
f ab bc ab(c c ) (a a )bc
abc abc abc abc abc
abc
abc
P7 P6 P2
P2 P6 P7
Probleme propuse:
1. Implementati functia data sub forma canonica folosind: + +
3. Realizati un circuit numai cu porti SI – NU problema precedenta pentru functia data sub forma minimizata:
4. Realizati un circuit numai cu porti SAU – NU problema precedenta pentru functia data sub forma minimizata:
6. Minimizaţi funcţia care comparţ două cuvinte de 2 biţi A şi B şi dă valoarea 1 când A>B şi implementaţi numai cu porţi
SI-NU.
Probleme propuse (2):
8. Implementati functia data sub forma canonica folosind numai cu porti SI – NU:
a) f=P0+P1+P4+P6 folosind numai porţi SI-NU
b) f=P0+P1+P4+P6 folosind porţi logice
c) f=P0+P1+P4+P6+ P10+P13+P14+P15 folosind numai porţi SI- NU
d) f=P0+P1+P4+P6+ P10+P13+P14+P15 folosind porţi logice
9. Repetati problema precedenta folosind numai cu porti SAU – NU:
10. Realizati un circuit numai cu porti SAU – NU problema precedenta pentru functia data sub forma minimizata:
11. Minimizaţi funcţia votului majoritar de 3 variable şi implementaţi numai cu porţi SI-NU.
12. Minimizaţi funcţia care comparţ două cuvinte de 2 biţi A şi B şi dă valoarea 1 când A>B şi implementaţi numai cu porţi
SI-NU.
16. Sintetizati un circuit logic combinational care semnalizeaza la iesire cu ‘1’ daca toti cei patru biti aplicati la intrare sunt
egali cu ‘1’ sau toti sunt egali cu ‘0’. Folositi numai porti SAU – NU
17. Proiectati un decodificator care semnalizeaza la iesire cu ‘1’ daca cei patru biti aplicati la intrare descriu codul 2, 5, 7
sau 11
18. Proiectati un decodificator care semnalizeaza la iesire cu ‘0’ daca cei patru biti aplicati la intrare descriu codul 4, 6, 9
sau 13.
19. Deduceti expresia canonica a functiilor a si b, implementate cu circuitele acand schema in figura.
x y z t x y z t
a b